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DS/FH混合擴頻接收機解擴及同步技術的FPGA實現

研究采用編碼擴頻的DS/FH混合擴頻接收機的核心模塊――同步及解擴部分的FPGA實現結構。將多種專用芯片的功能集成在一片大規(guī)模FPGA芯片上，實現了接收機的高度集成化、小型化。偽碼的串并混合捕獲算法及跳頻同步算法等均采用硬件完成，提高了捕獲速度。實驗結果證明該方案是正確可行的。
關鍵字：技術 FPGA 實現同步擴及混合擴頻接收機 DS/FH 轉換器

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