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擴(kuò)頻
擴(kuò)頻 文章 進(jìn)入擴(kuò)頻技術(shù)社區(qū)
采用擴(kuò)頻調(diào)制技術(shù)降低D類(lèi)放大器音頻應(yīng)用中的電磁干
- 對(duì)D類(lèi)放大器拓?fù)浣Y(jié)構(gòu)進(jìn)行簡(jiǎn)單的回顧有助于更好地理解電磁干擾(EMI)的根源。
- 關(guān)鍵字： 擴(kuò)頻 調(diào)制技術(shù) D類(lèi)放大器 電磁干擾
擴(kuò)頻為沉寂的時(shí)鐘芯片市場(chǎng)注入活力
- 隨著兩家競(jìng)爭(zhēng)對(duì)手公司近期相繼推出了一類(lèi)新的可編程時(shí)鐘器件，沉寂的時(shí)鐘發(fā)生器芯片市場(chǎng)終于蘇醒了。 賽普拉斯半導(dǎo)體(Cypress Semiconductor)和SpectraLinear推出了基于擴(kuò)頻技術(shù)的時(shí)鐘芯片，據(jù)稱，此類(lèi)芯片可解決時(shí)鐘芯片設(shè)計(jì)中日益增長(zhǎng)的電磁干擾(EMI)問(wèn)題。Cypress增加了一款可編程時(shí)鐘發(fā)生器并拓展了其目前的時(shí)序解決方案。SpectraLinear發(fā)布了其首批產(chǎn)品—— 一個(gè)擴(kuò)頻時(shí)鐘發(fā)生器芯片系列，據(jù)稱它們可降低通信類(lèi)、消費(fèi)類(lèi)和計(jì)算類(lèi)等應(yīng)用中的EMI。 據(jù)Spec
- 關(guān)鍵字： 嵌入式系統(tǒng) 單片機(jī) 擴(kuò)頻 時(shí)鐘 芯片 模擬IC
數(shù)字差分BPSK擴(kuò)頻接收機(jī)的設(shè)計(jì)與FPGA實(shí)現(xiàn)
- 本文提出了一種全數(shù)字差分BPSK擴(kuò)頻接收機(jī)的實(shí)現(xiàn)方案，通過(guò)Simulink仿真驗(yàn)證了該方案具有較低的誤碼率。
- 關(guān)鍵字： FPGA 實(shí)現(xiàn) 設(shè)計(jì) 接收機(jī) BPSK 擴(kuò)頻 數(shù)字差分
一種基于FPGA的直接序列擴(kuò)頻基帶處理器
- 摘 要：本文設(shè)計(jì)實(shí)現(xiàn)了一種基于FPGA的直接序列擴(kuò)頻基帶處理器，并闡述了其基本原理和設(shè)計(jì)方案。關(guān)鍵詞：擴(kuò)頻；FPGA；數(shù)字匹配濾波器；基帶處理器引言擴(kuò)頻通信技術(shù)具有抗干擾、抗多徑、保密性好、不易截獲以及可實(shí)現(xiàn)碼分多址等許多優(yōu)點(diǎn)，已成為無(wú)線通信物理層的主要通信手段。本文設(shè)計(jì)開(kāi)發(fā)了一種基于直接序列擴(kuò)頻技術(shù)(DS-SS)的基帶處理器。直接序列擴(kuò)頻通信直接序列擴(kuò)頻通信系統(tǒng)原理框圖如圖1所示。該處理器由FPGA芯片，完成圖1中兩虛線框所示的基帶信號(hào)處理部分。擴(kuò)頻方式為11位bar
- 關(guān)鍵字： FPGA 基帶處理器 擴(kuò)頻 數(shù)字匹配濾波器
TMS320C54x在擴(kuò)頻通信系統(tǒng)中的應(yīng)用
- 采用TMS320C54x芯片實(shí)現(xiàn)擴(kuò)頻通信系統(tǒng)中的核心進(jìn)程――擴(kuò)頻編碼與調(diào)制。
- 關(guān)鍵字： 應(yīng)用 系統(tǒng) 通信 擴(kuò)頻 TMS320C54x
擴(kuò)頻介紹
擴(kuò)頻是一種信息處理傳輸技術(shù)。擴(kuò)頻技術(shù)是利用同欲傳輸數(shù)據(jù)(信息)無(wú)關(guān)的碼對(duì)被傳輸信號(hào)擴(kuò)展頻譜，使之占有遠(yuǎn)遠(yuǎn)超過(guò)被傳送信息所必需的最小帶寬。
擴(kuò)頻-特性
頻帶
擴(kuò)頻信號(hào)具有以下三個(gè)特性：
（1）擴(kuò)頻信號(hào)是不可預(yù)測(cè)的偽隨機(jī)的寬帶信號(hào)；
（2）擴(kuò)頻信號(hào)帶寬遠(yuǎn)大于欲傳輸數(shù)據(jù)(信息)帶寬；
（3）接收機(jī)中必須有與寬帶載波同步的副本。
傳輸信息時(shí)所用信號(hào)帶寬遠(yuǎn)大于傳輸些信息所 [ 查看詳細(xì) ]
擴(kuò)頻電路
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