接收端 文章 進(jìn)入接收端技術(shù)社區(qū)
PCIe Gen3/Gen4接收端鏈路均衡測(cè)試
- PCIe接口自從被推出以來，已經(jīng)成為了PC和Server上最重要的接口。為了更高了數(shù)據(jù)吞吐率，PCI-SIG組織不斷刷新接口標(biāo)準(zhǔn)，從PCIe?3.0的8GT/s數(shù)據(jù)速率，到PCIe?4.0的16GT/s數(shù)據(jù)速率，再到PCIe?5.0的32GT/x。PCI-SIG組織實(shí)現(xiàn)了在速率翻倍的同時(shí)，仍能保持使用普通的FR4板材和廉價(jià)接插件，主要源自兩個(gè)方面的改進(jìn)，一是使用128b/130b編碼來代替8b/10b編碼，使得編碼效率大幅提高；另一個(gè)是使用動(dòng)態(tài)均衡技術(shù)，來代替先前代的靜態(tài)均衡
- 關(guān)鍵字： 測(cè)試 接收端
基于CORTEX-M3的多機(jī)通信網(wǎng)絡(luò)的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：系統(tǒng)以STM32F103作主控單元，使用RS485通信總線，制定了一套通信協(xié)議，從軟件角度保證了總線仲裁機(jī)制的完整，保證了測(cè)控網(wǎng)絡(luò)的正常運(yùn)轉(zhuǎn)。在系統(tǒng)
- 關(guān)鍵字： RS485通信 協(xié)議半雙工；發(fā)送端 接收端 CORTEX―M3
基于FPGA的ADSP-TS101擴(kuò)展USB接口設(shè)計(jì)
- ADI公司的DSP器件(ADSP-TS101)具有浮點(diǎn)實(shí)時(shí)處理能力強(qiáng)、并行性好等優(yōu)點(diǎn)，從而廣泛被彈載信號(hào)處理系統(tǒng)選用。其...
- 關(guān)鍵字： 接收端 數(shù)據(jù)率 ADSP-TS101 鏈路
USB3.0的物理層接收端的測(cè)試方法
- USB3.0的Receiver測(cè)試的兩種方法 由于USB3.0的速率高達(dá)5Gbps，在USB3.0規(guī)范中接收機(jī)測(cè)試成為必測(cè)項(xiàng)目。接收機(jī)測(cè)試包括了誤碼率測(cè)試和接收機(jī)抖動(dòng)容限測(cè)試兩部分。 對(duì)于Receiver Compliance測(cè)試，需要使用誤碼率測(cè)試儀BERT(Bit Error Ratio Tester，簡稱BERT)，比如力科的PeRT3。BERT由Pattern Generator和Error Detector組成。如下圖1左圖所示為傳統(tǒng)的BER測(cè)試和抖動(dòng)容限測(cè)試的示意圖。BERT的
- 關(guān)鍵字： 力科 USB3.0 接收端
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