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          本土廠商難舍DSP情懷

          • 1948 年貝爾實驗室的克勞德·香農(nóng) (Claude Shannon) 發(fā)表了他具有里程碑意義的論文——《通信的數(shù)學(xué)理論》(A Mathematical Theory of Communication),該論文明確闡述了可實現(xiàn)的比特率、信道帶寬和信噪比之間的關(guān)系。這是DSP(digital signal processing)的元年??梢哉f,香濃的這篇論文開拓了一個新紀(jì)元。但具體到硬件方面,此時距離第一顆DSP芯片面世還有很多年。因為哪怕是最基本的IC,也需要10年后才由TI的Jack Kilby發(fā)明。但
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          精通信號處理設(shè)計小Tips(8):檢測淹沒在噪聲中的信號

          • 精通信號處理設(shè)計小Tips(8):檢測淹沒在噪聲中的信號-相關(guān)函數(shù)的應(yīng)用很廣,比如噪聲中信號的檢測,信號中隱含周期性的檢測,信號時延長度的測量等等。這一節(jié)專門討論利用自相關(guān)函數(shù)檢測淹沒在噪聲下的周期性信號。
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          精通信號處理設(shè)計小Tips(7):應(yīng)用極其廣泛的相關(guān)

          • 精通信號處理設(shè)計小Tips(7):應(yīng)用極其廣泛的相關(guān)-相關(guān)不僅是一個非常有理論價值的概念,而且是一個在實踐中應(yīng)用極為廣泛的處理方法和有效的處理手段。在通信接收機(jī)的同步檢測,導(dǎo)航,定位,電子偵察,延時估計,譜估計等方面有著廣泛的應(yīng)用。后面系列文章,將風(fēng)別結(jié)合實際應(yīng)用,列舉數(shù)例一一說明。
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          精通信號處理設(shè)計小Tips(6):卷積是怎么得到的?

          • 精通信號處理設(shè)計小Tips(6):卷積是怎么得到的?-卷積是信號處理的一個基本概念,它的體現(xiàn)最重要的一個方面,也許就是下面這句話了:時域的卷積對應(yīng)頻域的相乘。這句話,或者說,這個概念,在很多應(yīng)用會得到充分的體現(xiàn),比如頻域均衡,比如信道估計,比如濾波分析等等。
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          工程師須知:FPGA 的演進(jìn)、優(yōu)勢、設(shè)計、改進(jìn)

          • 工程師須知:FPGA 的演進(jìn)、優(yōu)勢、設(shè)計、改進(jìn)-1989年我第一次接觸到電路板的時候,上面密布著一系列的TTL、CMOS芯片,一顆14~20只管腳的芯片中一般只有4-6個簡單的“門”,十幾個芯片的大板子也就完成尋址、譯碼之類的功能,使用起來是非常的痛苦,如果要修改邏輯,只能用手術(shù)刀切割電路板并進(jìn)行飛線。
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          mcu,DSP,PLD/EDA的介紹/比較/分析

          基于FPGA的915 MHz射頻讀卡器設(shè)計

          • 參照ISO/IEC 18000-6 Type B 協(xié)議設(shè)計了一款工作頻率為915 MHz的射頻讀卡器,采用FPGA完成協(xié)議中規(guī)定的數(shù)字信號處理,C8051F020單片機(jī)作為主控器。利用Verilog HDL硬件描述語言,搭建FPGA內(nèi)部各個小模塊及系統(tǒng)的驗證平臺,選用Altera公司Cyclone系列的EP1C6Q240C8芯片為目標(biāo)器件,使用Quartus II進(jìn)行綜合,并通過時序和功能驗證。
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          Xilinx助力邁信成功推出POWERLINK主站

          • 基于賽靈思Zynq All Programmable SoC的解決方案幫助中國武漢邁信電氣技術(shù)有限公司大大降低了開發(fā)難度,同時大幅加速了開發(fā)進(jìn)程,使得中國武漢邁信電氣技術(shù)有限公司成為市場上POWERLINK主站的首家中國供應(yīng)商。2013
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          FPGA雙雄公布季度財報數(shù)據(jù)顯示一片光明

          • FPGA供應(yīng)商Altera和賽靈思近日陸續(xù)公布了健康的財務(wù)數(shù)據(jù)。Altera公司四季度銷售額為4.544億美元,環(huán)比增長2%同比增長3%。賽靈思則為5.87億美元,環(huán)比下降了2%,但是同比激增15%。“受益于Kintex 7系列產(chǎn)品的熱
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          基于PIC32的數(shù)字渦街流量計設(shè)計方案

          • 研究背景與意義1.渦街流量計概述當(dāng)流體中安放一個非流線型旋渦發(fā)生體時,流體將會在發(fā)生體兩側(cè)交替分離,并釋放出兩串規(guī)則的交錯排列的旋渦。在一定范圍內(nèi),旋渦分離頻率與流量成正比。根據(jù)這種原理實現(xiàn)流量測量的流
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          基于DSP及FPGA的水下目標(biāo)定位系統(tǒng)數(shù)字信號處理模塊設(shè)計

          • 隨著水下武器和水下航行器等水下目標(biāo)的快速發(fā)展,對其進(jìn)行定位和跟蹤從而檢驗其性能的試驗具有非常重要的意義,這也是水下目標(biāo)試驗場的重要工作內(nèi)容。水下試驗場的定位系統(tǒng)根據(jù)被測目標(biāo)是否加裝合作聲信標(biāo),可以分為
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          從業(yè)績來看,賽靈思已經(jīng)遠(yuǎn)遠(yuǎn)領(lǐng)先于Altera

          • Altera和賽靈思20年來都在FPGA這個窄眾市場激烈的競爭者,然而Peter Larson基于對兩個公司現(xiàn)金流折現(xiàn)法的研究表明,賽靈思是目前FPGA市場的絕對領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
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          FPGA:縱向創(chuàng)新與橫向整合引領(lǐng)變革

          • FPGA在先進(jìn)工藝路上的狂飚猛進(jìn)帶來了如影隨形的挑戰(zhàn):一方面,進(jìn)入20nm和14nm階段后,不光是FPGA復(fù)雜度提升,對其外圍的電源管理等芯片也提出了“與時俱進(jìn)”的要求。另一方面,隨著SoC FPGA和3D IC技術(shù)
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          硬核浮點(diǎn)DSP的FPGA或取代高性能計算GPGPU

          • 近來,Altera公司推出業(yè)界首款浮點(diǎn)FPGA,它集成了硬核IEEE754兼容浮點(diǎn)運(yùn)算功能,提高了DSP性能、設(shè)計人員的效能和邏輯效率。據(jù)悉,硬核浮點(diǎn)DSP模塊集成在Altera20nmArria10FPGA和SoC中,以及14nmStratix10FPGA和SoC
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          DSP和FPGA各顯神通,應(yīng)對TD-SCDMA基站成本和演進(jìn)需求

          • 由于運(yùn)營商大手筆進(jìn)行基礎(chǔ)設(shè)施建設(shè)的時代已經(jīng)過去,成本和靈活性成為對通信基礎(chǔ)設(shè)施的共同要求,對于TD-SCDMA基站更是如此。因為采用了智能天線等先進(jìn)技術(shù),TD基站的容量大幅提升,但也還帶來了成本挑戰(zhàn);另外,TD技術(shù)
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          數(shù)字信號處理介紹

            數(shù)字信號處理的定義   數(shù)字信號處理是將信號以數(shù)字方式表示并處理的理論和技術(shù)。數(shù)字信號處理與模擬信號處理是信號處理的子集。   數(shù)字信號處理的目的是對真實世界的連續(xù)模擬信號進(jìn)行測量或濾波。因此在進(jìn)行數(shù)字信號處理之前需要將信號從模擬域轉(zhuǎn)換到數(shù)字域,這通常通過模數(shù)轉(zhuǎn)換器實現(xiàn)。而數(shù)字信號處理的輸出經(jīng)常也要變換到模擬域,這是通過數(shù)模轉(zhuǎn)換器實現(xiàn)的。   數(shù)字信號處理的算法需要利用計算機(jī)或?qū)S锰幚碓O(shè) [ 查看詳細(xì) ]
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