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EEPW首頁 >> 主題列表 >> 數(shù)字信號處理器（dsp）

數(shù)字信號處理器（dsp）文章進(jìn)入數(shù)字信號處理器（dsp）技術(shù)社區(qū)

基于DSP的數(shù)碼相機(jī)中的MPEG-4 壓縮

雖然數(shù)碼相機(jī) (DSC) 投入市場僅幾年時間，但已經(jīng)使消費(fèi)類電子成像業(yè)發(fā)生了翻天覆地的變化。目前，全球售出的相機(jī)中大約有三分之一是數(shù)碼相機(jī)，而且其份額還在穩(wěn)步上升。
關(guān)鍵字： DSP 數(shù)碼 MPEG-4 壓縮

MAX706S在DSP系統(tǒng)中的應(yīng)用

對于實際的DSP應(yīng)用系統(tǒng)特別是產(chǎn)品化的DSP系統(tǒng)而言，可靠性是一個不容忽視的問題。由于DSP系統(tǒng)的時鐘頻率比較高，因此在運(yùn)行時極有可能發(fā)生干擾和被干擾的現(xiàn)象，嚴(yán)重時系統(tǒng)可能會出現(xiàn)死機(jī)。為了克服這種情況，除了在軟件上作一些保護(hù)措施外，硬件上也必須作相應(yīng)的處理。硬件上最有效的保護(hù)措施就是采用具有監(jiān)視(Watchdog)功能的自動復(fù)位電路。各大公司生產(chǎn)了多種微處理器監(jiān)控器，用來監(jiān)測微處理器的運(yùn)行狀態(tài)，一旦微處理器失控就強(qiáng)行復(fù)位微處理器，引導(dǎo)程序重新運(yùn)行。
關(guān)鍵字： MAX706S DSP 監(jiān)控電路

動量輪模擬器的設(shè)計

在衛(wèi)星姿態(tài)和軌道控制計算機(jī)(AOCC)分系統(tǒng)的設(shè)計和室內(nèi)聯(lián)調(diào)階段，為方便系統(tǒng)調(diào)試，需設(shè)計動量輪模擬器，模擬執(zhí)行機(jī)構(gòu)動量輪所決定的衛(wèi)星姿態(tài)和控制效果，代替真實部件進(jìn)行分系統(tǒng)的開環(huán)和閉環(huán)試驗。
關(guān)鍵字：動量輪模擬器 DSP

中文語音處理在數(shù)字助聽器的設(shè)計

目前國外對助聽器研究發(fā)展的一個熱點則是集中在中國，確切地講是基于對漢語語言和語音研究，開發(fā)相關(guān)的語音識別技術(shù)和產(chǎn)品。為中心的中文聽力學(xué)也不例外。我們已經(jīng)知道聽覺科學(xué)是一門發(fā)展迅速、知識更新很快的一門學(xué)。
關(guān)鍵字： DSP TOCCATA 語言助聽器

中文語音處理在數(shù)字助聽器系統(tǒng)的開發(fā)

目前國外對助聽器研究發(fā)展的一個熱點則是集中在中國，確切地講是基于對漢語語言和語音研究，開發(fā)相關(guān)的語音識別技術(shù)和產(chǎn)品。為中心的中文聽力學(xué)也不例外。我們已經(jīng)知道聽覺科學(xué)是一門發(fā)展迅速、知識更新很快的一門學(xué)。
關(guān)鍵字： TOCCATA DSP 助聽器語言

基于DSP的加速度計的家用監(jiān)測設(shè)備設(shè)計

先進(jìn)的半導(dǎo)體技術(shù)正為體積越來越小、功能愈加強(qiáng)大的家用醫(yī)療設(shè)備的發(fā)展鋪平道路。對于病人來說，更小的便攜式設(shè)備帶來的好處是更容易進(jìn)行保健、更少去醫(yī)院以及進(jìn)一步降低醫(yī)療費(fèi)用。
關(guān)鍵字： DSP 家用監(jiān)測加速度計

基于適用于多種系統(tǒng)的超聲波成像模擬前端設(shè)計

超聲波成像是一種應(yīng)用廣泛的醫(yī)療成像方法。傳統(tǒng)超聲波成像系統(tǒng)使用2～15MHz的頻率，精度水平為毫米，已廣泛應(yīng)用于監(jiān)控胎兒，以及診斷內(nèi)臟疾病等。在過去的20多年里，傳統(tǒng)臺式超聲波系統(tǒng)主導(dǎo)了醫(yī)療超聲波應(yīng)用。
關(guān)鍵字：模擬前端 DSP 超聲波成像 AFE5805

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：典型實例-整數(shù)DCT變換的設(shè)計與實現(xiàn)

本節(jié)旨在設(shè)計實現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設(shè)計技巧在算法優(yōu)化中的作用。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 整數(shù)DCT變換 H.264

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：典型實例-FPGA片上硬件乘法器的使用

在FPGA+DSP系統(tǒng)設(shè)計系統(tǒng)中，F(xiàn)PGA經(jīng)常作為DSP的協(xié)處理器來輔助完成一些計算任務(wù)。而這些計算工作中最消耗時間的就是乘法運(yùn)算，因此本實例的主要內(nèi)容就是幫助讀者學(xué)會調(diào)用硬件乘法IP核。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 硬件乘法器

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：FPGA+DSP協(xié)同平臺的調(diào)試技巧和注意事項

作為雙芯片的協(xié)同系統(tǒng)，調(diào)試的開始階段需要對每個芯片進(jìn)行單獨測試。這種情況下就需要避免另外一個芯片對調(diào)試產(chǎn)生影響，比較好的辦法就是讓它停止工作。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 內(nèi)部邏輯分析儀隔離調(diào)試

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之： FPGA與DSP的通信接口設(shè)計

以上的接口中，比較常用的接口是EMIF和HPI。其中總線接口需要協(xié)議支持，開發(fā)難度較大，串行接口開發(fā)簡單，但是速率較慢。VPORT等特殊接口一般是在特定的場合下應(yīng)用，不具備通用性，而且需要修改DSP驅(qū)動，開發(fā)周期較長。
關(guān)鍵字： DSP 協(xié)同處理 FPGA 通信接口 EMIF HPI BlockRAM

FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計之：基于FPGA+DSP協(xié)同處理平臺的優(yōu)勢和適用領(lǐng)域

FPGA的一個重要的應(yīng)用領(lǐng)域就是數(shù)字信號處理，隨著FPGA密度和速度的提高，現(xiàn)在FPGA已經(jīng)可以勝任一些原來只有專用芯片或者多DSP才能完成的計算任務(wù)。
關(guān)鍵字： DSP 協(xié)同處理 FPGA

基于FPGA的數(shù)字下變頻的工作理念分析

　近年來，軟件無線電已經(jīng)成為通信領(lǐng)域一個新的發(fā)展方向，數(shù)字下變頻技術(shù)(Digital Down Converter-DDC)是軟件無線電的核心技術(shù)之一，也是計算量最大的部分。基于FPGA的DDC設(shè)計一
關(guān)鍵字： DSP DDC FPGA 濾波器

利用FPGA和多通道光模塊組合長距離傳送高速數(shù)據(jù)

目前基于銅電纜的高速串口能夠以數(shù)千兆位速率進(jìn)行數(shù)據(jù)傳送，并可通過使用多個并行通道達(dá)成超過100Gbps的數(shù)據(jù)傳輸率，不過傳送的距離卻受到限制，一個可以改善傳輸距離的作法是使用光互連來取代銅電纜，Alt
關(guān)鍵字： DSP LGA FPGA DDM

基于DSP的嵌入式導(dǎo)航計算機(jī)系統(tǒng)中CPLD器件軟件更新的實現(xiàn)

針對嵌入式導(dǎo)航計算機(jī)系統(tǒng)中CPLD器件軟件更新需求，提出了通過串行方式基于DSP的CPLD軟件更新方案，通過DSP的I／O口模擬CPLD的JTAG時序邏輯，將由串口接收到的CPLD配置信息文件，移入到其內(nèi)部邏輯中，從而實現(xiàn)軟件更新。分析研究了實現(xiàn)該方案需解決的硬件和軟件中的關(guān)鍵問題，設(shè)計實現(xiàn)了提出的CPLD器件軟件更新方案，并在實際的導(dǎo)航計算機(jī)系統(tǒng)中進(jìn)行了驗證和應(yīng)用。
關(guān)鍵字： CPLD器件軟件更新 DSP JTAG

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數(shù)字信號處理器（dsp）介紹

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數(shù)字信號處理器（dsp）電路

基于ADMCF34X系列直流無刷電機(jī)控制系統(tǒng)設(shè)計
一種基于DSP和USB的指紋識別系統(tǒng)設(shè)計
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
采用DSP和STM32的雙核智能電液伺服控制器

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數(shù)字信號處理器（dsp）資料下載

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