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數(shù)字信號(hào)處理器（dsp）
數(shù)字信號(hào)處理器（dsp） 文章 進(jìn)入數(shù)字信號(hào)處理器（dsp）技術(shù)社區(qū)
基于FPDP的高速數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
- 基于FPDP的高速數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì), 隨著電子技術(shù)的高速發(fā)展，越來(lái)越多的信號(hào)處理系統(tǒng)，需要高速的數(shù)據(jù)采集和大吞吐量的數(shù)據(jù)傳輸，來(lái)實(shí)現(xiàn)數(shù)據(jù)的高速實(shí)時(shí)處理能力。在雷達(dá)系統(tǒng)中，原始數(shù)據(jù)中包含豐富的信息，及時(shí)獲得原始數(shù)據(jù)并進(jìn)行實(shí)時(shí)分析就顯得
- 關(guān)鍵字： 傳輸系統(tǒng) 設(shè)計(jì) 數(shù)據(jù) 高速 FPDP 基于 DSP
基于DSP Builder的16階FIR濾波器實(shí)現(xiàn)
- 現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)器件廣泛用于數(shù)字信號(hào)處理領(lǐng)域．而使用VHDL或VerilogHDL語(yǔ)言進(jìn)行設(shè)計(jì)的難度較大。提出一種采用DSP Builder實(shí)現(xiàn)FIR濾波器的設(shè)計(jì)方案，按照Matlab／Simulink／DSP Builder／Modelsim／QuartusⅡ的設(shè)計(jì)流程，設(shè)計(jì)一個(gè)16階的FIR低通濾波器，并完成了軟硬件的仿真與驗(yàn)證。結(jié)果表明，該方法簡(jiǎn)單易行，可滿足設(shè)計(jì)要求，它驗(yàn)證了采用DSP Builder實(shí)現(xiàn)濾波器設(shè)計(jì)的獨(dú)特優(yōu)勢(shì)。
- 關(guān)鍵字： Builder DSP FIR 濾波器
基于DSP仿人機(jī)器人關(guān)節(jié)控制器設(shè)計(jì)
- 在具有32自由度仿人機(jī)器人中，為了每一個(gè)關(guān)節(jié)動(dòng)作準(zhǔn)確，可以采用分布式控制的體系結(jié)構(gòu)。這里采用基于RS 485總線的TMS320F240DSP作為分布式關(guān)節(jié)控制器，非常適合于在機(jī)械臂內(nèi)的狹小空間內(nèi)安裝，并進(jìn)行增量碼盤(pán)和速度檢測(cè)電路的設(shè)計(jì)以及相應(yīng)的軟件設(shè)計(jì)等，完成了6個(gè)自由度機(jī)械臂分布式關(guān)節(jié)控制器設(shè)計(jì)，能夠滿足仿人機(jī)器人技術(shù)與系統(tǒng)的運(yùn)動(dòng)軌跡的要求。
- 關(guān)鍵字： 控制器 設(shè)計(jì) 關(guān)節(jié) 機(jī)器人 DSP 基于
基于DSP和FPGA的調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng)
- 基于DSP和FPGA的調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng), 引言 隨著通信與廣播電視業(yè)務(wù)的發(fā)展，無(wú)線電頻譜迅速、大量的被占用，頻道擁擠和相互間干擾日趨嚴(yán)重，為了能有效地利用無(wú)線電頻譜，減少相互間的干擾，信號(hào)監(jiān)測(cè)業(yè)務(wù)隨之成為必要。調(diào)幅廣播信號(hào)監(jiān)測(cè)系統(tǒng)是用于實(shí)
- 關(guān)鍵字： 信號(hào) 監(jiān)測(cè) 系統(tǒng) 廣播 調(diào)幅 DSP FPGA 基于 DSP FPGA
一種新的基于DSP的混合預(yù)失真器的設(shè)計(jì)
- 關(guān)鍵字： 預(yù)失真 DSP 混合預(yù)失真器
基于DSP的自適應(yīng)濾波算法的仿真及工程實(shí)現(xiàn)
- 關(guān)鍵字： 自適應(yīng)濾波 LMS DSP
數(shù)字信號(hào)處理器（dsp）介紹
您好，目前還沒(méi)有人創(chuàng)建詞條數(shù)字信號(hào)處理器（dsp）!
歡迎您創(chuàng)建該詞條，闡述對(duì)數(shù)字信號(hào)處理器（dsp）的理解，并與今后在此搜索數(shù)字信號(hào)處理器（dsp）的朋友們分享。 創(chuàng)建詞條
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