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數(shù)字基帶預(yù)失真系統(tǒng)
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數(shù)字基帶預(yù)失真系統(tǒng)中環(huán)路延遲估計(jì)的FPGA實(shí)現(xiàn)
- 基于FPGA芯片Stratix II EP2S60F672C4設(shè)計(jì)實(shí)現(xiàn)了數(shù)字基帶預(yù)失真系統(tǒng)中的環(huán)路延遲估計(jì)模塊。該模塊運(yùn)用了一種環(huán)路延遲估計(jì)新方法，易于FPGA實(shí)現(xiàn)。同時(shí)，在信號(hào)失真的情況下也能給出正確的估計(jì)結(jié)果。Modelsim SE 6.5c的時(shí)序仿真結(jié)果和SignalTaps II的硬件調(diào)試結(jié)果驗(yàn)證了模塊的有效性。
- 關(guān)鍵字： 數(shù)字基帶預(yù)失真系統(tǒng) 環(huán)路延遲估計(jì) FPGA
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數(shù)字基帶預(yù)失真系統(tǒng)介紹
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歡迎您創(chuàng)建該詞條，闡述對(duì)數(shù)字基帶預(yù)失真系統(tǒng)的理解，并與今后在此搜索數(shù)字基帶預(yù)失真系統(tǒng)的朋友們分享。 創(chuàng)建詞條
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