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基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計(jì)方案

本文采用FPGA作為實(shí)現(xiàn)控制邏輯的核心部件，提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計(jì)方案，并介紹了上位機(jī) ...
關(guān)鍵字： FPGA 數(shù)據(jù)分配矩陣設(shè)計(jì)

上世紀(jì)60年代初，香農(nóng)的學(xué)生Gallager在他的博士畢業(yè)論文中首次提出了LDPC碼的概念和完整的譯碼方法，但是直到上世紀(jì)末期，隨著LDPC碼譯碼理論的進(jìn)步和計(jì)算機(jī)技術(shù)的發(fā)展，LDPC碼才以其優(yōu)良的誤碼性能和良好的可實(shí)現(xiàn)性成為人們研究的焦點(diǎn)。針對(duì)QC類LDPC碼進(jìn)行研究的時(shí)候，注意到很多碼的循環(huán)子矩陣中不只有一組1，這就產(chǎn)生了水平運(yùn)算后判斷運(yùn)算結(jié)果屬于哪個(gè)存儲(chǔ)模塊的問題；另外，由于校驗(yàn)矩陣中每個(gè)循環(huán)子矩陣的列初始位置都是不同的，而且通常LDPC碼的校驗(yàn)矩陣的循環(huán)子矩陣的數(shù)目都是非常龐大的，因此如果通過程序
關(guān)鍵字： LDPC 通用準(zhǔn)循環(huán) 數(shù)據(jù)分配

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