時序收斂 文章 進(jìn)入時序收斂技術(shù)社區(qū)
加速時序簽收步伐，應(yīng)對復(fù)雜設(shè)計挑戰(zhàn)
- 目前，花費(fèi)在時序收斂與簽收(Timing closure and signoff)上的時間接近整個設(shè)計實現(xiàn)流程時間的40%，復(fù)雜設(shè)計對實現(xiàn)時序收斂提出了更高的要求。但在Cadence公司芯片實現(xiàn)之簽收與驗證部門，公司副總裁Anirudh Devgan看來，傳統(tǒng)的簽收流程卻沒能跟上這種需求的步伐。為幫助系統(tǒng)級芯片(SoC)開發(fā)者加速時序收斂
- 關(guān)鍵字： EDA設(shè)計 時序收斂
Plunify從Lanza techVentures獲得融資
- 開創(chuàng)性FPGA軟件供應(yīng)商Plunify® Pte. Ltd.今日宣布，從早期風(fēng)險資本投資公司Lanza techVentures獲得一輪融資。 此次所獲投資將被用于發(fā)展Plunify的銷售和技術(shù)支持渠道，擴(kuò)展其市場團(tuán)隊，以推動專用于FPGA設(shè)計的InTimeTM時序收斂加速軟件。Lanza techVentures總經(jīng)理Lucio Lanza將成為Plunify董事會的一員。Lanza techVentures的自由合伙人Mark Templeton將擔(dān)任公司顧問。 Lanza t
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