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          EEPW首頁 >> 主題列表 >> 時鐘源

          基于Xilinx FPGA的DCM動態(tài)重配置方法研究及實現(xiàn)

          • 介紹了Xilinx FPGA中DCM的結(jié)構和相關特性,提出了一種基于Xilinx FPGA的DCM動態(tài)重配置的原理方法,并給出了一個具體的實現(xiàn)系統(tǒng)。系統(tǒng)僅通過外部和Xilinx XC4VFX100相連的少數(shù)控制線,就可以在輸入100 MHz時鐘源的條件下,對DCM進行50~300 MHz范圍內(nèi)準確、快速地變頻。本設計系統(tǒng)具有接口簡單、實時性強、穩(wěn)定性高等特點,目前已成功應用到某星載系統(tǒng)中。
          • 關鍵字: DCM配置  時鐘源  FPGA  

          時鐘源電路圖

          如何設計選通脈沖串又不會截短脈沖的電路

          •   要想從一個連續(xù)的時鐘源選通一個完整的時鐘脈沖序列而又不改變脈沖的持續(xù)時間和數(shù)量,不是一件容易的事情。在大多數(shù)情況下,簡單的與門會有問題,見圖1。   只要異步選通信號E是高電平,時鐘脈沖就會通過與門。哪怕丟失或失真一個脈沖都會很關鍵,那么簡單的與門就不合適了—由于時鐘和E之間缺少同步,脈沖串中的第一個和最后一個脈沖經(jīng)常會失真(比正常脈沖短)。        圖1:兩種選通脈沖串的方法,一種是使用選通信號E和與門(Y輸出),一種是量化器(藍色)。   本設計實例展示了
          • 關鍵字: 時鐘脈沖  時鐘源  

          串行總線技術全面解析

          如何正確選擇低功耗MCU

          • 嵌入式微控制器 (MCU)的功耗在當今電池供電應用中正變得越來越舉足輕重。大多 MCU 芯片廠商都提供低功耗產(chǎn) ...
          • 關鍵字: 低功耗  MCU  時鐘源  

          利用低抖動LVPECL扇出緩沖器增加時鐘源的輸出數(shù)

          • 器件連接/參考 ADF4351:集成VCO的小數(shù)N分頻PLL合成器ADCLK948:提供8路LVPECL輸出的時鐘扇出緩沖器 評估和設計支持 電路評估板 ADF4351評估板(EVAL-ADF4351EB1Z)ADCLK948評估板(ADCLK948/PCBZ) 設計和集成文件 原理
          • 關鍵字: LVPECL  低抖動  扇出緩沖器  時鐘源    

          高加速度條件下的時鐘源管理設計

          • 引言在高加速度環(huán)境下,由于石英晶體振蕩器本身的機械特性,它在100000g的情況下,自身就有損壞的可能。而硅振蕩器啟動一致和快速,不像RC電路那樣易受到性能欠佳問題的阻擾。標準的硅片制造和組裝技術意味著,硅振蕩
          • 關鍵字: 加速度  條件下  時鐘源    

          為您的轉(zhuǎn)換器選擇正確的時鐘(3)

          • 了解時鐘源 采樣時鐘的潛在來源很多。通常,選擇范圍可以縮小至固定和可調(diào)頻率。適合數(shù)據(jù)轉(zhuǎn)換器的時鐘可參考AN-835[1]和AN-928[2]。這些時鐘的共同點是具有一直被關注的兩個重要特性:良好的寬帶噪聲性能和低非諧波雜散。雖然簡單地選擇任意時鐘源很吸引人,但這樣會導致性能不佳,尤其要注意宣傳低相位噪聲的廉價振蕩器。最佳做法是在開始設計前測試并測量時鐘源的相位噪聲,即便制造商聲稱相位噪聲或抖動性能良好。抖動測量時常不一致,使用了針對其他類型系統(tǒng)的方法。這些測量可能不適用于ADC性能,在選擇時鐘源前應予以
          • 關鍵字: 時鐘源  振蕩器  201107  

          一種新穎的內(nèi)外頻標自適應式時鐘源的設計

          • 介紹傳統(tǒng)內(nèi)外頻標切換時鐘源的工作原理,分析了其缺點。在此基礎上,提出一種新的以軟件檢測環(huán)路鎖定指示和控制內(nèi)頻標電源的設計方法,使時鐘源能完成在不同內(nèi)外頻標作用下的自適應切換。同時給出了自適應式時鐘源的軟件實現(xiàn)流程以及環(huán)路濾波器的設計。實驗結(jié)果表明,該時鐘源不僅具有良好的電性能,且內(nèi)外頻標的自適應切換也很可靠。
          • 關鍵字: 時鐘源    

          系統(tǒng)時鐘源的比較選擇及高性能PLL的發(fā)展趨勢

          • 在所有電子系統(tǒng)中,時鐘相當于心臟,時鐘的性能和穩(wěn)定性直接決定著整個系統(tǒng)的性能。典型的系統(tǒng)時序時鐘信號的產(chǎn)生和分配包含多種功能,如振蕩器源、轉(zhuǎn)換至標準邏輯電平的部件以及時鐘分配網(wǎng)絡。這些功能可以由元器件芯片組或高度集成的單封裝來完成,如圖1所示。 系統(tǒng)時鐘源需要可靠、精確的時序參考,通常所用的就是晶體。本文將比較兩種主要的時鐘源——晶體振蕩器(XO,簡稱晶振)模塊和鎖相環(huán)(PLL)合成器,并探討高性能PLL的發(fā)展趨勢。? ? 圖1:安森美半導體提供的
          • 關鍵字: 時鐘源 選擇 PLL 發(fā)展   

          為時鐘源編程的計算機并行端口

          • 本設計實例說明如何將Linear Technology公司的LTC6903可編程振蕩器作為時鐘源應用在直接數(shù)字合成、數(shù)據(jù)轉(zhuǎn)換、開關電容濾波、時鐘和壓控振蕩器等電路中。
          • 關鍵字: 時鐘源  編程  計算機  并行端口    
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          時鐘源介紹

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