時(shí)鐘頻率 文章 進(jìn)入時(shí)鐘頻率技術(shù)社區(qū)
用DSP實(shí)現(xiàn)抖動(dòng)（Jitter）測(cè)量的方法
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： DSP 抖動(dòng)（Jitter）測(cè)量 時(shí)鐘頻率
基于Astro工具的ASIC時(shí)序分析
- 引言 隨著系統(tǒng)時(shí)鐘頻率的提高，時(shí)鐘偏斜和干擾開始成為IC工程師重點(diǎn)考慮的問題。增大時(shí)序電路的時(shí)鐘頻率，減小時(shí)序電路的容差能提升未來的系統(tǒng)性能。低偏斜時(shí)鐘緩沖器和鎖相環(huán)時(shí)鐘驅(qū)動(dòng)器將幫助設(shè)計(jì)人員設(shè)計(jì)出速度、偏斜和抗噪性能等指標(biāo)滿足要求的電路系統(tǒng)，但必須將時(shí)鐘電路設(shè)計(jì)為一個(gè)時(shí)鐘系統(tǒng)，考慮時(shí)鐘分步網(wǎng)絡(luò)的各個(gè)方面，包括驅(qū)動(dòng)器、傳輸線路和信號(hào)布線等。 時(shí)鐘偏斜 時(shí)鐘偏斜定義為在時(shí)鐘分布系統(tǒng)中到達(dá)各個(gè)時(shí)鐘末端(即器件內(nèi)部觸發(fā)器的時(shí)鐘輸入端)的時(shí)鐘相位不一致的現(xiàn)象。如果時(shí)鐘偏斜超過所允許的最大值，電
- 關(guān)鍵字： 嵌入式系統(tǒng) 單片機(jī) 時(shí)鐘頻率 IC 驅(qū)動(dòng)器 通訊 無線 網(wǎng)絡(luò) 嵌入式系統(tǒng) 單片機(jī) 模擬IC
時(shí)鐘頻率介紹
時(shí)鐘頻率，是提供電腦定時(shí)信號(hào)的一個(gè)源，這個(gè)源產(chǎn)生不同頻率的基準(zhǔn)信號(hào)，用來同步CPU的每一步操作，通常簡稱其為頻率。CPU的主頻，是其核心內(nèi)部的工作頻率（核心時(shí)鐘頻率），它是評(píng)定CPU性能的重要指標(biāo)。一般來說主頻數(shù)字值越大越好。外頻，是CPU外部的工作頻率，是由主板提供的基準(zhǔn)時(shí)鐘頻率。FSB頻率，是連接CPU和主板芯片組中的北橋芯片的前端總線（Front Side Bus）上的數(shù)據(jù)傳輸頻率。CPU的 [ 查看詳細(xì) ]
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