模數(shù)轉(zhuǎn)換器（adc）文章進入模數(shù)轉(zhuǎn)換器（adc）技術(shù)社區(qū)

電路筆記：集成同步解調(diào)功能的低功耗LVDT信號調(diào)理器

連接/參考器件ADA2200同步解調(diào)器和可配置模擬濾波器AD7192內(nèi)置PGA的4.8 kHz、超低噪聲、24位Sigma;-Delta;型ADCADG794低壓、300 MHz、四通道2:1多路
關(guān)鍵字：信號調(diào)理器集成式同步解調(diào)器模數(shù)轉(zhuǎn)換器 ADC

全差分放大器的概念及其優(yōu)勢

目前，世界上大多數(shù)的高速模數(shù)轉(zhuǎn)換器 (ADC)都具有差分輸入。這些ADC被廣泛的運用于多種終端的應(yīng)用當(dāng)中，但不僅僅局限于通信無線基礎(chǔ)設(shè)施和回傳，以及
關(guān)鍵字：差分放大器 ADC FDA

\"驅(qū)動 ADC 輸入\"時的第一經(jīng)驗法則

工程師們喜歡通過多種方法簡化設(shè)計流程。我最喜歡的是一直采用低阻抗電源驅(qū)動模數(shù)轉(zhuǎn)換器 (ADC) 輸入。為什么我會對這種方法情有獨鐘?因為它可為精確
關(guān)鍵字： ADC 電源驅(qū)動數(shù)據(jù)采集

ADC的峰峰分辨率與有效分辨率

低帶寬、高分辨率ADC的有效位數(shù)計算方法因公司而異，而器件的有效位數(shù)受噪聲限制。有些公司規(guī)定使用有效分辨率來表示有效位數(shù)，ADI則規(guī)定使用峰峰值分
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ADC 中的集成式容性 PGA ：重新定義性能

ADI專利的容性可編程增益放大器(PGA)相比傳統(tǒng)的阻性PGA具有更佳的性能，包括針對模擬輸入信號的更高共模電壓抑制能力。
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MCU怎么做一個簡單的ADC?

　　STM32的優(yōu)點在哪里?除去宣傳環(huán)節(jié)，細(xì)細(xì)分析，STM32時鐘不算快，72MHZ，也不能擴展大容量的RAM FLASH，同樣沒有DSP那樣強大的指令集。它的優(yōu)勢在哪里呢?　　---就在快速采集數(shù)據(jù)，快速處理上?！　RM的特點就是方便?！∵@個快速采集，高性能的ADC就是一個很好的體現(xiàn)，12位精度，最快1uS的轉(zhuǎn)換速度，通常具備2個以上獨立的ADC控制器，這意味著，STM32可以同時對多個模擬量進行快速采集，這個特性不是一般的MCU具有的。以上高性能的ADC，配合相對比較塊的指令集和一些特色的算法支持，
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如何基于C2000內(nèi)置12位ADC設(shè)計電能計量方案？

摘要本應(yīng)用筆記介紹了基于C2000內(nèi)核和片內(nèi)12位ADC實現(xiàn)軟件電能計量的方案。C2000是德州儀器半導(dǎo)體有限公司生產(chǎn)的32位高性能實時微控制器，廣泛應(yīng)用于諸
關(guān)鍵字： C2000 控制 ADC

STM32 ADC基礎(chǔ)與多通道采樣

12位ADC是一種逐次逼近型模擬數(shù)字?jǐn)?shù)字轉(zhuǎn)換器。它有多達18個通道，可測量16個外部和2個內(nèi)部信號源。ADC的輸入時鐘不得超過14MHZ，它是由PCLK2經(jīng)分頻產(chǎn)
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一種基于每周期兩位轉(zhuǎn)換的流水線逐次逼近ADC

隨著半導(dǎo)體制造工藝的革新與芯片供電電壓的下降，高性能的模數(shù)轉(zhuǎn)換器設(shè)計面臨新的挑戰(zhàn)。傳統(tǒng)的逐次逼近SAR模數(shù)轉(zhuǎn)換器與流水線Pipelined模數(shù)轉(zhuǎn)化器難以實現(xiàn)高轉(zhuǎn)化速率、高精度與低功耗的性能指標(biāo)，常常需要犧牲某個指標(biāo)來滿足其他要求。針對傳統(tǒng)模數(shù)轉(zhuǎn)換器電路結(jié)構(gòu)在精度、轉(zhuǎn)換速率以及功耗方面的不足之處，提出了一種基于每周期兩位轉(zhuǎn)化的流水線逐次逼近12位5兆的ADC，采用兩級流水線結(jié)構(gòu)，第二級采用每周期兩位量化的SAR模數(shù)轉(zhuǎn)換器實現(xiàn)，可以充分利用輸入電壓幅值較小的特點，實現(xiàn)整體電路性能的優(yōu)化，最終可在5兆的采樣速度
關(guān)鍵字：逐次逼近SAR 模數(shù)轉(zhuǎn)換器流水線Pipelined 模數(shù)轉(zhuǎn)化器每周期兩位轉(zhuǎn)換 201807

如何在MCU內(nèi)完成一次ADC？

　　STM32的優(yōu)點在哪里?除去宣傳環(huán)節(jié)，細(xì)細(xì)分析，STM32時鐘不算快，72MHZ，也不能擴展大容量的RAM FLASH，同樣沒有DSP那樣強大的指令集。它的優(yōu)勢在哪里呢?　　---就在快速采集數(shù)據(jù)，快速處理上?！　RM的特點就是方便?！∵@個快速采集，高性能的ADC就是一個很好的體現(xiàn)，12位精度，最快1uS的轉(zhuǎn)換速度，通常具備2個以上獨立的ADC控制器，這意味著，STM32可以同時對多個模擬量進行快速采集，這個特性不是一般的MCU具有的。以上高性能的ADC，配合相對比較塊的指令集和一些特色的算法支持，
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HMC661LC4B和HMC1061LC5配合ADC使用的一般原則和程序

　　INTRODUCTION　　簡介　　軟件定義無線電、雷達系統(tǒng)、電子戰(zhàn)(EW)、電子智能(ELINT)以及測試測量設(shè)備等各種應(yīng)用，需要帶寬為數(shù)GHz的寬帶數(shù)據(jù)采集系統(tǒng)。理想情況下，系統(tǒng)設(shè)計人員希望能夠?qū)⑿盘栐?例如天線)直接連接到寬帶高動態(tài)范圍模數(shù)轉(zhuǎn)換器(ADC)進行數(shù)字化。這些應(yīng)用中有很多涉及到子采樣，其中目標(biāo)信號是遠高于ADC采樣率的高頻信號。這種方法的一個主要限制是當(dāng)前ADC通常沒有足夠的帶寬來支持這些超寬帶應(yīng)用。雖然有多種高速ADC提供增強的采樣速率，但其中能夠提供數(shù)GHz以上輸入帶寬的則很少。
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基于40 nm CMOS工藝的高速SAR ADC的設(shè)計

基于40 nm CMOS工藝，設(shè)計了一種高速逐次逼近型模數(shù)轉(zhuǎn)換器。本設(shè)計采用了非二進制冗余DAC技術(shù)來緩解ADC對建立時間和建立精度的要求，來提高ADC量化的準(zhǔn)確性;采用帶有預(yù)放大級的高速比較器來提高比較器的精度，同時減小后級Latch的回踢噪聲，采用了兩級Latch來進一步提高比較器的速度;采用基于鎖存器的鎖存單元來提高SAR邏輯控制電路的速度，并且采用了異步時序控制，不需要外部時鐘，有利于提高SAR ADC的速度，并降低了設(shè)計的復(fù)雜度。設(shè)計的SAR ADC在160 MHz的采樣頻率下，在不同輸入信號頻
關(guān)鍵字：高速通信模數(shù)轉(zhuǎn)換器逐次逼近非二進制 201803

華虹半導(dǎo)體推出12位SAR ADC IP助力超低功耗MCU平臺

　　全球領(lǐng)先的200mm純晶圓代工廠——華虹半導(dǎo)體有限公司 (“華虹半導(dǎo)體”或“公司”，連同其附屬公司，統(tǒng)稱“集團”，股份代號：1347.HK) 今日宣布，基于其0.11微米超低漏電 (Ultra-Low-Leakage，ULL) 嵌入式閃存 (eFlash) 工藝平臺，推出自主設(shè)計的超低功耗12位逐次逼近 (SAR)型模數(shù)轉(zhuǎn)換器 (ADC) (12-Bit SAR ADC) IP，達到
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14位125MSPS四通道ADC電路圖（通過后端數(shù)字求和增強SNR性能）

14位125MSPS四通道ADC電路圖（通過后端數(shù)字求和增強SNR性能）-所示電路是14位、125 MSPS四通道ADC系統(tǒng)的簡化圖，該電路使用后端數(shù)字求和將信噪比（SNR）從單通道ADC的 74 dBFS提升到四通道ADC的78.5 dBFS。這項技術(shù)特別適合要求高SNR（如超聲和雷達）的應(yīng)用，并且利用了現(xiàn)代高性能、低功耗、四通道流水線式ADC。##表2總結(jié)了系統(tǒng)的測量性能，其中?3 dB帶寬為67 MHz。網(wǎng)絡(luò)的總插入損耗約為3dB，因此需要+13dBm的輸入驅(qū)動能力，以便為ADC的輸入提供滿量程2V
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模數(shù)轉(zhuǎn)換器應(yīng)用電路設(shè)計解析—電路圖天天讀（275）

模數(shù)轉(zhuǎn)換器應(yīng)用電路設(shè)計解析—電路圖天天讀（275）-模數(shù)轉(zhuǎn)換器即A/D轉(zhuǎn)換器，或簡稱ADC，通常是指一個將模擬信號轉(zhuǎn)變?yōu)閿?shù)字信號的電子元件。通常的模數(shù)轉(zhuǎn)換器是將一個輸入電壓信號轉(zhuǎn)換為一個輸出的數(shù)字信號。本文介紹幾款模數(shù)轉(zhuǎn)換器芯片電路原理。
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