流水線 文章 進(jìn)入流水線技術(shù)社區(qū)
一種可重構(gòu)流水線ADC的設(shè)計(jì)
- 摘要：對多標(biāo)準(zhǔn)無線通信系統(tǒng)中的A／D轉(zhuǎn)換器進(jìn)行了研究，根據(jù)無線通信系統(tǒng)的特點(diǎn)，構(gòu)建了一個(gè)新型可重構(gòu)流水線A／D轉(zhuǎn)換器結(jié)構(gòu)，該A／D轉(zhuǎn)換器的可重構(gòu)功能是通過在低分辨率下關(guān)斷子級流水線來實(shí)現(xiàn)的。轉(zhuǎn)換器的系統(tǒng)指標(biāo)
- 關(guān)鍵字： 設(shè)計(jì) ADC 流水線 重構(gòu)
基于FPGA的高速流水線浮點(diǎn)乘法器設(shè)計(jì)與實(shí)現(xiàn)
- 1 引言 在數(shù)字化飛速發(fā)展的今天，人們對微處理器的性能要求也越來越高。作為衡量微處理器 性能的主要標(biāo)準(zhǔn)，主頻和乘法器運(yùn)行一次乘法的周期息息相關(guān)。因此，為了進(jìn)一步提高微處 理器性能，開發(fā)高速高精度的乘法器
- 關(guān)鍵字： FPGA 流水線 浮點(diǎn) 乘法器設(shè)計(jì)
流水線處理技術(shù)在數(shù)據(jù)集成中的應(yīng)用
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： 數(shù)據(jù)集成 流水線 內(nèi)存控制
電子產(chǎn)品流水線自動(dòng)送板機(jī)設(shè)計(jì)
- 本文給出了電子產(chǎn)品流水線上使用的自動(dòng)送板機(jī)設(shè)計(jì)方案。描述了硬件系統(tǒng)和軟件系統(tǒng)，通過測試表明，該系統(tǒng)能夠完成對電子產(chǎn)品流水線上自動(dòng)貼片機(jī)／插裝機(jī)的自動(dòng)送板?？捎行岣呱a(chǎn)效率，降低工人勞動(dòng)強(qiáng)度。
- 關(guān)鍵字： 設(shè)計(jì) 自動(dòng) 流水線 電子產(chǎn)品
適用于12 bit流水線ADC采樣保持電路的設(shè)計(jì)
- 本文設(shè)計(jì)了一個(gè)可用于12 bit，20 MS／s流水線ADC中的采樣／保持電路。該電路使用CSMC公司的0.5μm CMOS工藝庫，在20 MS／s采樣頻率下，當(dāng)輸入信號的頻率為9.8193 MHz時(shí)，SFDR為76 dB，精度達(dá)0.012％，完全滿足12 bit要求。本文運(yùn)用增益增強(qiáng)型折疊式運(yùn)算放大器，以獲得較高的增益和帶寬。同時(shí)采用柵壓自舉開關(guān)，并通過對電路中的開關(guān)組合優(yōu)化，極大的提高了電路的線性性能；采用全差分結(jié)構(gòu)、底極板采樣來消除電荷注入和時(shí)鐘饋通。該采樣保持電路能夠直接應(yīng)用于高速高精度模／數(shù)轉(zhuǎn)換
- 關(guān)鍵字： 保持 電路 設(shè)計(jì) 采樣 ADC bit 流水線 適用于
高速流水線浮點(diǎn)加法器的FPGA實(shí)現(xiàn)
- 本工程設(shè)計(jì)完全符合IP核設(shè)計(jì)的規(guī)范流程，而且完成了Verilog HDL建模、功能仿真、綜合、時(shí)序仿真等IP核設(shè)計(jì)的整個(gè)過程，電路功能正確。實(shí)際上，本系統(tǒng)在布局布線后，其系統(tǒng)的最高時(shí)鐘頻率可達(dá)80MHz。雖然使用浮點(diǎn)數(shù)會(huì)導(dǎo)致舍入誤差，但這種誤差很小，可以忽略。實(shí)踐證明，本工程利用流水線結(jié)構(gòu)，方便地實(shí)現(xiàn)了高速、連續(xù)、大數(shù)據(jù)量浮點(diǎn)數(shù)的加法運(yùn)算，而且設(shè)計(jì)結(jié)構(gòu)合理，性能優(yōu)異，可以應(yīng)用在高速信號處理系統(tǒng)中。
- 關(guān)鍵字： FPGA 流水線 浮點(diǎn) 加法器
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