燦芯半導(dǎo)體文章進(jìn)入燦芯半導(dǎo)體技術(shù)社區(qū)

燦芯半導(dǎo)體發(fā)布通用高性能小數(shù)分頻鎖相環(huán)IP及相關(guān)解決方案

一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體（上海）股份有限公司近日宣布成功研發(fā)出一款通用高性能小數(shù)分頻鎖相環(huán)（fractional-N PLL） IP，支持24bits高精度小數(shù)分頻，最高輸出頻率4.5Ghz，另外還支持?jǐn)U頻時(shí)鐘（SSC）功能，可以為客戶提供多功能的小數(shù)分頻 PLL解決方案。PLL電路一般用于產(chǎn)生輸出頻率，輸出頻率值與PLL的參考輸入頻率呈倍數(shù)關(guān)系。小數(shù)分頻PLL通過頻率乘法比例的小數(shù)值，實(shí)現(xiàn)更精確的輸出頻率控制，從而提供更高精度和準(zhǔn)確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內(nèi)調(diào)制時(shí)鐘信號(hào)
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燦芯半導(dǎo)體推出xSPI/Hyperbus/Xcella控制器和PHY整體解決方案

一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體日前宣布推出xSPI/HyperbusTM/XcellaTM存儲(chǔ)器（閃存、PSRAM、MRAM 等）的控制器和PHY解決方案，適用于客制化SoC。該解決方案采用了兆易創(chuàng)新、愛普科技、賽普拉斯（英飛凌）、美光、旺宏電子等memory廠商的存儲(chǔ)器進(jìn)行驗(yàn)證，可以支持客戶在不同領(lǐng)域更快地開發(fā)性能更優(yōu)異的產(chǎn)品。由JEDEC在2018年7月批準(zhǔn)的eXpanded串行外設(shè)接口（xSPI）JESD251標(biāo)準(zhǔn)，定義了一種用于存儲(chǔ)器的高數(shù)據(jù)吞吐量串行接口。它提供高數(shù)據(jù)吞吐量
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采用燦芯半導(dǎo)體SoC平臺(tái)解決方案的智能電表芯片開始量產(chǎn)

中國(guó)上海，2019年10月16日，全球領(lǐng)先的定制化芯片（ASIC）設(shè)計(jì)解決方案提供商燦芯半導(dǎo)體（“燦芯”）對(duì)外宣布，采用燦芯SoC平臺(tái)解決方案以及中芯國(guó)際40nm及0.13um工藝研發(fā)、可實(shí)現(xiàn)RF和PLC通信的兩顆芯片進(jìn)入量產(chǎn)階段。此芯片設(shè)計(jì)將RF和PLC通信集合于同一芯片組上，整合了多個(gè)傳輸接口IP，支持工業(yè)級(jí)的有線或無線連接，如PLC, IEEE 802.15.4g和 WiFi，為智能水表、電表和氣表提供智能互連方案；利用自適應(yīng)通信功能，網(wǎng)絡(luò)基礎(chǔ)設(shè)施的部署將更加便捷、快速以及成本更低?！爸悄茈姳硇酒?/li>
關(guān)鍵字：燦芯半導(dǎo)體 SoC平臺(tái)解決方案智能電表芯片

中芯國(guó)際與燦芯首創(chuàng)SMIC-ASIC網(wǎng)絡(luò)互動(dòng)平臺(tái)

　　國(guó)際領(lǐng)先的IC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商 -- 燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱“燦芯半導(dǎo)體”)與中國(guó)內(nèi)地規(guī)模最大、技術(shù)最先進(jìn)的集成電路晶圓代工企業(yè) -- 中芯國(guó)際集成電路制造有限公司(“中芯國(guó)際”，紐交所代號(hào)：SMI，港交所代號(hào)：981)，于2014年6月5日宣布聯(lián)合推出SMIC-ASIC網(wǎng)絡(luò)服務(wù)平臺(tái)。該平臺(tái)是由燦芯半導(dǎo)體創(chuàng)建，并由中芯國(guó)際和燦芯半導(dǎo)體共同打造的專業(yè)的半導(dǎo)體產(chǎn)業(yè)網(wǎng)絡(luò)交流平臺(tái)，為客戶解答基礎(chǔ)ASIC問題以及提供專業(yè)工程技術(shù)和商務(wù)咨詢，并為整個(gè)ASIC項(xiàng)目開發(fā)提供參考，實(shí)現(xiàn)創(chuàng)新的業(yè)務(wù)
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中芯國(guó)際、燦芯半導(dǎo)體和CEVA合作力推DSP硬核及平臺(tái)

　　國(guó)際領(lǐng)先的IC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商?--?燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱“燦芯半導(dǎo)體”)與中國(guó)內(nèi)地規(guī)模最大、技術(shù)最先進(jìn)的集成電路晶圓代工企業(yè)——中芯國(guó)際集成電路制造有限公司以及CEVA公司——領(lǐng)先的IP平臺(tái)解決方案和數(shù)位信號(hào)處理器(DSP)?核心授權(quán)商，今日聯(lián)合宣布：三方將共同開發(fā)CEVA?DSP硬核，為客戶降低研發(fā)風(fēng)險(xiǎn)、縮短SoC項(xiàng)目的設(shè)計(jì)周期。根據(jù)協(xié)議，燦芯半導(dǎo)體取得一系列基于中芯國(guó)際工藝的CEVA?DSP核心技術(shù)的獨(dú)家授權(quán)，開發(fā)針對(duì)特
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燦芯半導(dǎo)體爭(zhēng)當(dāng)設(shè)計(jì)服務(wù)業(yè)的排頭兵

　　10月10日“中國(guó)集成電路設(shè)計(jì)業(yè)2013年會(huì)暨合肥集成電路創(chuàng)新發(fā)展高峰論壇”在合肥盛大開幕,云集了眾多業(yè)界知名的晶圓代工廠、EDA、IP及IC設(shè)計(jì)產(chǎn)商，燦芯半導(dǎo)體仍然與投資方中芯國(guó)際聯(lián)袂參展，展示了其先進(jìn)技術(shù)的最新進(jìn)展和成功案例。　　自從2010年中國(guó)大陸第一大芯片代工廠中芯國(guó)際投資燦芯半導(dǎo)體后，燦芯半導(dǎo)體所有工藝產(chǎn)品都是與其合作的。中芯國(guó)際擁有世界先進(jìn)的制造工藝、穩(wěn)定的生產(chǎn)線、充足的產(chǎn)能和高品質(zhì)的良率，再加上燦芯半導(dǎo)體的高端設(shè)計(jì)能力和定制化的IP，客戶在中國(guó)就可以享受到一
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燦芯半導(dǎo)體40納米項(xiàng)目累計(jì)達(dá)兩位數(shù)

　　燦芯半導(dǎo)體宣布與客戶合作開發(fā)的40納米芯片設(shè)計(jì)項(xiàng)目數(shù)量累計(jì)達(dá)到十個(gè)，這些項(xiàng)目均基于中芯國(guó)際的40納米制造工藝。　　燦芯半導(dǎo)體開發(fā)的先進(jìn)技術(shù)芯片廣泛應(yīng)用于高成長(zhǎng)的移動(dòng)設(shè)備領(lǐng)域，如智能手機(jī)。燦芯半導(dǎo)體的40納米項(xiàng)目大多采用了先進(jìn)的ARMCortex?系列內(nèi)核，包括A5、A7、A9,以確保芯片高性能和低功耗的要求。　　燦芯半導(dǎo)體致力于先進(jìn)技術(shù)的芯片設(shè)計(jì)開發(fā)，截止到2012年第三季度，線寬小于65納米的項(xiàng)目累計(jì)數(shù)量已占到總數(shù)的一半。燦芯半導(dǎo)體還積極投入研發(fā)28納米的芯片設(shè)計(jì)技術(shù)，以滿足客戶將來的需求。
關(guān)鍵字：燦芯半導(dǎo)體 40納米

燦芯半導(dǎo)體40納米項(xiàng)目累計(jì)達(dá)兩位數(shù)

　　上海，2013年1月9日-- 國(guó)際領(lǐng)先的ASIC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商，燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱“燦芯半導(dǎo)體”)今日宣布與客戶合作開發(fā)的40納米芯片設(shè)計(jì)項(xiàng)目數(shù)量累計(jì)達(dá)到十個(gè)，這些項(xiàng)目均基于中芯國(guó)際(紐約證交所代碼：SMI，香港聯(lián)交所代碼：981)的40納米制造工藝。　　燦芯半導(dǎo)體開發(fā)的先進(jìn)技術(shù)芯片廣泛應(yīng)用于高成長(zhǎng)的移動(dòng)設(shè)備領(lǐng)域，如智能手機(jī)。燦芯半導(dǎo)體的40納米項(xiàng)目大多采用了先進(jìn)的ARM® Cortex™系列內(nèi)核，包括A5、A7
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燦芯半導(dǎo)體與Cadence合作推出DDR內(nèi)存解決方案

　　國(guó)際領(lǐng)先的IC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商 -- 燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱"燦芯半導(dǎo)體")，日前宣布與全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司共同合作，將Cadence DDR Soft DLL PHY IP應(yīng)用于中芯國(guó)際集成電路制造有限公司(SMIC)生產(chǎn)工藝的設(shè)計(jì)體系。燦芯半導(dǎo)體和Cadence將集成DDR PHY 與I/O并應(yīng)用于中芯國(guó)際130納米、65納米、55納米和40納米工藝技術(shù)。燦芯半導(dǎo)體將流片系列測(cè)試芯片平臺(tái)，包含存儲(chǔ)器子系統(tǒng)IP，以此證明這種超
關(guān)鍵字：燦芯半導(dǎo)體 DDR內(nèi)存

燦芯半導(dǎo)體推出新一代SoC集成平臺(tái)

　　燦芯半導(dǎo)體日前宣布，開始面向客戶提供能滿足快速和可靠的RTL交付的新一代SoC集成平臺(tái)“Briliante”。根據(jù)客戶定制的目標(biāo)，結(jié)合架構(gòu)的復(fù)雜度，燦芯半導(dǎo)體能在1~3天內(nèi)完成RTL設(shè)計(jì)以供綜合，包括自動(dòng)生成測(cè)試案例以供驗(yàn)證。此外，這個(gè)通用的平臺(tái)可以杜絕手工連接所帶來的風(fēng)險(xiǎn)，能通過簡(jiǎn)單的、參數(shù)化的配置實(shí)施編程。　　“Briliante”平臺(tái)不僅能通過AMBA AHB和APB的ARM標(biāo)準(zhǔn)總線來把基于ARM CortexTM-M0, Cortex-M3
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燦芯半導(dǎo)體成立美國(guó)和臺(tái)灣分公司

　　燦芯半導(dǎo)體(上海)有限公司今日宣布，燦芯半導(dǎo)體的臺(tái)灣分公司和美國(guó)分公司已正式成立。　　為了拓展?fàn)N芯半導(dǎo)體在臺(tái)灣和海外的業(yè)務(wù)，方便與海外客戶開展業(yè)務(wù)，燦芯半導(dǎo)體早在2011年初就開始籌劃在臺(tái)灣和海外建立分公司。臺(tái)灣分公司已于2011年9月成立，位于臺(tái)灣新竹，包括銷售、設(shè)計(jì)與研發(fā)等部門，燦芯半導(dǎo)體資深總監(jiān)楊展悌兼任臺(tái)灣分公司總經(jīng)理。美國(guó)分公司于2012年1月成立，主要面向海外客戶開展業(yè)務(wù)。除此之外，燦芯半導(dǎo)體還在歐洲、北美和日本設(shè)有銷售代理處。　　燦芯半導(dǎo)體總裁兼CEO職春星博士表示：&ldquo
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40納米低漏電ARM Cortex-A9雙核測(cè)試芯片成功流片

國(guó)際領(lǐng)先的IC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商—燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱“燦芯半導(dǎo)體”)與中芯國(guó)際集成電路制造有限公司(“中芯國(guó)際”)及ARM今日聯(lián)合宣布，采用中芯國(guó)際40納米低漏電工藝的ARM Cortex-A9 MPCore雙核測(cè)試芯片首次成功流片。
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燦芯半導(dǎo)體入選中國(guó)集成電路設(shè)計(jì)分會(huì)理事

　　近日，中國(guó)半導(dǎo)體行業(yè)協(xié)會(huì)集成電路設(shè)計(jì)分會(huì)會(huì)員大會(huì)與“2011 ICCAD”同期召開，在此次會(huì)議上，燦芯半導(dǎo)體(上海)有限公司(以下簡(jiǎn)稱“燦芯半導(dǎo)體”)入選為中國(guó)半導(dǎo)體行業(yè)協(xié)會(huì)集成電路設(shè)計(jì)分會(huì)理事。　　燦芯半導(dǎo)體總裁兼CEO職春星博士說：“燦芯半導(dǎo)體自成立以來，一直在不斷地成長(zhǎng)壯大，從0.18um芯片設(shè)計(jì)服務(wù)開始，目前已經(jīng)成功tape out 了40nm芯片。我們很高興入選為集成電路設(shè)計(jì)分會(huì)的理事，感謝各位代表及協(xié)會(huì)對(duì)我們的肯定!同時(shí)，我們
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燦芯半導(dǎo)體第一顆40nm芯片驗(yàn)證成功

　　燦芯半導(dǎo)體(上海)有限公司與中芯國(guó)際集成電路制造有限公司(簡(jiǎn)稱“中芯國(guó)際”，紐約證交所股票代碼：SMI，香港聯(lián)合交易所股票代碼：HK0981)共同宣布燦芯半導(dǎo)體第一顆 40nm 芯片在中芯國(guó)際一次性流片驗(yàn)證成功。　
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燦芯半導(dǎo)體第一顆40nm芯片驗(yàn)證成功

燦芯半導(dǎo)體（上海）有限公司與中芯國(guó)際集成電路制造有限公司(簡(jiǎn)稱“中芯國(guó)際”，紐約證交所股票代碼：SMI，香港聯(lián)合交易所股票代碼：HK0981)今天共同宣布燦芯半導(dǎo)體第一顆 40nm 芯片在中芯國(guó)際一次性流片驗(yàn)證成功。
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燦芯半導(dǎo)體介紹

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