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EEPW首頁(yè) >> 主題列表 >> 現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)

現(xiàn)場(chǎng)可編程門(mén)陣列(fpga) 文章進(jìn)入現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)技術(shù)社區(qū)

Achronix開(kāi)始交付其22納米Speedster22i系列FPGA

Achronix Semiconductor公司日前宣布：公司已開(kāi)始將其業(yè)界領(lǐng)先的Speedster?22i HD1000可編程邏輯器件(FPGA)發(fā)運(yùn)給客戶(hù)。該器件采用英特爾領(lǐng)先的22納米3D Tri-Gate晶體管技術(shù)，其功耗是競(jìng)爭(zhēng)對(duì)手同類(lèi)器件的一半。是業(yè)內(nèi)唯一內(nèi)嵌10/40/100G以太網(wǎng)MAC、100Gbps Interlaken、PCI Express Gen1/2/3和2.133 Gbps DDR3控制器硬核的FPGA器件。
關(guān)鍵字： Achronix FPGA Speedster22i

基于FPGA的膚色分割實(shí)現(xiàn)

膚色分割關(guān)鍵在于色度空間以及膚色模型的選擇。常用的色度空間主要有：RGB、HIS、YIQ、YUV、YCbCr。常用的膚色模型有簡(jiǎn)單閾值模型、高斯模型、直方圖模型、區(qū)域模型等。大部分基于FPGA的實(shí)時(shí)膚色分割通常采用簡(jiǎn)單閾值模型，因?yàn)檫@種方法只設(shè)定簡(jiǎn)單的門(mén)限閾值，處理起來(lái)快速方便，但是效果不是很好。
關(guān)鍵字： FPGA YCbCr 膚色聚類(lèi)

一種自適應(yīng)紅外圖像增強(qiáng)處理的FPGA實(shí)現(xiàn)

紅外成像技術(shù)是當(dāng)今科技發(fā)展的熱點(diǎn)，具有廣泛的應(yīng)用。但是由于受紅外探測(cè)器件的影響，紅外成像儀的成像效果還不夠理想，主要表現(xiàn)為圖像中的目標(biāo)與背景區(qū)分不明顯、對(duì)比度低、噪聲大、信噪比低等缺點(diǎn)，因而紅外圖像處理首要解決的問(wèn)題是圖像增強(qiáng)。要實(shí)現(xiàn)圖像的增強(qiáng)處理，主要有兩個(gè)途徑：一是改善探測(cè)器性能，一是在紅外圖像系統(tǒng)電子部分加入實(shí)時(shí)圖像處理功能。
關(guān)鍵字：紅外圖像 FPGA 平臺(tái)閾值

基于DSP+FPGA的紅外移動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)設(shè)計(jì)

與通用集成電路相比，ASIC芯片具有體積小、重量輕、功耗低、可靠性高等幾個(gè)方面的優(yōu)勢(shì)，而且在大批量應(yīng)用時(shí)，可降低成本?，F(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)是在專(zhuān)用ASIC的基礎(chǔ)上發(fā)展出來(lái)的，它克服了專(zhuān)用ASIC不夠靈活的缺點(diǎn)。
關(guān)鍵字： FPGA DSP 紅外移動(dòng)

基于NI CompactRIO混合動(dòng)力轎車(chē)整車(chē)標(biāo)定系統(tǒng)的開(kāi)發(fā)

針對(duì)混合動(dòng)力汽車(chē)的特性，開(kāi)發(fā)了基于NI CompactRIO的混合動(dòng)力汽車(chē)整車(chē)標(biāo)定系統(tǒng)，在臺(tái)架及整車(chē)調(diào)試階段，可以利用該系統(tǒng)對(duì)整車(chē)控制器內(nèi)部的標(biāo)定參數(shù)變量進(jìn)行在線(xiàn)修改，以達(dá)到優(yōu)化整車(chē)各項(xiàng)性能的目的。
關(guān)鍵字： NI VCU FPGA CAN

FPGA程序遠(yuǎn)程在線(xiàn)更新設(shè)計(jì)

1　概述現(xiàn)場(chǎng)可編程門(mén)陣列(Field Programmable Gate Array，F(xiàn)PGA)器件具有高密度、低功耗、高速、高可靠性等優(yōu)點(diǎn)，在航空航天、通信、工業(yè)控制等方面得到了大量應(yīng)用。FPGA的處理器分為軟核和硬核，并且軟核處理器具有
關(guān)鍵字： FPGA 程序遠(yuǎn)程

暗光視頻采集成監(jiān)控?zé)狳c(diǎn)

2012年12月初的中國(guó)國(guó)際公共安全博覽會(huì) (CPSE) 上，多家半導(dǎo)體公司展示了最新產(chǎn)品，其中的一個(gè)亮點(diǎn)是光線(xiàn)條件差時(shí)的視頻采集方案。
關(guān)鍵字： Lattice FPGA 201301

基于Xilinx Zynq的解決方案展示

Zynq-7000系列器件將處理器的軟件可編程能力與 FPGA 的硬件可編程能力實(shí)現(xiàn)完美結(jié)合，以低功耗和低成本等系統(tǒng)優(yōu)勢(shì)實(shí)現(xiàn)無(wú)以倫比的系統(tǒng)性能、靈活性、可擴(kuò)展性，同時(shí)可以加速產(chǎn)品上市進(jìn)程。
關(guān)鍵字： Xilinx Zynq-7000 FPGA 201301

異構(gòu)雙核SoC設(shè)計(jì)與實(shí)現(xiàn)

摘要：異構(gòu)雙核SoC采用SPARC V8處理器加專(zhuān)用DSP的架構(gòu)，根據(jù)其應(yīng)用特點(diǎn)，設(shè)計(jì)了SPARC V8處理器與專(zhuān)用DSP之間互斥通訊機(jī)制。并完成了SPARC V8處理器的狀態(tài)控制設(shè)計(jì)與優(yōu)化、外部存儲(chǔ)控制器的接口優(yōu)化設(shè)計(jì)，以及SoC的整體功能驗(yàn)證。
關(guān)鍵字： SoC DSP FPGA 201301

美高森美推出SmartFusion2 SoC FPGA入門(mén)者工具套件

致力于提供幫助功率管理、安全、可靠與高性能半導(dǎo)體技術(shù)產(chǎn)品的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號(hào)：MSCC)，宣布提供SmartFusion?2入門(mén)者工具套件，為設(shè)計(jì)人員提供用于其SmartFusion2系統(tǒng)級(jí)芯片(SoC)現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的基礎(chǔ)原型構(gòu)建平臺(tái)。
關(guān)鍵字：美高森美 FPGA SmartFusion2 USB

10G以太網(wǎng)光接口的FPGA實(shí)現(xiàn)

1 概述隨著人們對(duì)通信信息的充裕性、及時(shí)性和便捷性的要求越來(lái)越高，能夠隨時(shí)隨地、方便而及時(shí)地獲取所需信息，變得越來(lái)越重要。2002年，IEEE通過(guò)了10 Gb/s速率的以太網(wǎng)標(biāo)準(zhǔn)——IEEE 802.3ae[1]。10G以太網(wǎng)
關(guān)鍵字： FPGA 10G 以太網(wǎng)光接口

基于FPGA的雙緩沖模式PCI Express總線(xiàn)設(shè)計(jì)方案

引言　　近年來(lái)軟件無(wú)線(xiàn)電（SDR）得到了飛速的發(fā)展，在很多領(lǐng)域已顯示出其優(yōu)越性。本文的項(xiàng)目背景是通過(guò)軟件無(wú)線(xiàn)電方式實(shí)現(xiàn)數(shù)字音頻廣播（DAB）的基帶信號(hào)處理，這要求軟件無(wú)線(xiàn)電平臺(tái)具有高速實(shí)時(shí)數(shù)字信號(hào)處理與傳輸
關(guān)鍵字： Express FPGA PCI 模式

Altera向JDSU發(fā)售Stratix V GT FPGA

Altera公司 (Nasdaq: ALTR)日前宣布，向JDSU發(fā)售Stratix? V GT FPGA，以支持其下一代光網(wǎng)絡(luò)測(cè)試儀(ONT)解決方案的量產(chǎn)。JDSU是通信行業(yè)光產(chǎn)品以及測(cè)試測(cè)量解決方案的領(lǐng)先供應(yīng)商，在其ONT-600系列中采用了Altera的高端28 nm FPGA，以實(shí)現(xiàn)第一個(gè)面向CFP2 100G光傳送網(wǎng)(OTN)環(huán)境的測(cè)試解決方案。
關(guān)鍵字： Altera FPGA Stratix

在FPGA上建立MATLAB和Simulink算法原型

芯片設(shè)計(jì)和驗(yàn)證工程師通常要為在硅片上實(shí)現(xiàn)的每一行RTL代碼寫(xiě)出多達(dá)10行測(cè)試平臺(tái)代碼。驗(yàn)證任務(wù)在設(shè)計(jì)周期內(nèi)可能會(huì)占用50%或更多的時(shí)間。盡管如此辛苦，仍有接近60%的芯片存在功能瑕疵，需要返工。由于HDL仿真不足以
關(guān)鍵字： Simulink MATLAB FPGA 算法

Xilinx 20nm產(chǎn)品細(xì)節(jié)揭秘搶占20nm FPGA制高點(diǎn)

　　前不久，賽靈思(Xilinx)發(fā)表其20 nm產(chǎn)品路線(xiàn)圖，在之前的28nm產(chǎn)品上，Xilinx聲稱(chēng)他們領(lǐng)先競(jìng)爭(zhēng)對(duì)手一代，落實(shí)了All Programmable器件戰(zhàn)略(FPGA、SoC和3D IC)，推出了Vivado設(shè)計(jì)環(huán)境和開(kāi)發(fā)套件，結(jié)合其豐富的IP資源，為市場(chǎng)提供了高性能、低功耗和有利于減少系統(tǒng)/BOM成本的產(chǎn)品。賽靈思公司全球高級(jí)副總裁，亞太區(qū)執(zhí)行總裁湯立人表示，Xilinx在20nm產(chǎn)品的表現(xiàn)上還將保持領(lǐng)先一代的優(yōu)勢(shì),下一代FPGA及第二代SoC和3D IC將與Vivado設(shè)計(jì)套件&ldqu
關(guān)鍵字： Xilinx FPGA 20nm

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現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)介紹

您好，目前還沒(méi)有人創(chuàng)建詞條現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)!
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現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開(kāi)關(guān)電源設(shè)計(jì)的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)資料下載

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