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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列(fpga)

現(xiàn)場可編程門陣列(fpga) 文章進入現(xiàn)場可編程門陣列(fpga)技術社區(qū)

基于FPGA的TFTLCD快檢信號源的實現(xiàn)

0　引言目前,液晶顯示行業(yè)得到迅速的發(fā)展,但由于液晶模塊的生產(chǎn)不可能達到100%的成品率,或多或少地存在缺陷,目前在TFT模塊的生產(chǎn)工藝中就有可能產(chǎn)生點缺陷和線缺陷等。為了及早對產(chǎn)品的質(zhì)量進行檢測,液晶測試儀器成為
關鍵字： TFTLCD FPGA 信號源

基于高速串行BCD碼除法的數(shù)字頻率計的設計

摘要：介紹了在PPGA芯片上實現(xiàn)數(shù)字頻率計的原理。對各種硬件除法進行了比較，提出了高速串行BCD碼除法的硬件算 ...
關鍵字：頻率測量周期測量 FPGA VHDL 狀態(tài)機

賽靈思異構3D FPGA難在哪兒

不久前，All Programmable技術和器件的企業(yè)——賽靈思公司（Xilinx）正式發(fā)貨 Virtex-7 H580T FPGA—全球首款3D異構All Programmable產(chǎn)品。 Virtex-7 HT采用賽靈思的堆疊硅片互聯(lián) (SSI)技術，是提供業(yè)界帶寬最高的FPGA，可提供多達16個28 Gbps收發(fā)器和72個13.1 Gbps收發(fā)器，也是能滿足關鍵Nx100G和400G線路卡應用功能要求的單芯片解決方案。為此，本刊訪問了該公司負責人，澄
關鍵字： Xilinx 賽靈思 3D FPGA all programmable 異構

一種基于ARM和FPGA的可重構MAC協(xié)議設計

一種基于ARM和FPGA的可重構MAC協(xié)議設計,摘要：為了在實際信道條件下研究Ad Hoc網(wǎng)絡MAC協(xié)議，克服商業(yè)網(wǎng)卡芯片和理論仿真等帶來的局限性，搭建了基于ARM和FPGA相結合的硬件平臺，設計與實現(xiàn)了基于CSMA／CA的可重構MAC協(xié)議，并進行了仿真測試，驗證了該協(xié)議設
關鍵字：協(xié)議設計 MAC 重構 ARM FPGA 基于

用Synplify Premier加快FPGA設計時序收斂

傳統(tǒng)的綜合技術越來越不能滿足當今采用 90 納米及以下工藝節(jié)點實現(xiàn)的非常大且復雜的 FPGA 設計的需求了。問題是傳統(tǒng)的 FPGA 綜合引擎是基于源自 ASIC 的方法，如底層規(guī)劃、區(qū)域內(nèi)優(yōu)化 (IPO,In-place Optimization) 以
關鍵字： Synplify Premier FPGA 時序收斂

基于FPGA的IRIG-B(DC)碼解碼

摘要：在分析了IRIG-B(DC)碼碼型特點的基礎上，提出了一種IRIG-B(DC)時間碼解碼的設計方法。該方法由少量外圍電路與一片現(xiàn)場可編程門陣列(FPGA)芯片組成，來實現(xiàn)對IRG-B(DC)碼的解碼、1 PPS信號輸出、實時時間顯示以
關鍵字： IRIG-B FPGA DC 解碼

基于FPGA和FLASH ROM的圖像信號發(fā)生器設計

摘要：以XC2V1500-FPGA為硬件架構，設計了一種圖像信號發(fā)生器，作為自適應光學系統(tǒng)波前處理機的信號源，為波前處理機的調(diào)試和算法驗證提供支持。系統(tǒng)采用大容量的NAND型FLASH存儲數(shù)據(jù)，存儲容量為1 GB。圖像數(shù)據(jù)通過
關鍵字： FLASH FPGA ROM 圖像信號發(fā)生器

單片機與FPGA實現(xiàn)等精度頻率測量和IDDS技術設計方案

O.引言本系統(tǒng)利用單片機和FPGA有效的結合起來共同實現(xiàn)等精度頻率測量和IDDS技術，發(fā)揮各自的優(yōu)點，使設計變得 ...
關鍵字：單片機 FPGA 頻率測量 IDDS技術

基于FPGA的運動估計設計

摘要：利用功能強大的FPGA實現(xiàn)視頻圖像的一種運動估計設計，采用的搜索方法是三步搜索法。在進行方案設計時，本文采用了技術比較成熟的VHDL語言進行設計，并使用Quartus II軟件進行時序仿真。由仿真結果可知，無論是
關鍵字： FPGA 運動估計

通信領域采用FPGA芯片嵌入式系統(tǒng)分析方案

1.引言由于FPGA 良好的可編程性和優(yōu)越的性能表現(xiàn)，當前液晶拼接屏幕采用FPGA 芯片的嵌入式系統(tǒng)數(shù)量呈現(xiàn)迅速增加的趨勢，特別是在需要進行大規(guī)模運算的通信領域。目前FPGA 配置數(shù)據(jù)一般使用基于SRAM 的存儲方式，掉電
關鍵字： FPGA 通信領域嵌入式方案

基于FPGA的腦機接口系統(tǒng)方案

腦機接口BCI(Brain Computer Interface)是一種新穎的人機接口方式。它的定義是：不依賴于腦的正常輸出通路(外周神經(jīng)系統(tǒng)及肌肉組織)的腦-機(計算機或其他裝置)通訊系統(tǒng)[1]。液晶面板走勢要實現(xiàn)腦機接口，必須有一種能
關鍵字： FPGA 腦機接口系統(tǒng)方案

基于FPGA的電梯控制器系統(tǒng)設計方案

本文首先提出了一種基于有限狀態(tài)機的電梯控制器算法，然后根據(jù)該算法設計了一個三層電梯控制器，該電梯控制器的正確性經(jīng)過了仿真驗證和硬件平臺的驗證。本文的電梯控制器設計，結合了深圳信息職業(yè)技術學院的實際電梯
關鍵字： FPGA 電梯控制器系統(tǒng)設計方案

單片機與FPGA在信號測試中的重要作用解析方案

1 引言在學習《電子線路》、《信號處理》等電子類課程時，高校學生只是從理論上理解真正的信號特征。不能真正了解或觀察測試某些信號。而幅頻特性和相頻特性是信號最基本的特征.這里提出了基于單片機和FPGA的頻率特性
關鍵字： FPGA 單片機信號測試方案

基于FPGA實現(xiàn)固定倍率的圖像縮放

摘要：基于FPGA硬件實現(xiàn)固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進行行方向的卷積，再進行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過程設計為一個單元體的循環(huán)過程，在
關鍵字： FPGA 倍率圖像

基于ARM和FPGA的時間同步儀控制單元設計

基于ARM和FPGA的時間同步儀控制單元設計,摘要以時間同步儀的功能為出發(fā)點，設計了基于ARM和FPGA的控制系統(tǒng)，該系統(tǒng)以ARM芯片S3C2440A為控制核心，在FPGA芯片XCS30的輔助控制下，完成了時間同步儀系統(tǒng)的人機交互、參數(shù)設定、電文處理、遠程控制等功能。通
關鍵字：控制單元設計同步時間 ARM FPGA 基于

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現(xiàn)場可編程門陣列(fpga)介紹

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現(xiàn)場可編程門陣列(fpga)電路

利用FPGA資源和最小模擬電路發(fā)電進行開關電源設計的方法
基于FPGA的機載顯示系統(tǒng)架構設計與優(yōu)化
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基于FPGA的LCD顯示遠程更新

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