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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列(fpga)

現(xiàn)場可編程門陣列(fpga) 文章進入現(xiàn)場可編程門陣列(fpga)技術社區(qū)

FPGA在航空電子系統(tǒng)中的設計應用

由于競爭的壓力和對飛機性能無止境的追求，航空電子從簡單、獨立的設備發(fā)展到如今以每秒百萬位乃至更快的速度交換信息的高級智能系統(tǒng)網絡。這也帶來了必須克服的許多設計問題。
關鍵字：高級智能系統(tǒng)網絡航空電子 FPGA

數字圖像倍焦系統(tǒng)設計與實現(xiàn)綜合實例之：系統(tǒng)硬件配置方案

FPGA作可編程器件，可以根據用戶的需要進行現(xiàn)場可編程。系統(tǒng)可采用了JTAG模式和AS模式進行FPGA編程配置。
關鍵字：數字圖像倍焦系統(tǒng) JTAG FPGA EPC1441PC8

帶硬件地址識別的UART IP的設計和實現(xiàn)

在通信和控制系統(tǒng)中，常使用異步串行通信控制器（UART）實現(xiàn)系統(tǒng)輔助信息的傳輸。為實現(xiàn)多點通信，通常用軟件識別發(fā)往本站點或其它站點的數據，這會加大CPU的開銷。介紹了一種基于FPGA的UART IP，由硬件實現(xiàn)多點通信時的數據過濾功能，降低了CPU的負擔，提高了系統(tǒng)性能。
關鍵字： UART IP FPGA

數字圖像倍焦系統(tǒng)設計與實現(xiàn)綜合實例之：系統(tǒng)原理框圖

本系統(tǒng)采用了兩片SRAM存儲器構成乒乓緩沖結構來完成視頻的采集和處理，視頻的采集和輸出部分采用了應用廣泛的SAA71XX系列。
關鍵字：數字圖像倍焦系統(tǒng) SRAM存儲器乒乓緩沖 FPGA

數字圖像倍焦系統(tǒng)設計與實現(xiàn)綜合實例之：系統(tǒng)工作原理分析

如前所述，本系統(tǒng)主要完成對輸入視頻圖像的兩倍放大。圖像的放大主要是通過插值算法來實現(xiàn)的，下面詳細分析如何應用雙線性插值算法來實現(xiàn)倍焦功能。
關鍵字：數字圖像倍焦系統(tǒng) 乘法器 FPGA

有限狀態(tài)機的FPGA設計

有限狀態(tài)機是一種常見的電路，由于時序電路和組合電路組成，設計有限狀態(tài)機的第一步是確定采用Moore狀態(tài)機還是采用Mealy狀態(tài)機。Mealy狀態(tài)機的狀態(tài)轉變不僅和當前狀態(tài)有關，而且和各輸入信號有關；Moore狀態(tài)機的轉變只和當前狀態(tài)有關。從電路實現(xiàn)功能上來講，任何一種都可以實現(xiàn)同樣的功能。但他們的輸出時序不同，所以選擇使用哪種狀態(tài)機是要根據具體情況來定。
關鍵字： Moore狀態(tài)機 Mealy狀態(tài)機 FPGA

數字圖像倍焦系統(tǒng)設計與實現(xiàn)綜合實例之：設計需求分析與芯片選型

在數字圖像處理和通信、遙感圖像分析、醫(yī)學成像診斷等應用領域，為了便于顯示、觀察或進行進一步的處理，常常需要對原始的數字圖像進行特征提取(如邊緣檢測、邊緣銳化)、噪聲平滑濾波、幾何校正、尺寸縮放等處理，這類圖像處理技術稱為圖像的預處理。在實際應用中，圖像的預處理功能很多可以通過FPGA來實現(xiàn)。
關鍵字：數字圖像倍焦系統(tǒng) 視頻解碼器 FPGA 視頻編碼器乒乓緩沖區(qū)

H.264/AVC中CAVLC編碼器的硬件設計與實現(xiàn)

設計了一種H.264標準的CAVLC編碼器，對原有軟件流程進行部分改進，提出了并行處理各編碼子模塊的算法結構。
關鍵字：變長編碼非零系數級編碼 FPGA

FPGA與DSP協(xié)同處理系統(tǒng)設計之：典型實例-整數DCT變換的設計與實現(xiàn)

本節(jié)旨在設計實現(xiàn)了視頻壓縮標準H.264算法中的整數DCT變換部分，幫助讀者了解并行流水設計技巧在算法優(yōu)化中的作用。
關鍵字： DSP 協(xié)同處理 FPGA 整數DCT變換 H.264

FPGA/CPLD狀態(tài)機穩(wěn)定性研究

在FPGA/CPLD設計中,狀態(tài)機是最典型、應用最廣泛的時序電路模塊,如何設計一個穩(wěn)定可靠的狀態(tài)機是我們必須面對的問題.
關鍵字：時序電路狀態(tài)機 FPGA

FPGA與DSP協(xié)同處理系統(tǒng)設計之：典型實例-FPGA片上硬件乘法器的使用

在FPGA+DSP系統(tǒng)設計系統(tǒng)中，F(xiàn)PGA經常作為DSP的協(xié)處理器來輔助完成一些計算任務。而這些計算工作中最消耗時間的就是乘法運算，因此本實例的主要內容就是幫助讀者學會調用硬件乘法IP核。
關鍵字： DSP 協(xié)同處理 FPGA 硬件乘法器

FPGA與DSP協(xié)同處理系統(tǒng)設計之：FPGA+DSP協(xié)同平臺的調試技巧和注意事項

作為雙芯片的協(xié)同系統(tǒng)，調試的開始階段需要對每個芯片進行單獨測試。這種情況下就需要避免另外一個芯片對調試產生影響，比較好的辦法就是讓它停止工作。
關鍵字： DSP 協(xié)同處理 FPGA 內部邏輯分析儀隔離調試

基于FPGA的帶Cache的嵌入式CPU的設計與實現(xiàn)

MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統(tǒng)領域中得到廣泛的應用。MIPS32TM指令集開放，指令格式規(guī)整，易于流水線設計，大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比，RISC具有設計更簡單、設計周期更短等優(yōu)點，并可以應用更多先進的技術，開發(fā)更快的下一代處理器。
關鍵字：流水線CPU 時序設計 FPGA

FPGA與DSP協(xié)同處理系統(tǒng)設計之： FPGA與DSP的通信接口設計

以上的接口中，比較常用的接口是EMIF和HPI。其中總線接口需要協(xié)議支持，開發(fā)難度較大，串行接口開發(fā)簡單，但是速率較慢。VPORT等特殊接口一般是在特定的場合下應用，不具備通用性，而且需要修改DSP驅動，開發(fā)周期較長。
關鍵字： DSP 協(xié)同處理 FPGA 通信接口 EMIF HPI BlockRAM

數字變頻的FPGA實現(xiàn)

本文介紹了數字下變頻的組成結構，并通過一個具體的實例，給出了FPGA實現(xiàn)的具體過程。
關鍵字：數字變頻 VHDL FPGA

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現(xiàn)場可編程門陣列(fpga)介紹

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現(xiàn)場可編程門陣列(fpga)電路

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