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現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)
現(xiàn)場(chǎng)可編程門(mén)陣列(fpga) 文章 進(jìn)入現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)技術(shù)社區(qū)
DIY你的體感游戲：人體動(dòng)作識(shí)別系統(tǒng)的設(shè)計(jì)，提供軟硬件實(shí)現(xiàn)方案
- 本項(xiàng)目使用Virtex-5 OpenSPARC評(píng)估平臺(tái)，首先通過(guò)VGA解碼芯片，將PC機(jī)中的視頻流數(shù)據(jù)解碼出R、G、B信號(hào)值和場(chǎng)、行信號(hào)。然后使用OV7670數(shù)字?jǐn)z像頭，攝取人體的手部動(dòng)作，運(yùn)用一定的算法，對(duì)攝像頭數(shù)據(jù)進(jìn)行處理，判定此時(shí)的人體動(dòng)作，然后將其與RGB分量信號(hào)進(jìn)行疊加，通過(guò)配置DVI接口芯片，將疊加后的圖像送至顯示器顯示。
- 關(guān)鍵字： Virtex-5 動(dòng)作識(shí)別 DIY 數(shù)字?jǐn)z像頭 FPGA
大熱的虹膜身份識(shí)別系統(tǒng)設(shè)計(jì)，提供軟硬件參考解決方案
- 使用FPGA進(jìn)行虹膜特征的提取和匹配計(jì)算。將用戶的虹膜特征數(shù)據(jù)事先存儲(chǔ)在數(shù)據(jù)庫(kù)中，捕獲測(cè)試者的虹膜圖像，通過(guò)預(yù)處理以及特征提取，得到待測(cè)特征數(shù)據(jù)，與數(shù)據(jù)庫(kù)中的特征數(shù)據(jù)進(jìn)行模式匹配，根據(jù)Bayes最大后驗(yàn)概率準(zhǔn)則判斷測(cè)試者的身份。
- 關(guān)鍵字： 虹膜身份識(shí)別 Spartan3E 攝像頭 虹膜圖像 FPGA
DIY小發(fā)明：打造你自己的流媒體播放器，解決方案、硬件框圖
- 主要內(nèi)容為利用Xilinx的Virtex-2 Pro FPGA 上豐富的邏輯資源來(lái)實(shí)現(xiàn)一個(gè)自定義的模塊，該模塊能作為流媒體播放過(guò)程中的一個(gè)功能部件。
- 關(guān)鍵字： DIY 流媒體播放器 Virtex-2Pro FPGA
基于FPGA的IIR數(shù)字濾波器的設(shè)計(jì)方案
- 用FPGA實(shí)現(xiàn)數(shù)字濾波器具有實(shí)時(shí)性強(qiáng)、靈活性高、處理速度快以及小批量生產(chǎn)成本低等優(yōu)點(diǎn)，所以得到了較為廣泛的應(yīng)用。本文以巴特沃思數(shù)字帶通濾波器為例，較為詳細(xì)地介紹了其設(shè)計(jì)和實(shí)現(xiàn)方法。給定巴特沃茲數(shù)字帶通濾波器的抽樣頻率為500Hz，上、下邊帶截止頻率分別為150Hz和30Hz。
- 關(guān)鍵字： IIR數(shù)字濾波器 雙線性變換法 FPGA matlab
基于FPGA平臺(tái)構(gòu)建汽車(chē)輔助駕駛系統(tǒng)算法(圖)
- 汽車(chē)輔助駕駛(DA)系統(tǒng)工程師通常使用 PC 模型來(lái)創(chuàng)建復(fù)雜的處理算法，以便實(shí)現(xiàn)高度可靠的自適應(yīng)巡航控制、車(chē)道偏離警告及行人檢測(cè)等功能。開(kāi)發(fā)人員高度重視PC算法模型，因?yàn)檫@種模型使他們能夠嘗試使用并快速評(píng)估不同的處理算法。不過(guò)，說(shuō)到底，還是需要一款設(shè)計(jì)合理的電子硬件解決方案，來(lái)實(shí)現(xiàn)經(jīng)濟(jì)有效的大規(guī)模生產(chǎn)與部署。
- 關(guān)鍵字： 汽車(chē)輔助駕駛 算法 FPGA
14nm的FPGA需要什么樣的電源管理IC？
- 現(xiàn)在的FPGA不僅僅是一個(gè)邏輯器件，它現(xiàn)在更加像一個(gè)平臺(tái)，在一個(gè)FPGA中常常會(huì)包含有數(shù)字信號(hào)處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么，這樣的FPGA需要什么樣的電源管理IC來(lái)與之配合呢？
- 關(guān)鍵字： 電源管理IC 14nm FPGA Enpirion CycloneVSoC
如何通過(guò)RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計(jì)
- EDA 公司和 FPGA 廠商不斷開(kāi)發(fā)新的工具和方法，推進(jìn)繁瑣任務(wù)的自動(dòng)化，幫助設(shè)計(jì)團(tuán)隊(duì)集中精力做好創(chuàng)造性工作。下面我們就來(lái)看看 FPGA 工具流程的演進(jìn)發(fā)展，了解一下現(xiàn)代 FPGA 團(tuán)隊(duì)是如何利用 RTL分析、約束生成和綜合導(dǎo)向來(lái)減少設(shè)計(jì)迭代的。
- 關(guān)鍵字： RTL SDC 綜合向?qū)?/a> FPGA
基于FPGA的視頻信號(hào)發(fā)生器設(shè)計(jì)與應(yīng)用研究
- 本文介紹了一種基于FPGA的新型視頻信號(hào)發(fā)生器，它可以滿足多種被測(cè)系統(tǒng)對(duì)輸入視頻信號(hào)制式的要求。該系統(tǒng)利用USB總線與上位機(jī)進(jìn)行通信，同時(shí)解決了系統(tǒng)供電的問(wèn)題。在FPGA內(nèi)部，通過(guò)軟件編程的方法生成視頻信號(hào)的圖像和時(shí)序控制信號(hào)，并送入視頻D /A模塊。
- 關(guān)鍵字： 視頻信號(hào)發(fā)生器 視頻采集卡 FPGA
用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計(jì)中的錯(cuò)誤
- Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計(jì)工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計(jì)人員完成上述工作。這些工具的特性使得設(shè)計(jì)人員能快速隔離錯(cuò)誤，有效縮短運(yùn)行時(shí)間，并減少開(kāi)發(fā)板啟動(dòng)所需的迭代次數(shù)。
- 關(guān)鍵字： 智能調(diào)試 SynplifyPremier FPGA SynplifyProFPGA
信號(hào)去直流方法
- 本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計(jì)的去直流模塊，其基本原理采用一階濾波器，如圖1所示，通過(guò)一個(gè)一階RC電路，在V0端可等效一個(gè)低通濾波器，得到直流分量。
- 關(guān)鍵字： 信號(hào)去直流 DSP48E1 FPGA 一階濾波器
用于實(shí)現(xiàn)嵌入式安全的開(kāi)源硬件
- 想像一下你正在排隊(duì)等待參加一個(gè)重要活動(dòng)。門(mén)票是通過(guò)網(wǎng)上購(gòu)買(mǎi)的，存儲(chǔ)在你的智能手機(jī)中。你需要將手機(jī)放到某個(gè)指定區(qū)域上，建立起NFC連接，門(mén)票隨之得到確認(rèn)，大門(mén)開(kāi)啟允許你進(jìn)入。好消息是，所有這一切都是在匿名情況下發(fā)生的。
- 關(guān)鍵字： 嵌入式安全 開(kāi)源硬件 零知識(shí)證明 ZKPK FPGA
現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)介紹
您好，目前還沒(méi)有人創(chuàng)建詞條現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)!
歡迎您創(chuàng)建該詞條，闡述對(duì)現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)的理解，并與今后在此搜索現(xiàn)場(chǎng)可編程門(mén)陣列(fpga)的朋友們分享。 創(chuàng)建詞條
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