<meter id="pryje"><nav id="pryje"><delect id="pryje"></delect></nav></meter>

<label id="pryje"></label>

結(jié)合超寬帶測(cè)距和雷達(dá)功能以實(shí)現(xiàn)高級(jí)IoT應(yīng)用 11.14珠海｜與泰克共探半導(dǎo)體產(chǎn)業(yè)鏈來(lái)這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>> 來(lái)學(xué)習(xí)NXP基于i.MX處理器的工業(yè)解決方案吧！

我要投稿 | 手機(jī)版

首頁(yè)　資訊　商機(jī) 　下載　拆解　高校　招聘　雜志　會(huì)展　 EETV　百科　問(wèn)答　電路圖　工程師手冊(cè) 　 Datasheet　 100例　活動(dòng)中心　 E周刊閱讀　樣片申請(qǐng)

EEPW首頁(yè) >> 主題列表 >> 現(xiàn)場(chǎng)可編程門陣列（fpga）

現(xiàn)場(chǎng)可編程門陣列（fpga）文章進(jìn)入現(xiàn)場(chǎng)可編程門陣列（fpga）技術(shù)社區(qū)

時(shí)序分析的一些基本概念

時(shí)序分析時(shí)FPGA設(shè)計(jì)中永恒的話題，也是FPGA開(kāi)發(fā)人員設(shè)計(jì)進(jìn)階的必由之路。慢慢來(lái)，先介紹時(shí)序分析中的一些基本概念。
關(guān)鍵字： FPGA 時(shí)序

掌握三大原則，輕松分配FPGA引腳

現(xiàn)在的FPGA正變得越來(lái)越復(fù)雜，向引腳分配信號(hào)的任務(wù)曾經(jīng)很簡(jiǎn)單，現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多用途引腳指配信號(hào)的指導(dǎo)方針有助于設(shè)計(jì)師根據(jù)最
關(guān)鍵字： FPGA

Verilog的語(yǔ)言要素有哪些？

本章介紹Verilog HDL的基本要素，包括標(biāo)識(shí)符、注釋、數(shù)值、編譯程序指令、系統(tǒng)任務(wù)和系統(tǒng)函數(shù)。另外，本章還介紹了Verilog硬件描述語(yǔ)言中的兩種數(shù)據(jù)類
關(guān)鍵字： Verilog FPGA

詳細(xì)介紹數(shù)字時(shí)鐘管理模塊與嵌入式塊RAM

3.數(shù)字時(shí)鐘管理模塊(DCM)業(yè)內(nèi)大多數(shù)FPGA 均提供數(shù)字時(shí)鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進(jìn)的FPGA 提供數(shù)字時(shí)鐘管理
關(guān)鍵字：數(shù)字時(shí)鐘管理 FPGA

詳解底層內(nèi)嵌功能單元與軟核、硬核以及固核

6、底層內(nèi)嵌功能單元內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)?，F(xiàn)在越來(lái)越豐富的內(nèi)嵌功能單元
關(guān)鍵字：賽靈思 dll FPGA

FPGA開(kāi)發(fā)基本流程有哪些？

FPGA是可編程芯片，因此FPGA的設(shè)計(jì)方法包括硬件設(shè)計(jì)和軟件設(shè)計(jì)兩部分。硬件包括FPGA芯片電路、存儲(chǔ)器、輸入輸出接口電路以及其他設(shè)備，軟件即是相應(yīng)
關(guān)鍵字：微電子 SOC FPGA

ZYNQ器件的啟動(dòng)配置方法解讀

無(wú)任是用CPU作為系統(tǒng)的主要器件，還是用FPGA作為系統(tǒng)的主要器件，系統(tǒng)設(shè)計(jì)中首先要考慮到的問(wèn)題就是處理器的啟動(dòng)加載問(wèn)題。XILINX推出的ZYNQ可擴(kuò)展處理
關(guān)鍵字： Xilinx 賽靈思 FPGA

如何實(shí)現(xiàn)FPGA基于CORDIC算法的求平方？

1. CORDIC功能及原理CORDIC是在沒(méi)有專用乘法器(最小化門數(shù)量)情況下，一組完成特定功能的算法，包括平方、超越、Log、sin/cos/artan。原理為連續(xù)的旋轉(zhuǎn)
關(guān)鍵字： CORDIC FPGA

深度解讀IBM基于Kintex-7 FPGA―K70T實(shí)現(xiàn)MCL86 8088處理器

IBM PCjr的問(wèn)世眾所周知IBM是著名的國(guó)際商業(yè)機(jī)器公司，它是計(jì)算機(jī)產(chǎn)業(yè)的長(zhǎng)期領(lǐng)導(dǎo)者，其推出的個(gè)人計(jì)算機(jī)(PC)標(biāo)準(zhǔn)一直沿用至今，同時(shí)其在大型機(jī)、超級(jí)計(jì)
關(guān)鍵字： MCL868080 IBM FPGA

詳解嵌入式開(kāi)發(fā)中DSP與FPGA的關(guān)系

常所說(shuō)的單片機(jī)側(cè)重于控制，不支持信號(hào)處理，屬于低端嵌入式處理器，arm可以看做是低端單片機(jī)升級(jí)版，支持操作系統(tǒng)管理，更多接口如網(wǎng)卡，處理能力更強(qiáng)
關(guān)鍵字：嵌入式開(kāi)發(fā) FPGA DSP

幾組實(shí)用FPGA原理設(shè)計(jì)圖

FPGA(Field-Programmable Gate Array)，即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC
關(guān)鍵字： FPGA

如何設(shè)計(jì)基于FPGA和USB2.0的高精度數(shù)據(jù)采集系統(tǒng)？

現(xiàn)代電子偵查技術(shù)要求能夠?qū)ν獠磕M信號(hào)進(jìn)行精確提取和分析，從而對(duì)數(shù)據(jù)采集的精度提出了很高的要求，本文提出了一種以FPGA 作為主控制器的高精度500
關(guān)鍵字： FPGA USB2.0 高精度數(shù)據(jù)采集系統(tǒng)

FPGA與CPU的關(guān)系

說(shuō)起CPU，大家都已經(jīng)很熟悉了，是“中央處理器”的英文縮寫，它是用來(lái)“運(yùn)算”的。而技術(shù)上來(lái)說(shuō)，F(xiàn)PGA也由非常多的核組成的，F(xiàn)PGA號(hào)稱“萬(wàn)能芯片”，那
關(guān)鍵字： FPGA CPU

如何基于多DSP互聯(lián)技術(shù)研究頻譜監(jiān)測(cè)儀？

0 引言隨著微波技術(shù)的廣泛發(fā)展，空間和地面電磁環(huán)境越來(lái)越復(fù)雜，無(wú)線電頻譜資源作為公共資源的一種，需要頻譜管理部門進(jìn)行有效的分配和監(jiān)控。特別是在
關(guān)鍵字： DDR2內(nèi)存卡頻譜監(jiān)測(cè)儀 FPGA DSP

AWS詳述FPGA基本原理和市場(chǎng)發(fā)展

在2016年底一年快要結(jié)束的時(shí)候，AWS(亞馬遜網(wǎng)絡(luò)服務(wù))宣布通過(guò)借助云傳輸模型可以采用Xilinx高端FPGA器件了，首次以開(kāi)發(fā)者的角度而不是擴(kuò)展高層次工具來(lái)
關(guān)鍵字： AWS FPGA

共6399條 34/427 |‹ « 32 33 34 35 36 37 38 39 40 41 » ›|

現(xiàn)場(chǎng)可編程門陣列（fpga）介紹

您好，目前還沒(méi)有人創(chuàng)建詞條現(xiàn)場(chǎng)可編程門陣列（fpga）!
歡迎您創(chuàng)建該詞條，闡述對(duì)現(xiàn)場(chǎng)可編程門陣列（fpga）的理解，并與今后在此搜索現(xiàn)場(chǎng)可編程門陣列（fpga）的朋友們分享。創(chuàng)建詞條

現(xiàn)場(chǎng)可編程門陣列（fpga）電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開(kāi)關(guān)電源設(shè)計(jì)的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

現(xiàn)場(chǎng)可編程門陣列（fpga）相關(guān)帖子

在米爾電子MPSOC實(shí)現(xiàn)12GSDI視頻采集H.265壓縮SGMII萬(wàn)兆以太網(wǎng)推流
RDMA IP 設(shè)計(jì)簡(jiǎn)介
詳解FPGA六大應(yīng)用領(lǐng)域
科普：到底什么是ASIC和FPGA？
fpga控制w5500發(fā)不出廣播
高云FPGA（GW1NR-LV9）使用串口IP無(wú)法通信
專業(yè)FPGA芯片分銷
TC264如何外掛FPGA？

現(xiàn)場(chǎng)可編程門陣列（fpga）資料下載

如何使用FPGA實(shí)現(xiàn)BP神經(jīng)網(wǎng)絡(luò)的仿真線設(shè)計(jì)
基于UDP協(xié)議和FPGA的點(diǎn)到點(diǎn)數(shù)據(jù)傳輸方案
如何使用FPGA實(shí)現(xiàn)低成本網(wǎng)絡(luò)數(shù)據(jù)傳輸存儲(chǔ)系統(tǒng)
萊迪思 ECP5和ECP5-5G FPGA
基于FPGA集群的NEST脈沖神經(jīng)網(wǎng)絡(luò)仿真器
萊迪思CertusPro-NX 高級(jí)通用FPGA
手把手教你學(xué)習(xí)FPGA—LED篇
萊迪思L-ASC10

現(xiàn)場(chǎng)可編程門陣列（fpga）專欄文章

熱門主題

現(xiàn)場(chǎng)可編程門陣列（FPGA）樹(shù)莓派 linux

關(guān)于我們 - 廣告服務(wù) - 企業(yè)會(huì)員服務(wù) - 網(wǎng)站地圖 - 聯(lián)系我們 - 征稿 - 友情鏈接 - 手機(jī)EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社版權(quán)所有北京東曉國(guó)際技術(shù)信息咨詢有限公司

京ICP備12027778號(hào)-2 北京市公安局備案：1101082052 京公網(wǎng)安備11010802012473

看屁屁www成人影院,亚洲人妻成人图片,亚洲精品成人午夜在线,日韩在线欧美成人 (function(){ var bp = document.createElement('script'); var curProtocol = window.location.protocol.split(':')[0]; if (curProtocol === 'https') { bp.src = 'https://zz.bdstatic.com/linksubmit/push.js'; } else { bp.src = 'http://push.zhanzhang.baidu.com/push.js'; } var s = document.getElementsByTagName("script")[0]; s.parentNode.insertBefore(bp, s); })();