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加快早期設計探索和驗證，縮短上市時間

• 芯片級驗證的挑戰(zhàn)鑒于先進工藝設計的規(guī)模和復雜性，而且各方為 搶先將產(chǎn)品推向市場而不斷競爭，片上系統(tǒng) (SoC) 設計團隊沒有時間等到所有芯片模塊都全 部完成后才開始組裝芯片。因此，SoC 設計人員 通常會在模塊開發(fā)的同時開始芯片集成工作，以 便在設計周期的早期捕獲并糾正任何布線違規(guī)， 從而幫助縮短至關(guān)重要的上市時間。錯誤在早期 階段更容易修復，而且對版圖沒有重大影響，設 計人員在此階段消除錯誤，可以減少實現(xiàn)流片所 需的設計規(guī)則檢查 (DRC) 迭代次數(shù)（圖 1）。但是，早期階段芯片級物理驗證面臨許多挑 戰(zhàn)
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