譯碼器 文章 進(jìn)入譯碼器技術(shù)社區(qū)
如何基于并行流水線技術(shù)進(jìn)行RS255/RS233譯碼器設(shè)計？
- RS糾錯編碼是目前最有效、應(yīng)用最廣泛的差錯控制編碼之一，是一種糾錯能力很強(qiáng)的多進(jìn)制BCH碼，也是一類典型的代數(shù)幾何碼。它是由里德(Reed)和索洛蒙(So
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基于FPGA的RS碼譯碼器的設(shè)計
- 摘要：介紹了符合CCSDS標(biāo)準(zhǔn)的RS(255，223)碼譯碼器的硬件實現(xiàn)結(jié)構(gòu)。譯碼器采用8位并行時域譯碼算法，主要包括了修正后的無逆BM迭代譯碼算法，錢搜索算法和Forney算法。采用了三級流水線結(jié)構(gòu)實現(xiàn)，減小了譯碼器的時延
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譯碼器工作原理
- 導(dǎo)讀：本文主要介紹的是譯碼器的工作原理，感興趣的童鞋們快來看一下吧~~~很漲姿勢的哦~~~ 1.譯碼器工作原理--簡介 譯碼器(decoder)是一類可以將輸入二進(jìn)制代碼的狀態(tài)翻譯成輸出信號，以表示其原來含義的電路，或者可以說實現(xiàn)把代碼狀態(tài)的特定含義“翻譯”出來電路稱為譯碼器。其可以分為變量譯碼和顯示譯碼兩類，常見的有n線-2^n線譯碼和8421BCD碼譯碼兩類。顯示譯碼器用來將二進(jìn)制數(shù)轉(zhuǎn)換成對應(yīng)的七段碼，一般其可分為驅(qū)動LED和驅(qū)動LCD兩類。 2.譯碼器工作原
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基于FPGA的Viterbi譯碼器設(shè)計及實現(xiàn)
- 卷積碼是廣泛應(yīng)用于衛(wèi)星通信、無線通信等各種通信系統(tǒng)的信道編碼方式。Viterbi算法是一種最大似然譯碼算法。在碼的約束度較小時，它比其它概率譯碼算法效率更高、速度更快，譯碼器的硬件結(jié)構(gòu)比較簡單。隨著可編程邏輯技術(shù)的不斷發(fā)展，其高密度、低功耗、使用靈活、設(shè)計快速、成本低廉、現(xiàn)場可編程和反復(fù)可編程等特性，使FPGA逐步成為Viterbi譯碼器設(shè)計的最佳方法。項目目的是用FPGA實現(xiàn)一個Viterbi譯碼器。 一、譯碼器功能分析 譯碼器是一種具有“翻譯”功能的邏輯電路，這
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基于PROTEUS的汽車尾燈控制系統(tǒng)的設(shè)計
- 利用Proteus軟件設(shè)計了一種汽車尾燈控制系統(tǒng)。采用555定時器產(chǎn)生時鐘信號，用JK觸發(fā)器進(jìn)行計數(shù)，譯碼器74HC138進(jìn)行譯碼，利用發(fā)光二極管顯示尾燈的狀態(tài)。完成了整體電路的設(shè)計。并在Proteus軟件中對電路進(jìn)行仿真，汽車尾燈在正常行駛、左拐彎、右拐彎和臨時剎車等狀態(tài)時能夠按設(shè)計要求正常顯示。最后制成成品。該系統(tǒng)具有結(jié)構(gòu)簡單，價格低廉、使用方便等特點，有一定的實際應(yīng)用價值。
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計數(shù)器在數(shù)字電路中的應(yīng)用
- 摘要：計數(shù)器是典型的時序邏輯電路，也是數(shù)字系統(tǒng)中使用最多的時序邏輯器件，為了更好地理解和擴(kuò)展集成計數(shù)器件的性能和用途，達(dá)到舉一反三、靈活運(yùn)用的目的。以中規(guī)模集成計數(shù)器74LS192為例，選用兩片74LS192構(gòu)成預(yù)
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譯碼器介紹
概述
譯碼器是組合邏輯電路的一個重要的器件，其可以分為：變量譯碼和顯示譯碼兩類。
變量譯碼一般是一種較少輸入變?yōu)檩^多輸出的器件，一般分為2n譯碼和8421BCD碼譯碼兩類。
顯示譯碼主要解決二進(jìn)制數(shù)顯示成對應(yīng)的十、或十六進(jìn)制數(shù)的轉(zhuǎn)換功能，一般其可分為驅(qū)動LED和驅(qū)動LCD兩類。
譯碼是編碼的逆過程，在編碼時，每一種二進(jìn)制代碼，都賦予了特定的含義，即都表示了一個確定的信號或者 [ 查看詳細(xì) ]
譯碼器電路
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