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          EEPW首頁(yè) >> 主題列表 >> 軟件設(shè)計(jì)工具

          利用強(qiáng)大的軟件設(shè)計(jì)工具為FPGA開(kāi)發(fā)者賦能

          • 許多嵌入式系統(tǒng)的開(kāi)發(fā)者都對(duì)使用基于FPGA的SoC系統(tǒng)感興趣,但是基于傳統(tǒng)HDL硬件描述語(yǔ)言的FPGA開(kāi)發(fā)工具和復(fù)雜流程往往會(huì)令他們望而卻步。為了解決這一問(wèn)題,萊迪思的Propel工具套件提供了基于圖形化設(shè)計(jì)方法的設(shè)計(jì)環(huán)境,用于創(chuàng)建,分析,編譯和調(diào)試基于FPGA的嵌入式系統(tǒng),從而完成系統(tǒng)軟硬件設(shè)計(jì)。萊迪思的Propel工具套件由兩部分組成:Propel Builder提供圖形化的SoC系統(tǒng)和硬件設(shè)計(jì),通過(guò)拖放方式,選擇處理器和相關(guān)的外設(shè)與IP,通過(guò)圖形化的方式進(jìn)行配置和連接,從而完成系統(tǒng)層面的硬件設(shè)計(jì);
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          軟件設(shè)計(jì)工具介紹

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