邏輯 文章 進(jìn)入邏輯技術(shù)社區(qū)
基于PCI9054橋路器的數(shù)據(jù)傳輸?shù)慕涌谶壿嬙O(shè)計(jì)
- PCI總線支持突發(fā)傳送，多處理器和并發(fā)工作，廣泛應(yīng)用于各種平臺(tái)設(shè)計(jì)?；赑CI9054的接口板也廣泛地應(yīng)用于各種高速、大數(shù)據(jù)量的處理系統(tǒng)。由于PCI9054橋接有PCI總線和本地總線，開發(fā)者不必過多考慮復(fù)雜的PCI總線規(guī)
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基于絕熱邏輯的低功耗乘法器電路設(shè)計(jì)
- 基于絕熱開關(guān)理論的能量回收邏輯與傳統(tǒng)的靜態(tài)CM0s邏輯相比，能夠大大減少電路的功率消耗。這里介紹了一種使用單相正弦電源時(shí)鐘的能量回收邏輯，分別用靜態(tài)CMOS邏輯和這種能量回收邏輯設(shè)計(jì)，并仿真了一個(gè)兩位乘法器電路，比較了這兩種電路的性能。研究表明，采用能量回收邏輯設(shè)計(jì)的乘法器顯著降低了電路的功率消耗。
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基于可編程計(jì)數(shù)器的時(shí)序邏輯電路設(shè)計(jì)
- 介紹了基于MSI可編程計(jì)數(shù)器74Lsl61的時(shí)序邏輯電路設(shè)計(jì)技術(shù)，目的是探索MSI可編程計(jì)數(shù)器實(shí)現(xiàn)一般時(shí)序邏輯電路的擴(kuò)展應(yīng)用方法，即以計(jì)數(shù)器Q3，Q2，Q1，Q0端的代碼組合表示時(shí)序邏輯電路的各個(gè)狀態(tài)，由輸入變量控制計(jì)數(shù)器的EP，ET及端，綜合利用計(jì)數(shù)、置數(shù)、保持功能，使計(jì)數(shù)器的狀態(tài)變化滿足所要求的時(shí)序，用計(jì)數(shù)功能實(shí)現(xiàn)“次態(tài)=現(xiàn)態(tài)+1”的二進(jìn)制時(shí)序關(guān)系，用置數(shù)功能實(shí)現(xiàn)“次態(tài)=預(yù)置數(shù)”的非二進(jìn)制時(shí)序關(guān)系，用保持功能實(shí)現(xiàn)“次態(tài)=現(xiàn)態(tài)”的自循環(huán)時(shí)序關(guān)系。所述方法的創(chuàng)新點(diǎn)是提出了MSI可編程計(jì)數(shù)器改變應(yīng)用方向的邏
- 關(guān)鍵字： 邏輯 電路設(shè)計(jì) 時(shí)序 計(jì)數(shù)器 可編程 基于
采用可編程邏輯器件和A/D轉(zhuǎn)換器的高速數(shù)據(jù)采集卡的設(shè)計(jì)方案
- 采用可編程邏輯器件和A/D轉(zhuǎn)換器的高速數(shù)據(jù)采集卡的設(shè)計(jì)方案, 用于PC的采集系統(tǒng)以前大多有用ISA總線結(jié)構(gòu)，這種結(jié)構(gòu)的最大缺點(diǎn)是傳輸速率低，無法實(shí)現(xiàn)高速數(shù)據(jù)的實(shí)時(shí)傳輸。而PCI總線則以其卓越的性能受到了廣泛的應(yīng)用。32位PCI總線的最大傳輸數(shù)據(jù)速率可達(dá)132MB/s，64位PCI總線的
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聯(lián)電、爾必達(dá)第2階段合作朝交叉持股進(jìn)行
- 邏輯和DRAM技術(shù)跨產(chǎn)業(yè)合作大戲正式登場，聯(lián)電、爾必達(dá)(Elpida)攜手開發(fā)TSV技術(shù)的簽約儀式將于21日召開記者會(huì)對外宣布;值得注意的是，業(yè)界透露，雙方技術(shù)合作僅是第1階段，未來第2階段考慮以交叉持股的方式，讓雙方的合作關(guān)系更為緊密，因此聯(lián)電為引進(jìn)策略聯(lián)盟伙伴而辦理的私募案，爾必達(dá)將是口袋人選之一。 聯(lián)電、爾必達(dá)和力成將于今日針對TSV技術(shù)舉行簽約儀式，這是近年來邏輯和存儲(chǔ)器技術(shù)領(lǐng)域罕見的跨產(chǎn)業(yè)大合作，爾必達(dá)(Elpida)社長坂本幸雄過去是聯(lián)日半導(dǎo)體(UMCj)的總經(jīng)理，因此爾必達(dá)與聯(lián)電雙
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實(shí)現(xiàn)拆分大組合邏輯的方法
- 實(shí)現(xiàn)拆分大組合邏輯的方法,圖1是很多為了提高系統(tǒng)時(shí)鐘采用的拆分大組合邏輯的方法，但是沒有提供具體如何拆分的實(shí)例。我覺得實(shí)例才是重要的。但我不明白在寫代碼時(shí)，如何知道這樣寫會(huì)被綜合成一個(gè)很大的邏輯，一些簡單的可以想到(比如大的計(jì)數(shù)
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基于Verilog的順序狀態(tài)邏輯FSM的設(shè)計(jì)與仿真
- 基于Verilog的順序狀態(tài)邏輯FSM的設(shè)計(jì)與仿真, 硬件描述語言Verilog為數(shù)字系統(tǒng)設(shè)計(jì)人員提供了一種在廣泛抽象層次上描述數(shù)字系統(tǒng)的方式，同時(shí)，為計(jì)算機(jī)輔助設(shè)計(jì)工具在工程設(shè)計(jì)中的應(yīng)用提供了方法。該語言支持早期的行為結(jié)構(gòu)設(shè)計(jì)的概念，以及其后層次化結(jié)構(gòu)設(shè)計(jì)的
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數(shù)字網(wǎng)絡(luò)視頻監(jiān)控器中多路轉(zhuǎn)接邏輯的設(shè)計(jì)
- 摘要：本文主要介紹在視頻監(jiān)控板中多路視頻信號輸入情況下的數(shù)據(jù)緩存、信號格式轉(zhuǎn)換的設(shè)計(jì)，并用Altera的Cyclone器件實(shí)現(xiàn)的整個(gè)過程。包括簡單介紹視頻監(jiān)控器電路板的原理，此轉(zhuǎn)接邏輯在系統(tǒng)中的作用和地位，并詳細(xì)
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基于PLD的CCD Sensor驅(qū)動(dòng)邏輯設(shè)計(jì)
- 0 引 言
視覺信息是客觀世界中非常豐富，非常重要的部分。隨著多媒體系統(tǒng)的發(fā)展，圖像傳感器應(yīng)用越來越廣泛。不僅用于攝錄像機(jī)，安保產(chǎn)品、數(shù)碼相機(jī)及計(jì)算機(jī)鏡頭等，而且開始用于傳統(tǒng)上的非視像產(chǎn)品，如移動(dòng)電 - 關(guān)鍵字： 邏輯 設(shè)計(jì) 驅(qū)動(dòng) Sensor PLD CCD 基于
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