鎖相頻率 文章 進(jìn)入鎖相頻率技術(shù)社區(qū)
基于DDS的鎖相頻率合成器設(shè)計(jì)
- 1 引 言 現(xiàn)代頻半合成源對(duì)頻率精度、分辨率、轉(zhuǎn)換時(shí)間和頻譜純度等指標(biāo)提出了越來越高的要求。甚高頻(VHF)頻率合成器通常采用多鎖相環(huán)路(PLL)結(jié)構(gòu)，多環(huán)合成器將單環(huán)中的巨大分頻比用多個(gè)環(huán)路來負(fù)擔(dān)，同時(shí)各環(huán)，尤其足主環(huán)的鑒相頻率大幅度提高，從而滿足了鑒相頻率高、分頻比小和分辨率高等要求。但是由于多環(huán)組合的固有特性，尤其是分辨率每提高1個(gè)數(shù)量級(jí)，就要增加一級(jí)子環(huán)路，使得其頻率轉(zhuǎn)換速度低、線路復(fù)雜、可靠性差。 直接數(shù)字式頻率合成技術(shù)(DDS)的頻率分辨率高、頻率轉(zhuǎn)換速度快。DDS/PLL混合
- 關(guān)鍵字： DDS 鎖相頻率 合成器 模擬IC
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鎖相頻率介紹
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