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          EEPW首頁 >> 主題列表 >> 高速數(shù)據(jù)

          多種觸發(fā)功能的可編程高速數(shù)據(jù)采集模塊

          • 摘要:給出一種具有多種觸發(fā)功能的可編程高速數(shù)據(jù)采集模塊的設(shè)計方法。模塊可以動態(tài)設(shè)置觸發(fā)窗長度、觸發(fā)點電平、觸發(fā)極性和觸發(fā)模式;依據(jù)觸發(fā)字與存儲在FIFO中的A/D轉(zhuǎn)換數(shù)據(jù)比較確定觸發(fā)位置,并根據(jù)設(shè)置的預(yù)觸發(fā)
          • 關(guān)鍵字: 觸發(fā)  采集模塊  可編程  高速數(shù)據(jù)    

          基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

          • 摘要:為了在提高數(shù)據(jù)采集卡的速度的同時降低成本,設(shè)計了一種應(yīng)用流水線存儲技術(shù)的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)應(yīng)用軟件與硬件相結(jié)合的方式來控制實現(xiàn),通過MAX1308模數(shù)轉(zhuǎn)換器完成ADC的轉(zhuǎn)化過程,采用多片Nandflash流水線
          • 關(guān)鍵字: FPGA  高速數(shù)據(jù)  采集  系統(tǒng)設(shè)計    

          基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

          • 為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開發(fā)時間較長的問題,提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計軟核,使用VHDL語言對軟核進行模塊化設(shè)計。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動程序以及LabVIEW上位機的設(shè)計。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強,有利于縮短同類型系統(tǒng)設(shè)計研發(fā)周期。
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          基于DSP的高速數(shù)據(jù)采集系統(tǒng)硬件設(shè)計

          • 摘要:為了滿足數(shù)據(jù)采集及信號處理系統(tǒng)中對數(shù)據(jù)實時性的要求,采用TMS320VC5509為中心處理器,并對A/D轉(zhuǎn)換、電源及復(fù)位電路、時鐘電路、JTAG仿真電路等外圍硬件進行了設(shè)計,使其能夠在高速采樣信號下,及時對數(shù)據(jù)進
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          DDR SDRAM在高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

          • 在數(shù)據(jù)處理中為了更好地對被測對象進行處理和分析,研究人員們把重點更多的放在高速、高精度、高存儲深度的數(shù)據(jù)采集系統(tǒng)的研究上 由于A/D芯片及高性能的FPGA的出現(xiàn),已經(jīng)可以實現(xiàn)高速高精度的數(shù)據(jù)處理,則
          • 關(guān)鍵字: SDRAM  DDR  高速數(shù)據(jù)  采集系統(tǒng)    

          基于Linux平臺的天氣雷達高速數(shù)據(jù)采集系統(tǒng)設(shè)計

          • Linux是開放源代碼、網(wǎng)絡(luò)化的操作系統(tǒng),具有穩(wěn)定、高效、內(nèi)核可自由配置等特點。采用Linux 操作系統(tǒng)作為開發(fā)平臺與采用VxWorks 和Windows 作為開發(fā)平臺相比不僅有免費的優(yōu)勢,而且對于發(fā)展核心技術(shù),提高信息安全有
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          基于FPGA的IEEE 1394b高速數(shù)據(jù)傳輸系統(tǒng)

          • 摘要:介紹了IEEE 1394h串行總線的特點,并以FPGA嵌入式處理器Nios II為控制核心,設(shè)計實現(xiàn)了一種1394b高速數(shù)據(jù)傳輸系統(tǒng)。闡述了該系統(tǒng)的硬件設(shè)計和軟件工作流程。實驗表明,該系統(tǒng)可靠性高、實時性好、具有廣泛的應(yīng)
          • 關(guān)鍵字: 1394b  FPGA  IEEE  高速數(shù)據(jù)    

          基于FPGA的高速數(shù)據(jù)處理系統(tǒng)設(shè)計

          • 針對光纖微擾動傳感器的高速數(shù)據(jù)處理問題,設(shè)計一種以XC4VSX25為核心,具有數(shù)據(jù)采集功能、存儲功能、LCD顯示功能和USB通信功能的系統(tǒng)。利用XC4VSX25帶有的XtremeDSP IP核,通過并行運算解決高速實時數(shù)據(jù)處理問題,并且通過Verilog HDL語言設(shè)計串行結(jié)構(gòu)和并行結(jié)構(gòu),并在ModelSim中對兩種結(jié)構(gòu)進行仿真比較。結(jié)果表明,本系統(tǒng)中并型結(jié)構(gòu)的計算速度是正比于并行度的,可以提高系統(tǒng)處理速度。
          • 關(guān)鍵字: FPGA  高速數(shù)據(jù)  處理系統(tǒng)    

          基于FPGA+DSP的雷達高速數(shù)據(jù)采集系統(tǒng)的實現(xiàn)

          • 摘要:激光雷達的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄,幅度低,背景噪聲大等特點,對其進行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時,A/D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導(dǎo)致數(shù)據(jù)傳輸不
          • 關(guān)鍵字: FPGA  DSP  雷達  高速數(shù)據(jù)    

          一種高速數(shù)據(jù)采集卡的設(shè)計與實現(xiàn)

          • 摘要:為了實現(xiàn)對武器系統(tǒng)模擬信號的采集和數(shù)據(jù)分析,根據(jù)PC/104總線的數(shù)據(jù)采集系統(tǒng)的設(shè)計思想,數(shù)據(jù)采集卡以A/D轉(zhuǎn)換器、CPLD和FIFO相結(jié)合來實現(xiàn)信號的連續(xù)采集與數(shù)據(jù)傳輸?shù)目刂?。A/D轉(zhuǎn)換器實現(xiàn)信號的采樣保持和模
          • 關(guān)鍵字: 高速數(shù)據(jù)  采集  卡的設(shè)計    

          基于FPGA與DSP的雷達高速數(shù)據(jù)采集系統(tǒng)

          • 激光雷達的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄,幅度低,背景噪聲大等特點,對其進行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時,A/D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導(dǎo)致數(shù)據(jù)傳輸不及時,影響系統(tǒng)可靠性、實時性。針對激光雷達回撥信號,提出基于FPGA與DSP的高速數(shù)據(jù)采集系統(tǒng),利用FPGA內(nèi)部的異步FIFO和DCM實現(xiàn)A/D轉(zhuǎn)換器與DSP的高速外部存儲接口(EMIF)之間的數(shù)據(jù)傳輸。介紹了ADC外圍電路、工作時序以及DSP的EMIF的設(shè)置參數(shù),并對異步FIFO數(shù)據(jù)讀寫進行仿真,結(jié)合硬件結(jié)構(gòu)詳細地
          • 關(guān)鍵字: FPGA  DSP  雷達  高速數(shù)據(jù)    

          基于USB-6281的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

          • 為解決基于PCI卡的數(shù)據(jù)采集方案安裝不方便、傳輸速度慢、受限于計算機插槽數(shù)量和中斷資源,可擴展性差等問題,提出了基于USB-6281的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計方案。系統(tǒng)以USB-6281高速數(shù)據(jù)采集卡為硬件平臺,借助NI-DAQmx驅(qū)動軟件,采用VC++高級語言編程對USB-6281進行硬件驅(qū)動和控制,實現(xiàn)了數(shù)據(jù)高速采集、傳輸和存儲。實驗結(jié)果表明,該系統(tǒng)在高采樣率下也能保持高精度,模擬輸出最大速率達2.8MS/s(2路),系統(tǒng)測量精度(滿量程)約0.01%。系統(tǒng)的擴展性好,應(yīng)用面廣,可實現(xiàn)對工業(yè)生產(chǎn)中諸如溫
          • 關(guān)鍵字: 6281  USB  高速數(shù)據(jù)  采集系統(tǒng)    

          基于A/D和DSP的高速數(shù)據(jù)采集技術(shù)

          • 中頻信號分為和差兩路,高速A/D與DSP組成的數(shù)據(jù)采集系統(tǒng)要分別對這兩路信號進行采集。對于兩路數(shù)據(jù)采集電路,A/D與DSP的接口連接是一樣的。兩個A/D同時將和路與差路信號采樣,并分別送入兩個FIFO;DSP分時從兩個FIFO中
          • 關(guān)鍵字: DSP  高速數(shù)據(jù)  采集    

          基于SAR系統(tǒng)的高速數(shù)據(jù)采集和存儲系統(tǒng)

          •  合成孔徑雷達(SAR)是主動式微波成像雷達,近年來隨著合成孔徑雷達的高速發(fā)展,對作為重要部分的數(shù)據(jù)采集和存儲系統(tǒng)的要求越來越高,比如對數(shù)據(jù)采集系統(tǒng)的采樣率、分辨率、存儲深度、數(shù)字信號處理速度、抗干擾能力等
          • 關(guān)鍵字: SAR  系統(tǒng)  高速數(shù)據(jù)  采集    

          基于AVR和CPLD的高速數(shù)據(jù)采集系統(tǒng)

          • 為了提高數(shù)據(jù)采集卡的速度,同時降低成本,設(shè)計一種并行數(shù)據(jù)采集系統(tǒng),要求并行采集速度大于10 Mb/s。整個系統(tǒng)由AVR與CPLD控制實現(xiàn),通過MAXl308完成模數(shù)轉(zhuǎn)換,并設(shè)計搭建了其外圍電路。采用12路數(shù)據(jù)存儲模式存儲高速采集的數(shù)據(jù)。實驗依據(jù)存儲要求搭建硬件電路并調(diào)試,示波器顯示的波形結(jié)果8組脈沖序列完全對齊,沒有出現(xiàn)時序混亂,同時并行處理過程中不相互影響,實現(xiàn)了低成本高速多路采集的設(shè)計要求。
          • 關(guān)鍵字: CPLD  AVR  高速數(shù)據(jù)  采集系統(tǒng)    
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          高速數(shù)據(jù)介紹

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