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智權半導體/SmartDV力助高速發(fā)展的中國RISC-V CPU IP廠商走上高質量發(fā)展之道
- 進入2024年,全球RISC-V社群在技術和應用兩個方向上都在加快發(fā)展,中國國內的RISC-V CPU IP提供商也在內核性能和應用擴展方面取得突破。從幾周前在杭州舉行的2024年RISC-V中國峰會以及其他行業(yè)活動和廠商活動中,可以清楚地看到這一趨勢。作為全球領先的IP供應商,SmartDV也從其中國的客戶和志趣相投的RISC-V CPU IP供應商那里獲得了一些建議和垂詢,希望和我們建立伙伴關系攜手在AI時代共同推動芯片產業(yè)繼續(xù)高速發(fā)展。SmartDV也看到了這一新的浪潮。上一次在行業(yè)慶祝RISC-V
- 關鍵字: 智權 SmartDV RISC-V CPU IP
將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰(zhàn)的任務!
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā),介紹了如何將芯片的產品定義與設計和驗證規(guī)劃進行結合,詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時,必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始,通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素,用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中,我們分享了第二到第四主題,介紹了使用FPGA進行原型設計時需要立即想到哪些基本概念、在將專為ASIC技術而設計的I
- 關鍵字: ASIC IP FPGA SmartDV
新思科技推出業(yè)內首款獲得ISO/SAE 21434網絡安全合規(guī)認證的IP產品,加速汽車安全領域發(fā)展
- 摘要:●? ?新思科技ARC HS4xFS處理器IP和新思科技IP開發(fā)流程均通過獨立審計機構SGS-T?V Saar的ISO/SAE 21434認證?!? ?獲得ISO/SAE 21434認證可應對不斷變化的網絡安全威脅,有助于在整個生命周期內為汽車系統(tǒng)提供長期的安全性與可靠性?!? ?經過安全風險分析(SRA)認證的新思科技ARC HS4xFS處理器IP助力開發(fā)者能夠以安全的方式將IP集成到系統(tǒng)中,從而滿足ISO/SAE 21434要求?!?n
- 關鍵字: 新思科技 ISO/SAE 21434 網絡安全合規(guī)認證 IP 汽車安全
將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務!
- 本系列文章從數(shù)字芯片設計項目技術總監(jiān)的角度出發(fā),介紹了如何將芯片的產品定義與設計和驗證規(guī)劃進行結合,詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時,必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始,通過闡述開發(fā)ASIC原型設計時需要考慮到的IP核相關因素,用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設計時需要考量的因素。在上篇文章中,我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性,并對原型設計中各種考量因素進行了總體概述,分析開發(fā)A
- 關鍵字: ASIC IP FPGA SmartDV
燦芯半導體發(fā)布通用高性能小數(shù)分頻鎖相環(huán)IP及相關解決方案
- 一站式定制芯片及IP供應商——燦芯半導體(上海)股份有限公司近日宣布成功研發(fā)出一款通用高性能小數(shù)分頻鎖相環(huán)(fractional-N PLL) IP,支持24bits高精度小數(shù)分頻,最高輸出頻率4.5Ghz,另外還支持擴頻時鐘(SSC)功能,可以為客戶提供多功能的小數(shù)分頻 PLL解決方案。PLL電路一般用于產生輸出頻率,輸出頻率值與PLL的參考輸入頻率呈倍數(shù)關系。小數(shù)分頻PLL通過頻率乘法比例的小數(shù)值,實現(xiàn)更精確的輸出頻率控制,從而提供更高精度和準確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內調制時鐘信號
- 關鍵字: 燦芯半導體 小數(shù)分頻 鎖相環(huán) IP
IC設計倚重IP、ASIC趨勢成形
- 半導體制程進入2奈米,擷發(fā)科技董事長楊健盟指出,IC設計難度陡增,未來硅智財、ASIC角色將更加吃重,協(xié)助IC設計以SoC方式因應AI新世代。楊健盟分析,過往IDM分拆晶圓代工之典范,將在IC設計上發(fā)生,AI時代IC設計大者恒大趨勢成形。 擷發(fā)科技已獲國際芯片大廠AI芯片外包訂單,楊健盟認為,現(xiàn)在芯片晶體管動輒百億個,考驗IC設計業(yè)者研發(fā)量能。大量采用基礎、接口IP使研發(fā)能力更能專注前段設計,海外大廠甚至將后段交由ASIC業(yè)者,未來倚重IP、ASIC趨勢只會更加明顯。中國臺灣半導體產業(yè)鏈在邏輯先進制程、先
- 關鍵字: IC設計 IP ASIC
炬芯科技的智能手表SoC采用了芯原的2.5D GPU IP
- 芯原股份近日宣布低功耗?AIoT?芯片設計廠商炬芯科技股份有限公司(炬芯科技,?股票代碼:688049.SH)在其高集成度的雙模藍牙智能手表SoC? ATS3085S和ATS3089系列中采用了芯原低功耗且功能豐富的2.5D圖形處理器(GPU)IP。?炬芯科技的智能手表SoC ATS3085S和ATS3089系列擁有卓越的圖形顯示性能,采用2D+2.5D雙GPU硬件加速配置,支持JPEG硬件解碼,具有高幀率、低功耗等特點。該系列SoC以其高集成度,可實現(xiàn)單
- 關鍵字: 炬芯 智能手表 芯原 2.5D GPU IP
一文把TCP/IP協(xié)議講絕了!
- 本文整理了一些TCP/IP協(xié)議簇中需要必知必會的十大問題,既是面試高頻問題,又是程序員必備基礎素養(yǎng)。一、TCP/IP模型TCP/IP協(xié)議模型(Transmission Control Protocol/Internet Protocol),包含了一系列構成互聯(lián)網基礎的網絡協(xié)議,是Internet的核心協(xié)議?;赥CP/IP的參考模型將協(xié)議分成四個層次,它們分別是鏈路層、網絡層、傳輸層和應用層。下圖表示TCP/IP模型與OSI模型各層的對照關系。TCP/IP協(xié)議族按照層次由上到下,層層包裝。最上面的是應用層
- 關鍵字: TCP IP 協(xié)議 程序員
銳成芯微亮相北京車展 發(fā)布應用于wBMS的藍牙RF IP
- 25日,北京國際車展火熱開幕,銳成芯微攜旗下車規(guī)級IP亮相車展中國芯展區(qū),并發(fā)布應用于wBMS(無線電池管理系統(tǒng))的車規(guī)級藍牙RF IP。銳成芯微亮相2024北京車展中國芯展區(qū)(左)隨著電動汽車和新能源市場的快速發(fā)展,電池管理系統(tǒng)的需求也在不斷增加。無線電池管理系統(tǒng)(wBMS)作為提升電池性能、安全性和可靠性的關鍵技術之一,正逐漸成為汽車廠商、特別是頭部汽車廠商的關注焦點。而車規(guī)級藍牙RF IP作為wBMS中的重要組成部分,結合了藍牙的通信能力和RF IP的定位功能,為實現(xiàn)安全可靠的電池管理保駕護航。立足
- 關鍵字: 銳成芯微 wBMS 藍牙RF IP
嘉楠基于RISC-V的端側AIoT SoC采用了芯原的ISP IP和GPU IP
- 芯原股份(芯原)近日宣布嘉楠科技(嘉楠)全球首款支持RISC-V Vector 1.0標準的商用量產端側AIoT芯片K230集成了芯原的圖像信號處理器(ISP)IP ISP8000、畸變矯正(DeWarp)處理器IP DW200,以及2.5D圖形處理器(GPU)IP GCNanoV。該合作極大地優(yōu)化了高精度、低延遲的端側AIoT解決方案,可廣泛適用于各類智能產品及場景,如邊緣側大模型多模態(tài)接入終端、3D結構光深度感知模組、交互型機器人、開源硬件,以及智能制造、智能家居和智能教育相關硬件設備等。芯原的ISP
- 關鍵字: 嘉楠 RISC-V AIoT SoC 芯原 ISP IP GPU IP
芯原業(yè)界領先的嵌入式GPU IP賦能先楫高性能的HPM6800系列RISC-V MCU
- 2024年3月4日,中國上海——芯原股份(芯原,股票代碼:688521.SH)今日宣布先楫半導體(簡稱“先楫”)的HPM6800系列新一代數(shù)字儀表顯示及人機界面系統(tǒng)應用平臺采用了芯原的高性能2.5D圖形處理器(GPU)IP。HPM6800系列產品基于RISC-V CPU內核,具備高算力、低功耗、高集成度和出色的多媒體功能,適用于汽車儀表、人機交互界面(HMI),以及電子后視鏡(CMS)等需要復雜圖形處理、高分辨率顯示和高性能多媒體用戶界面的應用。 芯原支持OpenVG的2.5D GPU IP能夠
- 關鍵字: 芯原 GPU IP 先楫 RISC-V MCU
-ip介紹
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