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數(shù)字電視CAS中DES加密模塊的FPGA實(shí)現(xiàn)
- 一種基于FPGA的數(shù)據(jù)加密標(biāo)準(zhǔn)算法的實(shí)現(xiàn)。就資源優(yōu)先和性能優(yōu)先分別使用循環(huán)法和流水線法對(duì)DES加密算法進(jìn)行了設(shè)計(jì)，并對(duì)其進(jìn)行了比較。通過(guò)采用子密鑰簡(jiǎn)單產(chǎn)生和ROM優(yōu)化S盒的方法，對(duì)流水線法進(jìn)行改進(jìn)，達(dá)到了資源占用率低、加密速度快的效果。
- 關(guān)鍵字： 數(shù)據(jù)加密標(biāo)準(zhǔn)算法 DES FPGA 流水線
提高加密應(yīng)用的系統(tǒng)效率
- 為了確保數(shù)據(jù)從數(shù)據(jù)源安全傳輸?shù)侥康牡?，必須在安全?yīng)用中采用加密技術(shù)。最常用的加密技術(shù)采用確定性算法，并對(duì)固定長(zhǎng)度數(shù)據(jù)塊進(jìn)行固定不變的轉(zhuǎn)換操作。此類加密技術(shù)包括高級(jí)加密標(biāo)準(zhǔn)(AES)、數(shù)據(jù)加密標(biāo)準(zhǔn)(DES)、國(guó)際數(shù)據(jù)加密算法(IDEA)和RC5等。然而，這種“分組密碼”方案會(huì)制約硬件的吞吐量、數(shù)據(jù)處理和緩沖容量，因?yàn)榧用懿僮鞅仨氃谙聜€(gè)數(shù)據(jù)塊到來(lái)之前完成。大量工業(yè)加密
- 關(guān)鍵字： AES IDAE DES RC5
基于FPGA的改進(jìn)DES算法的實(shí)現(xiàn)
- 介紹了DES算法原理，詳細(xì)分析了子密鑰生成、S盒和輪函數(shù)的設(shè)計(jì)。將DES算法采用資源優(yōu)先方案，在輪函數(shù)內(nèi)部設(shè)置流水線架構(gòu)，提高了整體處理速度；簡(jiǎn)化子密鑰與原始密鑰的生成關(guān)系，實(shí)現(xiàn)子密鑰在迭代過(guò)程的動(dòng)態(tài)分發(fā)；利用雙重case語(yǔ)句實(shí)現(xiàn)S盒的變換功能，加快算法執(zhí)行速度。運(yùn)用硬件描述語(yǔ)言Verilog,采用自頂向下的設(shè)計(jì)思想,在FPGA平臺(tái)上實(shí)現(xiàn)了改進(jìn)DES算法的功能。
- 關(guān)鍵字： FPGA DES 算法
一種密鑰可配置的DES加密算法的FPGA
- 一種密鑰可配置的DES加密算法的FPGA,摘 要： 在傳統(tǒng)的DES加密算法的基礎(chǔ)上，提出一種對(duì)密鑰實(shí)行動(dòng)態(tài)管理的硬件設(shè)計(jì)方案，給出了其FPGA實(shí)現(xiàn)方法。通過(guò)對(duì)DES加密原理的分析，利用其子密鑰的生成與核心算法相關(guān)性較弱的特點(diǎn)，對(duì)密鑰進(jìn)行重新配置。DES算法采
- 關(guān)鍵字：
DES 線性反饋移位寄存器 混沌加密 FPGA
隨著密碼學(xué)技術(shù)的飛速發(fā)展，軟件加密已經(jīng)非常流行，但由于硬件加密的穩(wěn)定性和兼容性更好而且速度更快，所以仍是商業(yè)和軍事用途的主要選擇。而FPGA在實(shí)現(xiàn)算法方面具有靈活性、物理安全性和比軟件更高的速度性能，已成為硬件實(shí)現(xiàn)加密算法的最好選擇。
基于FPSLIC設(shè)計(jì)的DES解密和AES的分組加解密的實(shí)現(xiàn)
- 1 引言 美國(guó)Atmel公司生產(chǎn)的AT94K系列芯片是以Atmel0.35的5層金屬CMOS工藝制造。它基于SRAM的FPGA、高性能準(zhǔn)外設(shè)的Atmel8位RISCAVR單片機(jī)。另外器件中還包括擴(kuò)展數(shù)據(jù)和程序SRAM及器件控制和管理邏輯。圖1-1是
- 關(guān)鍵字： 解密 AES 實(shí)現(xiàn) 分組 DES FPSLIC 設(shè)計(jì) 基于
基于FPGA的DES加密算法的高性能實(shí)現(xiàn)
- 在分析DES算法原理的基礎(chǔ)上，詳細(xì)闡述一種基于VHDL描述、FPGA實(shí)現(xiàn)的DES加密算法系統(tǒng)的設(shè)計(jì)和仿真結(jié)果。該系統(tǒng)采用了一種基于子密鑰預(yù)先計(jì)算的新型流水線設(shè)計(jì)方案，克服了傳統(tǒng)DES流水線實(shí)現(xiàn)方式的缺點(diǎn)，使系統(tǒng)的密鑰可動(dòng)態(tài)刷新．并在硬件資源消耗有所降低的情況下，進(jìn)一步提高系統(tǒng)的處理速度，系統(tǒng)最高時(shí)鐘頻率為222．77 MHz．信息加密的速度為14．26 Gb／s，是最快軟件實(shí)現(xiàn)方式的112倍。同時(shí)系統(tǒng)還具有設(shè)計(jì)靈活，可靠性高，可重用性強(qiáng)．升級(jí)方便等特點(diǎn)。
- 關(guān)鍵字： FPGA DES 加密算法 性能
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