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基于鎖相環(huán)的Chirp超寬帶信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要:在傳統(tǒng)的模擬法產(chǎn)生Chirp超寬帶信號(hào)的基礎(chǔ)上,提出了一種基于鎖相環(huán)(PLL)法的Chirp超寬帶信號(hào)源設(shè)計(jì)方案。與傳統(tǒng)的模擬方法相比,該方法產(chǎn)生的Chirp超寬帶信號(hào)載頻穩(wěn)定性高,能夠達(dá)到參考信號(hào)的頻率穩(wěn)定度。從
- 關(guān)鍵字: 設(shè)計(jì) 實(shí)現(xiàn) 信號(hào)源 寬帶 相環(huán) Chirp 基于
一種基于DDS+PLL的Chirp-UWB信號(hào)產(chǎn)生方案
- 由于超寬帶信號(hào)的帶寬很寬,傳統(tǒng)的信號(hào)產(chǎn)生辦法已不能直接應(yīng)用于超寬帶通信。為此,提出一種基于DDS+PLL的Chirp-UWB信號(hào)產(chǎn)生方案,該方法聯(lián)合使用了DDS和PLL兩種信號(hào)產(chǎn)生技術(shù),優(yōu)勢(shì)互補(bǔ)。通過(guò)ADS結(jié)合Matlab對(duì)系統(tǒng)的模型建立和性能分析證明,該方案輸出信號(hào)性能優(yōu)良,完全能滿足設(shè)計(jì)要求,并已成功應(yīng)用于某超寬帶通信系統(tǒng)。
- 關(guān)鍵字: 產(chǎn)生 方案 信號(hào) Chirp-UWB DDS PLL 基于 轉(zhuǎn)換器
基于DSP Builder的Chirp信號(hào)源設(shè)計(jì)
- 設(shè)計(jì)分析了Chirp函數(shù)在時(shí)域和頻域內(nèi)的一般特點(diǎn)和解析公式。提出首先在Altera DSP開(kāi)發(fā)工具DSP Builder中實(shí)現(xiàn)直接數(shù)字合成器(DDS)模塊,根據(jù)Chirp函數(shù)特定的輸入/輸出(線性和非線性)關(guān)系,計(jì)算出當(dāng)前輸入字與輸出頻率的對(duì)應(yīng)關(guān)系;然后設(shè)計(jì)控制字子模塊產(chǎn)生DDS模塊的頻率控制字,驅(qū)動(dòng)DDS產(chǎn)生不同的輸出頻率,通過(guò)在Matlab的Simu-link環(huán)境下的仿真驗(yàn)證,得出不同時(shí)刻輸出的頻譜圖,驗(yàn)證了該設(shè)計(jì)能很好地實(shí)現(xiàn)Chirp信號(hào)源。
- 關(guān)鍵字: Builder Chirp DSP 信號(hào)源
Chirp函數(shù)的Nios Ⅱ嵌入式實(shí)現(xiàn)
- Chirp函數(shù)的Nios Ⅱ嵌入式實(shí)現(xiàn),摘 要:首先分析Chirp函數(shù)在頻域上的一般特性,提出利用FPGA的嵌入式軟核NiosⅡ處理器在嵌入式操作系統(tǒng)μC/OS-Ⅱ上實(shí)現(xiàn)Chirp的方法,即通過(guò)NiosⅡ處理器根據(jù)Chirp函數(shù)在頻域上頻率的跳變情況實(shí)時(shí)改變輸出DDS(直接數(shù)
- 關(guān)鍵字: 實(shí)現(xiàn) 嵌入式 Nios 函數(shù) Chirp
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