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EDA，如何突破功率的瓶頸
- 過(guò)去十年來(lái)，功率已經(jīng)成為一個(gè)關(guān)鍵的設(shè)計(jì)考慮，并在工程師設(shè)計(jì)與驗(yàn)證系統(tǒng)方面帶來(lái)了一些巨大的挑戰(zhàn)。物理學(xué)不再提供免費(fèi)便車(chē)。
- 關(guān)鍵字： 功率 動(dòng)態(tài)功率控制 EDA DVFS
基于自適應(yīng)DVFS的SoC低功耗技術(shù)研究
- 對(duì)便攜式系統(tǒng)設(shè)備而言，在采用目前90 nm和130 nm工藝進(jìn)行新的系統(tǒng)級(jí)芯片(SoC)設(shè)計(jì)中，對(duì)整個(gè)系統(tǒng)功耗的優(yōu)化變得與性能和面積的優(yōu)化同等重要。為此，簡(jiǎn)單介紹了涵蓋靜態(tài)功耗和動(dòng)態(tài)功耗的低功耗技術(shù)，同時(shí)提供了一種能夠通過(guò)使用前向預(yù)測(cè)反饋的動(dòng)態(tài)電壓頻率調(diào)節(jié)(DVFS)系統(tǒng)，并對(duì)該技術(shù)的可行性進(jìn)行了建模分析，驗(yàn)證了自適應(yīng)DVFlS方式的有效性，同時(shí)也給出了評(píng)估DVFS仿真的有效途徑。
- 關(guān)鍵字： DVFS SoC 低功耗 技術(shù)研究
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