eda設(shè)計(jì) 文章進(jìn)入eda設(shè)計(jì)技術(shù)社區(qū)

設(shè)計(jì)堅(jiān)固可靠系統(tǒng)的最佳實(shí)踐與注意事項(xiàng)

在現(xiàn)代電子設(shè)計(jì)中，如何在不增加產(chǎn)品成本的情況下，確保系統(tǒng)的堅(jiān)固性和可靠性是工程師們面臨的關(guān)鍵挑戰(zhàn)。無論是消費(fèi)電子產(chǎn)品，還是需要高可靠性的嵌入式系統(tǒng)，遵循最佳實(shí)踐并選擇合適的組件都能顯著延長設(shè)備的壽命并提高其性能。組件選擇的重要性在設(shè)計(jì)高可靠性的電子產(chǎn)品時(shí)，首要任務(wù)是選擇可靠的組件。電源晶體管和電容器往往是導(dǎo)致系統(tǒng)故障的主要組件，因此在選擇時(shí)需格外注意。淘汰不可靠的組件：電解電容器（EC）盡管便宜且廣泛使用，但它們?cè)谠S多系統(tǒng)中是最常見的故障源。相比之下，表面貼裝（SMT）多層陶瓷電容器（MLCCs）是一種
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EUV光刻機(jī)“忙瘋了”

據(jù)市場消息，目前，ASML High NA EUV光刻機(jī)僅有兩臺(tái)，如此限量版的EUV關(guān)鍵設(shè)備必然無法滿足市場對(duì)先進(jìn)制程芯片的需求，為此ASML布局步伐又邁一步。當(dāng)?shù)貢r(shí)間6月3日，全球最大的半導(dǎo)體設(shè)備制造商阿斯麥（ASML）宣布，攜手比利時(shí)微電子研究中心（IMEC），在荷蘭費(fèi)爾德霍芬（Veldhoven）開設(shè)聯(lián)合High-NA EUV光刻實(shí)驗(yàn)室（High NA EUV Lithography Lab），并由雙方共同運(yùn)營。推動(dòng)摩爾定律關(guān)鍵因素：High NA EUV技術(shù)據(jù)業(yè)界信息，High NA EUV技術(shù)是
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一款有趣的EDA設(shè)計(jì)應(yīng)用easyeda

最近發(fā)現(xiàn)個(gè)神奇的網(wǎng)站，可以在云端進(jìn)行硬件設(shè)計(jì)(畫原理圖、畫PCB圖、仿真)，而且還提供了制板廠家的網(wǎng)上下單接口，將設(shè)計(jì)直接外發(fā)打樣，非常方便。初步
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高壓靜電除塵器中振打控制電路的EDA設(shè)計(jì)

文中設(shè)計(jì)了一種新型電除塵器振打控制電路，利用EDA(電子設(shè)計(jì)自動(dòng)化)技術(shù)，采用先進(jìn)的VHDL硬件電路描述語言，使得盡管目標(biāo)系統(tǒng)是硬件，但整個(gè)系統(tǒng)的設(shè)計(jì)
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兩種EDA設(shè)計(jì)數(shù)據(jù)共性剖析與轉(zhuǎn)換

電子設(shè)計(jì)自動(dòng)化(EDA)設(shè)計(jì)軟件的不斷升級(jí)與創(chuàng)新，給從事電子電路設(shè)計(jì)行業(yè)的人們帶來了很多的方便與快捷然而，按照當(dāng)前電子產(chǎn)品組裝生產(chǎn)的傳統(tǒng)模式，每
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基于PADS軟件對(duì)高速電路的設(shè)計(jì)與實(shí)現(xiàn)

為了解決高速電路設(shè)計(jì)中的時(shí)序及信號(hào)完整性問題，結(jié)合PADS軟件的主要功能特點(diǎn)，以及高速電路設(shè)計(jì)的注意事項(xiàng)，以Hi3511模塊為例，介紹了使用PADS對(duì)布局
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【學(xué)霸帶節(jié)奏】教你DIY跳舞機(jī)器人之“上位機(jī)部分”

通過前兩周介紹的小π機(jī)器人硬件部分和軟件部分，你打造的小π機(jī)器人是否已經(jīng)可以運(yùn)動(dòng)起來了?這周小編將主要介紹小π機(jī)器人的上位機(jī)部分，讓你可以自由控制自己的小π。小π機(jī)器人的上位機(jī)部分分為電腦端的上位機(jī)軟件和手機(jī)端的APP。
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【學(xué)霸帶節(jié)奏】教你DIY跳舞機(jī)器人之“軟件部分”（連載中）

通過上周介紹的小π機(jī)器人硬件電路部分和3D打印部分，你是否已經(jīng)打造出一款屬于自己的小π機(jī)器人呢？這周小編將要給大家介紹小π機(jī)器人的軟件部分，讓屬于你自己的小π動(dòng)起來。
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【學(xué)霸帶節(jié)奏】教你DIY跳舞機(jī)器人之“硬件搭配”（連載中）

還記得上周小編給你們介紹的小π機(jī)器人嗎？這周小編將主要介紹小π機(jī)器人的制作流程，而且將詳細(xì)介紹3D打印和硬件電路的制作流程，幫助你打造屬于自己的小π。一、制作流程1、確定小π機(jī)器人功能要想打造屬于自己的小π機(jī)器人，首先要想好自己的小π機(jī)器人要實(shí)現(xiàn)什么功能。小π機(jī)器人的特色就是功能模塊化，用戶可以根據(jù)使用者自己的喜好更換，比如安裝超聲波探頭可以進(jìn)行手勢識(shí)別，安裝觸須可以觸摸互動(dòng)，安裝喇叭可以播放音樂，安裝RGB三色燈可以實(shí)現(xiàn)臉部變色，安裝溫度傳感器可以播報(bào)溫度等。2、3D打印外殼小π機(jī)器人的外殼使用3D打印
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【學(xué)霸帶節(jié)奏】教你DIY跳舞機(jī)器人

說起阿爾法機(jī)器人，大家應(yīng)該都不陌生，畢竟曾在16年春晚上大秀舞蹈，又在17年為王力宏的“AI愛”MV伴舞。但是你知道舞蹈機(jī)器人究竟是如何工作的嗎？你是否想過自己也可以DIY一個(gè)會(huì)跳舞的機(jī)器人呢？本欄目第一期為大家?guī)頃?huì)跳舞的機(jī)器人DIY攻略，在大神之路上為你助跑。此次曉宇同學(xué)和他的團(tuán)隊(duì)帶來的是一個(gè)取名叫“小π”的DIY舞蹈機(jī)器人，基本模型如下圖所示，不難看出，取名小π是因?yàn)檫@個(gè)小家伙的基礎(chǔ)模型酷似一個(gè)數(shù)學(xué)中的符號(hào)——π?？赡苣銜?huì)覺得小π略顯丑萌，不過自己DIY的機(jī)器人，雖然丑萌在所難免，但也會(huì)有諸多優(yōu)勢，
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加速時(shí)序簽收步伐，應(yīng)對(duì)復(fù)雜設(shè)計(jì)挑戰(zhàn)

目前，花費(fèi)在時(shí)序收斂與簽收(Timing closure and signoff)上的時(shí)間接近整個(gè)設(shè)計(jì)實(shí)現(xiàn)流程時(shí)間的40%，復(fù)雜設(shè)計(jì)對(duì)實(shí)現(xiàn)時(shí)序收斂提出了更高的要求。但在Cadence公司芯片實(shí)現(xiàn)之簽收與驗(yàn)證部門，公司副總裁Anirudh Devgan看來，傳統(tǒng)的簽收流程卻沒能跟上這種需求的步伐。為幫助系統(tǒng)級(jí)芯片(SoC)開發(fā)者加速時(shí)序收斂
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常用EDA設(shè)計(jì)與仿真軟件介紹

現(xiàn)在對(duì)EDA的概念或范疇用得很寬。包括在機(jī)械、電子、通信、航空航天、化工、礦產(chǎn)、生物、醫(yī)學(xué)、軍事等各個(gè) ...
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TRIVECTOR SERVICES 使用 MATHWORKS 產(chǎn)品驗(yàn)證 ARES I 火箭的時(shí)間延遲

　　MathWorks 日前宣布 TriVector Services 通過采用基于模型的設(shè)計(jì)，將美國航天總署 (NASA) Ares I 火箭通訊總線設(shè)計(jì)的驗(yàn)證時(shí)間縮短了一年多。TriVector 使用 MathWorks 產(chǎn)品建立系統(tǒng)模型，以用作整個(gè)開發(fā)過程中的可執(zhí)行規(guī)范。該模型用于在硬件開發(fā)之前分析時(shí)序性能和驗(yàn)證系統(tǒng)要求，從而將時(shí)序分析的總體任務(wù)時(shí)長減少 60%。　　TriVector 工程師們使用 Simulink、Stateflow 和 SimEvents 來開發(fā) Ares I 內(nèi)部通訊系統(tǒng)
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AVL 使用 MATHWORKS 工具開發(fā)燃燒控制器

　　MathWorks 今天宣布，從事動(dòng)力總成系統(tǒng)開發(fā)的，全球規(guī)模最大的私營公司，AVL LIST GmbH 運(yùn)用基于模型的設(shè)計(jì)開發(fā)出了一種實(shí)時(shí)燃燒控制器。與手寫代碼方式相比，AVL 借助 MathWorks 工具大約縮短了 50% 的開發(fā)時(shí)間。　　發(fā)動(dòng)機(jī)標(biāo)定是指對(duì)發(fā)動(dòng)機(jī)進(jìn)行控制，使其達(dá)到最佳的燃燒工況。傳統(tǒng)方法是在試驗(yàn)臺(tái)架上運(yùn)轉(zhuǎn)發(fā)動(dòng)機(jī)，進(jìn)行反復(fù)試驗(yàn)，這是一個(gè)非常緩慢的過程。為了解決這一難題，AVL 開發(fā)出一種新型燃燒控制器，可以極大縮短發(fā)動(dòng)機(jī)標(biāo)定團(tuán)隊(duì)在試驗(yàn)臺(tái)架上的測試時(shí)間。AVL 采用 Simuli
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Cadence推出驗(yàn)證計(jì)算平臺(tái)加快系統(tǒng)開發(fā)時(shí)間并提高其質(zhì)量

　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司今天公布了第一款全集成高性能驗(yàn)證計(jì)算平臺(tái)，稱為Palladium XP，它在一個(gè)統(tǒng)一的驗(yàn)證環(huán)境中綜合了模擬(Simulation)、加速(Acceleration)與仿真(Emulation)。這種高度可擴(kuò)展的Palladium XP驗(yàn)證計(jì)算平臺(tái)是為了支持下一代設(shè)計(jì)而開發(fā)的，讓設(shè)計(jì)與驗(yàn)證團(tuán)隊(duì)能夠更快地完善他們的軟硬件環(huán)境，在更短的時(shí)間內(nèi)生產(chǎn)出更高質(zhì)量的嵌入式系統(tǒng)。　　Cadence® Palladium® XP 最高支持20億門的設(shè)
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第五講：Zynq平臺(tái)設(shè)計(jì)學(xué)方法II
第四講：Xilinx可擴(kuò)展處理平臺(tái)導(dǎo)論（Zynq-7000）及設(shè)計(jì)方法

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