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基于HyperLynx的高速PECL交流耦合時鐘
- 隨著電子技術(shù)的不斷發(fā)展，數(shù)據(jù)的傳輸速度越來越快，高速時鐘的應(yīng)用日益廣泛，如何保證時鐘在高速跳變過程中的信號完整性、抖動、功耗等問題，已逐漸成為關(guān)注的問題。傳統(tǒng)的時鐘設(shè)計方法大多依靠經(jīng)驗和理論計算，但是隨著時鐘頻率越來越高，時鐘的電磁環(huán)境日趨復(fù)雜，時鐘的傳輸線效應(yīng)、過沖／欠沖、反射、振鈴效應(yīng)、趨膚效應(yīng)都成為影響時鐘設(shè)計的關(guān)鍵因素，只有使用現(xiàn)代科技手段，利用計算機的強大計算能力進行仿真才能夠保證時鐘電路設(shè)計成功。 HyperLynx是Mentor(Graphics開發(fā)的一款板級信號完整性的仿真工具。它可以進行
- 關(guān)鍵字： HyperLynx PECL 交流耦合 時鐘
高速數(shù)字電路的設(shè)計與仿真
- 摘要：介紹了專用于高速數(shù)字電路的仿真工具Hyperlynx，并使用它對高速數(shù)字電路中的阻抗匹配、傳輸線長度與串擾問題進行布線前的模型建立和仿真，通過仿真結(jié)果分析給出了相應(yīng)解決辦法，尤其在傳輸線長度上提供了LVDS電路的解決辦法。通過軟件平臺對電路參數(shù)的設(shè)置進行比較與分析，給出了高速數(shù)字電路設(shè)計的指導(dǎo)性結(jié)論。 關(guān)鍵詞：信號完整性；高速電路；PCB；Hyperlynx，IBIS 高速數(shù)字系統(tǒng)設(shè)計成功的關(guān)鍵在于保持信號的完整，而影響信號完整性(即信號質(zhì)量)的因素主
- 關(guān)鍵字： 設(shè)計 仿真 Hyperlynx 信號完整性 高速電路 PCB IC電路板測試 PCB
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