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全新EDK8.1簡(jiǎn)化嵌入式設(shè)計(jì)
- Platform Studio增強(qiáng)功能使處理器系統(tǒng)開發(fā)變得更輕松
- 關(guān)鍵字： Xilinx PlatformStudio EDK IDE PowerPC FPGA OPB PLB MicroBlaze
FSL總線IP核及其在MicoBlaze系統(tǒng)中的應(yīng)用
- 引 言 隨著半導(dǎo)體制造工藝的發(fā)展，以FPGA(現(xiàn)場(chǎng)可編程門陣列)為代表的新一代可編程邏輯器件(PLD)的邏輯資源密度不斷增加，使得可編程技術(shù)很自然地就與系統(tǒng)芯片集成技術(shù)(SoC)的結(jié)合日益緊密，并逐步成為可配置平臺(tái)技術(shù)(configurable platform)的主流。 目前，各主要PLD廠商基于FPGA的可配置平臺(tái)雖然大都采用“微處理器十可編程邏輯”的架構(gòu)，但在開發(fā)基于FPGA的嵌入式系統(tǒng)時(shí)，卻采用了各自不同的方式來整合處理器系統(tǒng)與片上的其他邏輯資源(大多數(shù)以用
- 關(guān)鍵字： IP核 FSL MicoBlaze FPGA RISC OPB LMB
基于FSL總線的UART外設(shè)IP核設(shè)計(jì)
- 引 言 在基于MicroBlaze的SOPC系統(tǒng)中，將用戶IP核整合到基于MicroBlaze的嵌入式軟核處理器系統(tǒng)中，通常有兩種方法：一種是將IP核連接到OPB總線；另一種是將用戶IP連接到MicroBlaze專用的FSL總線上。盡管OPB和FSL總線都是MicroBlaze軟核與FPGA其他片上邏輯資源連接的主要途徑，但它們的分工足不同的。OPB總線適用于將要求低速和低性能的設(shè)備連接到MicroBlaze系統(tǒng)中；而FSL總線則適用于將對(duì)時(shí)間要求高的用戶自定義IP核，整合到基于MicroBla
- 關(guān)鍵字： FSL UART IP核 SOPC OPB MicroBlaze
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