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燦芯半導體與成都納能、PLDA合作推出PCIe 2.0/3.0完整解決方案
- 國際領(lǐng)先的定制化芯片(ASIC)設(shè)計方案提供商及DDR控制器和物理層IP供應(yīng)商——燦芯半導體(上海)有限公司(以下簡稱“燦芯半導體”)對外宣布與成都納能、PLDA合作，推出基于中芯國際40nm和55nm工藝技術(shù)的PCIe 2.0/3.0完整解決方案。 “納能與燦芯半導體合作，提供基于中芯國際40nm和55nm的PCIe 2.0/3.0解決方案，滿足最新的PIPE規(guī)范，支持2.5G、5G數(shù)據(jù)率，功耗低、面積小，可以有效降低SoC設(shè)計風險和成本，”成都納能首席執(zhí)行官武國勝說，“我們期待著與燦芯半
- 關(guān)鍵字： 燦芯 PLDA
PLDA 與創(chuàng)意電子連手推出臺積電 16 奈米 FinFET Plus PCI Express Gen 4 解決方案
- PCI Express® 控制器IP解決方案領(lǐng)導者 PLDA 與彈性客制化 IC 領(lǐng)導廠商 (Flexible ASIC Leader™) 創(chuàng)意電子 (GUC) 合作，推出臺積電 (TSMC) 16 奈米 FinFET Plus (16FF+) 制程的完整 PCIe Gen 4 解決方案。全新的 PCIe Gen 4 IP可立即授權(quán)予系統(tǒng)單芯片 (SoC) 公司與系統(tǒng)制造商，有效滿足 PCIe 4.0 應(yīng)用在大量數(shù)據(jù)傳輸、低延遲與低功耗上的各種需求。除IP之外，測試芯片目前也已開始
- 關(guān)鍵字： PLDA 臺積電
Altera和PLDA宣布為廣播市場提供音頻解決方案
- Altera和PLDA SAS宣布繼續(xù)擴大合作，為專業(yè)音頻/視頻廣播市場提供靈活的解決方案。此次合作首先推出了新的知識產(chǎn)權(quán)(IP)內(nèi)核系列，以及音頻采樣轉(zhuǎn)換器(SRC)，并為Altera Stratix®和Cyclone® FPGA產(chǎn)品系列的認證客戶提供免費的IP許可。 SRC內(nèi)核 SRC內(nèi)核具有很強的配置能力，能夠處理8對立體聲信號，轉(zhuǎn)換并同步32 kHz和96 kHz之間的大部分組合采樣率。更新后的版本可支持192 kHz采樣率的輸入和輸出采樣，計劃于2007年10月推
- 關(guān)鍵字： Altera PLDA 音視頻技術(shù)
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