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基于Verilog的多路相干DDS信號源設(shè)計
- 摘要：傳統(tǒng)的多路同步信號源常采用單片機(jī)搭載多片專用DDS芯片配合實(shí)現(xiàn)。該技術(shù)實(shí)現(xiàn)復(fù)雜，且在要求各路同步相干可控時難以實(shí)現(xiàn)。本文在介紹了DDS原理的基礎(chǔ)上，給出了用Verilog_HDL語言實(shí)現(xiàn)相干多路DDS的工作原理、設(shè)
- 關(guān)鍵字： DDS 現(xiàn)場可編程門陣列(FPGA) 相位累加器 Verilog_HDL
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