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32位嵌入式CPU中系統(tǒng)控制協(xié)處理器的設(shè)計
- MIPS體系結(jié)構(gòu)中的系統(tǒng)控制協(xié)處理器簡稱CP0，它提供指令正常執(zhí)行所需的環(huán)境，進行異常/中斷處理、高速緩存填充、虛實地址轉(zhuǎn)換、操作模式轉(zhuǎn)換等操作。單從硬件的角度而言，系統(tǒng)控制協(xié)處理器對指令集的作用就相當(dāng)于操作系統(tǒng)對應(yīng)用程序的作用一樣。 異常處理 CPU運行過程中常常需要中斷正常執(zhí)行的指令流程，跳轉(zhuǎn)去執(zhí)行某段特殊的指令段，接著再恢復(fù)原來的指令序列。MIPS體系結(jié)構(gòu)中稱這樣的過程為異常(Exception)。所有的異常都采用統(tǒng)一的機制處理。 對于異常情況，需要采取以下3方面的措施：
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基于ARM的MPEG4視頻解碼器
- 摘 要 詳細(xì)闡述了針對ARM平臺的MPEG4視頻解碼算法的優(yōu)化方法。實驗數(shù)據(jù)表明，優(yōu)化后的解碼器性能得到了全面提升。還結(jié)合ARM7TDMI的Easy ARM2200開發(fā)平臺,給出了嵌入式MPEG-4視頻解碼的實時實現(xiàn)。關(guān)鍵詞 ARM，MPEG4，嵌入系統(tǒng)，視頻解碼器 1 引 言 本文旨在研究基于ARM微處理器的MPEG-4視頻解碼技術(shù)，主要應(yīng)用在手持移動設(shè)備中。利用嵌入式系統(tǒng)實現(xiàn)MPEG-4視頻解碼，處
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多核與多執(zhí)行緒的嵌入式系統(tǒng)解決方案
- 在嵌入式裝置中建置多核心（包含同質(zhì)或異質(zhì)）以及多執(zhí)行緒技術(shù)，的確能帶來諸多效益，尤其是改進系統(tǒng)效能方面最為明顯。 盡管RISC嵌入式技術(shù)所面臨的挑戰(zhàn)越來越多，但是在維持以往嵌入式軟件資源兼容性的前提之下，能夠改善其未來適用性，并且有效提升新系統(tǒng)的效能表現(xiàn)，使其不失為良好的解決方案。 應(yīng)用決定多核或多緒 多核心與多執(zhí)行緒在效能表現(xiàn)上有其幫助，但是效能與這些技術(shù)的內(nèi)建其實并沒有絕對關(guān)系，會造成這樣的原因主要是應(yīng)用環(huán)境的需求。以手機為例，整合于手機內(nèi)的SoC芯片雖然是屬于多核心架構(gòu)的一環(huán)，但
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嵌入式系統(tǒng)中“軟外設(shè)”的研究
- 隨著CPU的性能的不斷提升，處理速度越來越快，運算能力不斷增強，在許多嵌入式系統(tǒng)的開發(fā)中逐漸出現(xiàn)了軟外設(shè)（Software Peripherals）。所謂軟外設(shè)是指以軟件編程為手段，模擬CPU的外圍設(shè)備的功能，真正達(dá)到以軟代硬的目的。軟外設(shè)的出現(xiàn)給產(chǎn)品的開發(fā)帶來了極大的靈活性，不但使系統(tǒng)體積變得更小，而且使系統(tǒng)的升級換代變得更為方便，從而真正實現(xiàn)SOC。 本文介紹軟外設(shè)的設(shè)計思想以及在開發(fā)過程中應(yīng)注意的事項，并結(jié)合一個嵌入式系統(tǒng)，分析軟外設(shè)對系統(tǒng)的影響以及如何使設(shè)計合理化。 一 介紹
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擴大ARM SoC的驗證覆蓋縮短仿真時間
- 驗證復(fù)雜的SoC設(shè)計要耗費極大的成本和時間。據(jù)證實，驗證一個設(shè)計所需的時間會隨著設(shè)計大小的增加而成倍增加。在過去的幾年中，出現(xiàn)了很多的技術(shù)和工具，使驗證工程師可以用它們來處理這類問題。但是，這些技術(shù)中很多基于動態(tài)仿真，并依靠電路操作來發(fā)現(xiàn)設(shè)計問題，因此設(shè)計者仍面臨為設(shè)計創(chuàng)建激勵的問題。 設(shè)計者可以使用運行在處理器上的固件作為驗證仿真激勵的一部分，這也是目前通常采用的方法----使用全功能處理器模型。與在HDL中編寫激勵相比，固件作為激勵速度更快，并且更容易創(chuàng)建
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ARM基礎(chǔ)知識連載（1）
- ARM處理器共有37個寄存器。其中包括： **31個通用寄存器，包括程序計數(shù)器（PC）在內(nèi)。這些寄存器都是32位寄存器。 **6個狀態(tài)寄存器。這些寄存器都是32位寄存器。 ARM處理器共有7種不同的處理器模式，每一種模式中都有一組相應(yīng)的寄存器組。在任何時刻，可見的寄存器包括15個通用寄存器（R0-R14）,一個或兩個狀態(tài)寄存器及程序計數(shù)器（PC）。在所有的寄存器中，有些是各模式公用一個物理寄存器，有一些寄存器各模式擁有自己獨立的物理寄存器。 ****************************
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ARM基礎(chǔ)知識連載（2）
- *************************************************************** 程序狀態(tài)寄存器 ***************************************************************CPSR(當(dāng)前程序狀態(tài)寄存器)在任何處理器模式下被訪問。它包含了條件標(biāo)志位、中斷禁止位、當(dāng)前處理器模式標(biāo)志以及其他的一些控制和狀態(tài)位。每一種處理器 模式下都有一個專用的物理狀態(tài)寄存器，稱為SPSR（備份程序狀態(tài)寄存器）。當(dāng)特定的異常中
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ARM基礎(chǔ)知識連載（3）
- 在ARM體系中通常有以下3種方式控制程序的執(zhí)行流程： **在正常執(zhí)行過程中，每執(zhí)行一條ARM指令，程序計數(shù)器(PC)的值加4個字節(jié)；每執(zhí)行一條Thumb指令，程序計數(shù)器寄存器(PC)加2個字節(jié)。整個過程是按順序執(zhí)行 。 **跳轉(zhuǎn)指令，程序可以跳轉(zhuǎn)到特定的地址標(biāo)號處執(zhí)行，或者跳轉(zhuǎn)到特定的子程序處執(zhí)行。其中,B指令用于執(zhí)行跳轉(zhuǎn)操作；BL指令在執(zhí)行跳轉(zhuǎn)操作同時，保存子程 序的返回地址；BX指令在執(zhí)行跳轉(zhuǎn)操作同時，根據(jù)目標(biāo)地址為可以將程序切換到Thumb狀態(tài)；BLX指令執(zhí)行3個操作，跳轉(zhuǎn)到目標(biāo)地址處執(zhí)行，
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ARM基礎(chǔ)知識連載（5）
- ************************************************************* ARM編譯器支持的數(shù)據(jù)類型 ************************************************************數(shù)據(jù)類型 長度（位） 對齊特性Char 8 &n
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ARM基礎(chǔ)知識連載（4）
- 在應(yīng)用程序中安裝異常中斷處理程序1.使用跳轉(zhuǎn)指令：可以在異常中斷對應(yīng)異常向量表中特定位置放置一條跳轉(zhuǎn)指令，直接跳轉(zhuǎn)到該異常中斷的處理程序。這種方法有一個缺點，即只能在32M空間范圍內(nèi)跳轉(zhuǎn)。2.使用數(shù)據(jù)讀取指令LDR：使用數(shù)據(jù)讀取指令LDR向程序計數(shù)器PC中直接賦值。這種方法分為兩步：先將異常中斷處理程序的絕對地址存放在存放在距離向量表4KB范圍內(nèi)的一個存儲單元中；再使用數(shù)據(jù)讀取指令LDR將該單元的內(nèi)容讀取到程序計數(shù)器PC中。 **在系統(tǒng)復(fù)位時安裝異常中斷處理程序**1.地址0x00處為ROM的情況&n
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