arm+fpga 文章 進入arm+fpga技術(shù)社區(qū)
使用ARM標準C庫進行嵌入式應(yīng)用程序開發(fā)
- 引 言 隨著對高處理能力、實時多任務(wù)、超低功耗等方面需求的增長，高端嵌入式處理器已經(jīng)進入了國內(nèi)開發(fā)人員的視野，并在國內(nèi)得到了普遍的重視和應(yīng)用。ARM是目前嵌入式領(lǐng)域應(yīng)用最廣泛的RISC微處理器結(jié)構(gòu)，憑借低成本、低功耗、高性能等優(yōu)點占據(jù)了嵌入式系統(tǒng)應(yīng)用領(lǐng)域的領(lǐng)先地位。ADS是ARM公司推出的ARM集成開發(fā)環(huán)境，提供了對C和C++的支持，是目前開發(fā)ARM的主要工具。本文針對日益縮短的嵌入式開發(fā)周期，結(jié)合ARM系統(tǒng)開發(fā)調(diào)試經(jīng)驗，對使用ARM標準庫進行應(yīng)用程序開發(fā)作了比較系統(tǒng)的分析。 1
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FPGA與DS18B20型溫度傳感器通信的實現(xiàn)
- DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測溫分辨率可達0.0625℃，被測溫度用符號擴展的16位數(shù)字量方式串行輸出。 一線式(1-WIRE)串行總線是利用1條信號線就可以與總線上若干器件進行通信。具體應(yīng)用中可以利用微處理器的I/O端口對DS18B20直接進行通信，也可以通過現(xiàn)場可編程門陣列(FPGA)等可編程邏輯器件(PLD)實現(xiàn)對1-WIRE器件的通信。
- 關(guān)鍵字： DS18B20 FPGA 傳感器 單片機 嵌入式系統(tǒng)
ARM發(fā)布07年第一季度未審計財報
- 近日，英國ARM公司（倫敦證交所：ARM；納斯達克：ARMHY）公布了截止至2007年3月31日的2007年第一季度未審計財務(wù)報告，報告顯示第一季度公司營業(yè)收入達到6650萬英鎊，以美元結(jié)算營業(yè)收入達到1.292億美元，比去年同期分別增長了3%和14%。由于美元對英鎊匯率的下跌（2007年第一季度1.94美元兌1英鎊，2006年第一季度1.75美元兌1英鎊），依照2006年第一季度的實際匯率，2007年第一季度英鎊營業(yè)收入將達到7400萬英鎊。 第一季度公司授權(quán)業(yè)務(wù)的營業(yè)收入達到5430萬美元，
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基于IP核的FPGA設(shè)計方法
- 前 言 幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計能力跟不上制造能力的矛盾也日益突出。現(xiàn)在設(shè)計人員已不必全部用邏輯門去設(shè)計ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計,ASIC 設(shè)計人員可以應(yīng)用等
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ARM是什么?
- 如果說，“嵌入式”是2001年電子工程師談?wù)摰米疃嗟脑~之一，2002年談?wù)摰米疃嗟囊粋€詞就是“ARM”。究竟什么是ARM呢，他是英國一家電子公司的名字，全名的意思是Advanced RISC Machine。該公司成立于1990年11月，是蘋果電腦，Acorn電腦集團和VLSI Technology的合資企業(yè)。Acorn曾推出世界上首個商用單芯片RISC處理器，而蘋果電腦當時希望將RISC技術(shù)應(yīng)用于自身系統(tǒng)，ARM微處理器新標準因此應(yīng)運而生。 &nbs
- 關(guān)鍵字： ARM
基于并行流水線結(jié)構(gòu)的可重配FIR濾波器的FPGA實現(xiàn)
- 1 并行流水結(jié)構(gòu)FIR的原理 在用FPGA或?qū)Ｓ眉呻娐穼崿F(xiàn)數(shù)字信號處理算法時，計算速度和芯片面積是兩個相互制約的主要問題。實際應(yīng)用FIR濾波器時，要獲得良好的濾波效果，濾波器的階數(shù)可能會顯著增加，有時可能會多達幾百階。因此，有必要在性能和實現(xiàn)復(fù)雜性之間做出選擇，也就是選擇不同的濾波器實現(xiàn)結(jié)構(gòu)。這里運用并行流水線結(jié)構(gòu)來實現(xiàn)速度和硬件面積之間的互換和折衷。 在關(guān)鍵路徑插入寄存器的流水線結(jié)構(gòu)是提高系統(tǒng)吞吐率的一項強大的實現(xiàn)技術(shù)，并且不需要大量重復(fù)設(shè)置硬件。流水線的類型主要分為兩種：算術(shù)流水線和指令流水線
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USB海量存儲類設(shè)備功能在ARM系統(tǒng)中的應(yīng)用
- 技術(shù)發(fā)展到今天的信息時代，數(shù)據(jù)的存儲和傳輸在嵌入式系統(tǒng)有了越來越重要的地位。而USB是目前設(shè)計成熟、應(yīng)用廣泛且使用極為簡捷的技術(shù)，USB傳輸是一種高效方便的數(shù)據(jù)傳輸方式。 基于上述原因，本文重點論述基于USB的海量存儲(USB Mass Storage)設(shè)備功能在ARM嵌入式系統(tǒng)中設(shè)計和應(yīng)用。使用該設(shè)備功能，上位機可以像讀寫普通U盤一樣對于系統(tǒng)采集并存儲在FLASH中的數(shù)據(jù)進行讀寫。 1 硬件方案 l.1 器件簡介 S3C44B0X[1]是SAMSUNG公司出品的基于ARM7T
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FPGA設(shè)計的驗證技術(shù)及應(yīng)用原則
- FPGA設(shè)計和驗證工程師當今面臨的最大挑戰(zhàn)之一是時間和資源制約。隨著FPGA在速度、密度和復(fù)雜性方面的增加，完成一個完整時序驗證對人力和計算機處理器、存儲器提出了更多更高的要求。 隨著FPGA器件體積和復(fù)雜性的不斷增加，設(shè)計工程師越來越需要有效的驗證方。時序仿真可以是一種能發(fā)現(xiàn)最多問題的驗證方法，但對許多設(shè)計來說，它常常是最困難和費時的方法之一。過去，采用標準臺式計算機的時序仿真是以小時或分鐘計算的，但現(xiàn)在對某些項目來說，在要求采用高性能64位服務(wù)器的情況下，其測試時間卻要幾天甚至幾周。這樣，這種
- 關(guān)鍵字： FPGA 驗證
基于ARM的FPGA加載配置實現(xiàn)
- 引言 基于SRAM工藝FPGA在每次上電后需要進行配置，通常情況下FPGA的配置文件由片外專用的EPROM來加載。這種傳統(tǒng)配置方式是在FPGA的功能相對穩(wěn)定的情況下采用的。在系統(tǒng)設(shè)計要求配置速度高、容量大、以及遠程升級時，這種方法就顯得很不實際也不方便。本文介紹了通過ＡＲＭ對可編程器件進行配置的的設(shè)計和實現(xiàn)。 1 配置原理與方式 1.1 配置原理 在FPGA正常工作時，配置數(shù)據(jù)存儲在SRAM單元中，這個SRAM單元也被稱為配置存儲（Configuration RAM）。由于SRAM是易失性的存
- 關(guān)鍵字： ARM FPGA 單片機 配置 嵌入式系統(tǒng)
基于SYSTEM C的FPGA設(shè)計方法
- 一、概述 隨著VLSI的集成度越來越高，設(shè)計也越趨復(fù)雜。一個系統(tǒng)的設(shè)計往往不僅需要硬件設(shè)計人員的參與，也需要有軟件設(shè)計人員的參與。軟件設(shè)計人員與硬件設(shè)計人員之間的相互協(xié)調(diào)就變的格外重要，它直接關(guān)系到工作的效率以及整個系統(tǒng)設(shè)計的成敗。傳統(tǒng)的設(shè)計方法沒有使軟件設(shè)計工作與硬件設(shè)計工作協(xié)調(diào)一致，而是將兩者的工作割裂開來。軟件算法的設(shè)計人員在系統(tǒng)設(shè)計后期不能為硬件設(shè)計人員的設(shè)計提供任何的幫助。同時現(xiàn)在有些大規(guī)模集成電路設(shè)計中往往帶有DSP Core或其它CPU Core。這些都使得單
- 關(guān)鍵字： C FPGA SYSTEM 單片機 嵌入式系統(tǒng)
基于ARM智能交通信號機控制板開發(fā)
- 信號機是一個典刑的嵌入式系統(tǒng)，嵌入式系統(tǒng)是以應(yīng)用為中心來設(shè)計，對功能、性能、可靠性、成本、功耗、體積等有嚴格的要求，既要滿足智能交通系統(tǒng)對信號機智能化、多功能的要求，又要最大化信號機的性價比，因此本設(shè)計選擇基于ARM核的32位嵌入式RISC處理器——AT91RM9200來完成智能交通信號機控制板的硬件設(shè)計，以達到使信號機在交通系統(tǒng)中成為收集與處理交通流量數(shù)據(jù)、通信聯(lián)網(wǎng)以及區(qū)域協(xié)調(diào)控制平臺的設(shè)計目標。 1 引言 &
- 關(guān)鍵字： ARM 交通信號
基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計
- 介紹了一種基于DSP+FPGA結(jié)構(gòu)的小波圖像處理系統(tǒng)設(shè)計方案，以高性能數(shù)字信號處理器ADSP—BF535作為核心，結(jié)合現(xiàn)場可編程門陣列FPGA，實現(xiàn)了實時數(shù)字圖像處理。 小波分析是近年迅速發(fā)展起來的新興學(xué)科，與Fourier分析和Gabor變換相比，小波變換是時間(空間)頻率的局部化分析，它通過伸縮平移運算對信號逐步進行多尺度細化，最終達到高頻處時間細分和低頻處頻率細分，能自動適應(yīng)時頻信號分析的要求，從而可聚焦到信號的任意細節(jié)．解決了Fourier分
- 關(guān)鍵字： DSP FPGA 小波圖像處理
FPGA在智能儀表中的應(yīng)用
- 隨著微電子技術(shù)的發(fā)展，采用現(xiàn)場可編程門陣列(FPGA)進行數(shù)字信號處理得到了飛速發(fā)展。由于FPGA具有現(xiàn)場可編程的特點，可以實現(xiàn)專用集成電路，因此越來越受到硬件電路設(shè)計工程師們的青睞。 目前，在自動化監(jiān)測與控制儀器和裝置中，大多以8位或16位MCU為核心部件。然而伴隨著生產(chǎn)技術(shù)的進步和發(fā)展，對監(jiān)測與控制的要求也在不斷提高，面對日益復(fù)雜的監(jiān)測對象和控制算法，傳統(tǒng)的MCU往往不堪重負。把FPGA運用到這些儀表和設(shè)備中，可以減少這些儀器、設(shè)備的開發(fā)周期，大幅度提升這些儀器的性能，減少總成本和體積。 在低阻值
- 關(guān)鍵字： FPGA) 測量 測試 單片機 嵌入式系統(tǒng) 智能儀表
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