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FPGA/CPLD設(shè)計(jì)思想與技巧簡介
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- FPGA/CPLD設(shè)計(jì)思想與技巧簡介,本文討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧:乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化,都是FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn),合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作中取得事半功倍的效果?!
- 關(guān)鍵字: 簡介 技巧 設(shè)計(jì)思想 FPGA/CPLD
基于FPGA的高精度時(shí)間數(shù)字轉(zhuǎn)換電路設(shè)計(jì)
- 摘要:本文介紹一種基于 FPGA高精度時(shí)間數(shù)字轉(zhuǎn)換電路的設(shè)計(jì)方法,利用片內(nèi)鎖相環(huán)(PLL)和環(huán)形移位寄存器,采用不高的系統(tǒng)時(shí)鐘便可得到很高的時(shí)間分辨率,且占用較少邏輯資源??勺鳛楣δ茈娐藩?dú)立使用,也可作為 IP核
- 關(guān)鍵字: FPGA 高精度 電路設(shè)計(jì) 數(shù)字轉(zhuǎn)換
DARPA授權(quán)RF-FPGA項(xiàng)目合同 開發(fā)可編程射頻前端技術(shù)
- ? 美國國防預(yù)先研究計(jì)劃局射頻和微波技術(shù)專家正在與6家國防企業(yè)和大學(xué)合作,開發(fā)可編程射頻前端元件,以減少軍事通信、電子戰(zhàn)和信號(hào)情報(bào)系統(tǒng)(SIGINT)的成本和開發(fā)時(shí)間。 迄今為止,DARPA授權(quán)了6份關(guān)于“現(xiàn)場(chǎng)可編程門陣列射頻技術(shù)(RF-FPGA)”項(xiàng)目的合同。該項(xiàng)目旨在通過收發(fā)器鏈編程,跨不同應(yīng)用程序重復(fù)使用同一組射頻前端元件。從根本上講, RF-FPGA項(xiàng)目試圖將現(xiàn)場(chǎng)可編程門陣列(FPGA)在數(shù)字計(jì)算方面的成功應(yīng)用經(jīng)驗(yàn)轉(zhuǎn)移到射頻和微波技術(shù),從而在廣泛應(yīng)用中減少
- 關(guān)鍵字: DARPA FPGA
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