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一款用DSP+FPGA實(shí)現(xiàn)的數(shù)字相關(guān)器
- 引 言數(shù)字相關(guān)器作為軟件無(wú)線電的典型應(yīng)用,在擴(kuò)頻通信中成為必不可少的技術(shù)。在傳統(tǒng)的擴(kuò)頻通信中,采用模擬器件(如:聲表面波器) 來(lái)實(shí)現(xiàn)解擴(kuò)單元,而用數(shù)字相關(guān)器可以增加系統(tǒng)的靈活性和穩(wěn)定性,因此,對(duì)數(shù)字相關(guān)器
- 關(guān)鍵字: 相關(guān) 數(shù)字 實(shí)現(xiàn) FPGA DSP
Altera演示第一款基于模型的FPGA浮點(diǎn)DSP工具
- Altera公司日前演示了使用FPGA的浮點(diǎn)DSP新設(shè)計(jì)流程,這是業(yè)界第一款基于模型的浮點(diǎn)設(shè)計(jì)工具,支持在FPGA中實(shí)現(xiàn)復(fù)數(shù)浮點(diǎn)DSP算法。伯克萊設(shè)計(jì)技術(shù)公司 (Berkeley Design Technology, Inc, BDTI) 進(jìn)行的獨(dú)立分析驗(yàn)證了能夠在Altera 的Stratix 和Arria FPGA系列中簡(jiǎn)單方便的高效實(shí)現(xiàn)高性能浮點(diǎn)DSP設(shè)計(jì)。
- 關(guān)鍵字: Altera FPGA
基于FPGA的存儲(chǔ)測(cè)試系統(tǒng)的設(shè)計(jì)
- 摘要:針對(duì)某些特殊的測(cè)試試驗(yàn)要求測(cè)試系統(tǒng)高性能、微體積、低功耗,在存儲(chǔ)測(cè)試?yán)碚摶A(chǔ)上,進(jìn)行了動(dòng)態(tài)存儲(chǔ)測(cè)試系統(tǒng)的FPGA設(shè)計(jì)。介紹了該系統(tǒng)的組成,對(duì)控制模塊進(jìn)行了詳細(xì)設(shè)計(jì)。針對(duì)測(cè)試環(huán)境的多樣性設(shè)計(jì)了采樣策略
- 關(guān)鍵字: FPGA 存儲(chǔ)測(cè)試 系統(tǒng)
基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 摘要:為了在提高數(shù)據(jù)采集卡的速度的同時(shí)降低成本,設(shè)計(jì)了一種應(yīng)用流水線存儲(chǔ)技術(shù)的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)應(yīng)用軟件與硬件相結(jié)合的方式來(lái)控制實(shí)現(xiàn),通過(guò)MAX1308模數(shù)轉(zhuǎn)換器完成ADC的轉(zhuǎn)化過(guò)程,采用多片Nandflash流水線
- 關(guān)鍵字: FPGA 高速數(shù)據(jù) 采集 系統(tǒng)設(shè)計(jì)
基于FPGA的SoC驗(yàn)證平臺(tái)實(shí)現(xiàn)電路仿真?zhèn)慑e(cuò)
- 基于FPGA的SoC驗(yàn)證平臺(tái)實(shí)現(xiàn)電路仿真?zhèn)慑e(cuò),臺(tái)灣工業(yè)技術(shù)研究院提出一種能夠顯著提升客制化FPGA原型板驗(yàn)證效率的創(chuàng)新方法,自動(dòng)化現(xiàn)有的電路仿真(in-circuit emulation)偵錯(cuò)功能,并提供更高的FPGA能見(jiàn)度。這個(gè)以FPGA為基礎(chǔ)的SoC驗(yàn)證平臺(tái)對(duì)工研院而言是前景看好
- 關(guān)鍵字: 實(shí)現(xiàn) 電路 仿真 平臺(tái) 驗(yàn)證 FPGA SoC 基于
FPGA芯片結(jié)構(gòu)分析
- FPGA芯片結(jié)構(gòu)分析,目前主流的FPGA仍是基于查找表技術(shù)的,已經(jīng)遠(yuǎn)遠(yuǎn)超出了先前版本的基本性能,并且整合了常用功能(如RAM、時(shí)鐘管理和DSP)的硬核(ASIC型)模塊。如圖1-1所示(注:圖1-1只是一個(gè)示意圖,實(shí)際上每一個(gè)系列的FPGA都有其相應(yīng)的
- 關(guān)鍵字: 分析 結(jié)構(gòu) 芯片 FPGA
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