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	cadence?virtuoso?
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          二代提速硬件仿真 關(guān)注功耗/速度優(yōu)勢IP公司
          
                                                            
            
                    	
          • 　　Cadence CDNLive上海站，廠商聊的最多的，大家最想了解的，自然是剛剛在北京首發(fā)的Palladium XP II驗證平臺和系統(tǒng)開發(fā)增強套件。作為Palladium XP仿真系統(tǒng)的更新產(chǎn)品，二代產(chǎn)品最多可以將驗證性能再提高50%，更將其業(yè)界領(lǐng)先的容量擴展至23億門。而Cadence也是首次在美國以外推出新品發(fā)布，其中包含的種種深意，也是值得好好探究一番……

　　硬件仿真平臺發(fā)展的深意

　　隨著芯片設(shè)計的復(fù)雜度越來越高，驗證工程師已經(jīng)不能高效地使用傳統(tǒng)RT
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          • 關(guān)鍵字：
                        Cadence  IP                          
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          Cadence宣布提供業(yè)界首款HDMI 2.0驗證IP
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(納斯達(dá)克股票代碼：CDNS)日前宣布可提供業(yè)界首款支持全新HDMI 2.0規(guī)范的驗證IP(VIP)。這款VIP使設(shè)計師們可以快速徹底地驗證其片上系統(tǒng)(SoC)是否符合HDMI 2.0規(guī)范，從而加速批量生產(chǎn)的準(zhǔn)備時間。
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          • 關(guān)鍵字：
                        Cadence  HDMI                          
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          TSMC和Cadence合作開發(fā)3D-IC參考流程以實現(xiàn)3D堆疊
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ：CDNS)日前宣布，臺積電與Cadence合作開發(fā)出了3D-IC參考流程，該流程帶有創(chuàng)新的真正3D堆疊。該流程通過基于Wide I/O接口的3D堆疊，在邏輯搭載存儲器設(shè)計上進(jìn)行了驗證 ，可實現(xiàn)多塊模的整合。
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          • 關(guān)鍵字：
                        Cadence  臺積  3D-IC                          
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          TSMC和Cadence合作開發(fā)3D-IC參考流程以實現(xiàn)真正的3D堆疊
          
                                                            
            
                    	
          • 　　? 新參考流程增強了CoWoSTM (chip-on-wafer-on-substrate)芯片設(shè)計
　　? 使用帶3D堆疊的邏輯搭載存儲器進(jìn)行過流程驗證
　　全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ：CDNS)今天宣布，臺積電與Cadence合作開發(fā)出了3D-IC參考流程，該流程帶有創(chuàng)新的真正3D堆疊。該流程通過基于Wide I/O接口的3D堆疊，在邏輯搭載存儲器設(shè)計上進(jìn)行了驗證 ，可實現(xiàn)多塊模的整合。它將臺積電的3D堆疊技術(shù)和Cadence?3D-IC解決方案相結(jié)合，包
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          • 關(guān)鍵字：
                        Cadence  3D-IC                          
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          Cadence混合信號流程幫助Silicon將新MCU功耗縮減一半
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)日前宣布，Silicon Labs采用完整的Cadence? 混合信號低功耗設(shè)計流程，使其最新款節(jié)能型基于ARM? 微控制器單元(MCU)的功耗大幅降低了50%。
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          • 關(guān)鍵字：
                        Cadence  MCU                          
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          Cadence發(fā)表新一代驗證運算平臺
          
                                                            
            
                    	
          • 　　為了讓半導(dǎo)體與系統(tǒng)制造廠商加快產(chǎn)品上市速度，益華電腦(Cadence Design Systems)發(fā)表Palladium XP II 驗證運算平臺，作為強化系統(tǒng)開發(fā)套裝不可或缺的一環(huán)，大幅加速軟硬體驗證。
　　Palladium XP II 平臺建立在屢獲獎項肯定的 Palladium XP 仿真技術(shù)基礎(chǔ)之上，提升驗證效能達(dá)50%，并擴展容量達(dá)23億邏輯閘。由于更低的功耗與更高的閘道密度，現(xiàn)在客戶能夠以更小的面積承載更大的資料量。Cadence益華電腦也擴大支援8種全新行動與消費性通訊協(xié)定，加速模
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          • 關(guān)鍵字：
                        Cadence  驗證運算平臺                          
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          Cadence推出Palladium XP II 驗證平臺和系統(tǒng)開發(fā)增強套件
          
                                                            
                                        
            
                    	
          • 為了進(jìn)一步縮短半導(dǎo)體和系統(tǒng)制造商的產(chǎn)品上市時間，全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計系統(tǒng)公司 (NASDAQ:CDNS) 日前推出 Palladium? XP II 驗證計算平臺，它作為系統(tǒng)開發(fā)增強套件的一部分，可顯著加快硬件和軟件聯(lián)合驗證的時間。
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          • 關(guān)鍵字：
                        Cadence  嵌入式  201310                          
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          ARM收購Cadence顯示器IP
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)與頂尖半導(dǎo)體IP供應(yīng)商ARM聯(lián)合宣布，雙方已經(jīng)簽署最終協(xié)議，Cadence同意出售PANTA顯示控制器內(nèi)核，并將技術(shù)轉(zhuǎn)讓給ARM。這份協(xié)議促進(jìn)了雙方的長期生態(tài)系統(tǒng)合作，也強化了雙方的技術(shù)聯(lián)盟。
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          • 關(guān)鍵字：
                        ARM  Cadence  顯示器                          
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          Mellanox選擇Cadence縮短互聯(lián)產(chǎn)品開發(fā)時間
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)日前宣布Mellanox Technologies 選擇Cadence? Palladium? XP Verification Computing Platform 用于其領(lǐng)先的服務(wù)器和存儲產(chǎn)品的開發(fā)，該公司是高性能、端到端互聯(lián)解決方案領(lǐng)先供應(yīng)商，其產(chǎn)品用于數(shù)據(jù)中心服務(wù)器和存儲系統(tǒng)。
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          • 關(guān)鍵字：
                        Cadence  Mellanox  Palladium                          
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          Renesas獲得Cadence Tensilica ConnX D2 DSP授權(quán)
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)日前宣布，Renesas Electronics Corporation已獲得Tensilica ConnX D2 DSP(數(shù)字信號處理器)的授權(quán)，用于設(shè)計面向物聯(lián)網(wǎng) (IoT) 應(yīng)用領(lǐng)域的下一代芯片。
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          • 關(guān)鍵字：
                        Renesas  Cadence  DSP                          
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          中芯國際采用Cadence數(shù)字流程新增高級功能
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS) 與中芯國際集成電路制造有限公司(“中芯國際”，紐約證券交易所：SMI ，香港聯(lián)交所：981)，中國內(nèi)地規(guī)模最大、技術(shù)最先進(jìn)的集成電路晶圓代工企業(yè)，日前共同宣布中芯國際已采用Cadence? 數(shù)字工具流程，應(yīng)用于其新款SMIC Reference Flow 5.1，一款為低功耗設(shè)計的完整的RTL-GDSII 數(shù)字流程。
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          • 關(guān)鍵字：
                        中芯國際  Cadence  晶圓                          
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          Cadence布線常見問題
          
                                                            
            
                    	
          • 1. 怎樣建立自己的元件庫?建立了一個新的project后，畫原理圖的第一步就是先建立 自己所需要的庫，所采用的工具就是part developer.  首先在建立一個存放元件庫的目錄(如mylib)，然后用寫字板打開cds.lib，定義： De
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          • 關(guān)鍵字：
                        Cadence  布線                            
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          常見硬件設(shè)計EDA工具之比較
          
                                                            
            
                    	
          • 項目中EDA工具是每個工程師必不可少的好幫手，大大加快了我們的設(shè)計進(jìn)程。每一位工程師都應(yīng)該掌握并熟練至少一種EDA工具的使用。在論壇里經(jīng)常能看到新手的經(jīng)典提問：我應(yīng)該學(xué)習(xí)哪種畫圖工具呀?哪種畫圖工具更強大?哪種畫圖工具更好用?網(wǎng)上關(guān)于各種工具功能介紹的資料多如牛毛，EDA工具本身又包含很多版本和獨立功能的工具，初學(xué)者難免無所適從。
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          • 關(guān)鍵字：
                        EDA  PCB  Allegro  Mentor  Cadence  Altium                          
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          Cadence將分別于9月10、12日在北京和上海舉辦CDNLive 2013用戶大會
          
                                                            
            
                    	
          • 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS)將分別于9月10日、12日在北京金隅喜來登酒店和上海浦東嘉里大酒店舉辦“CDNLive用戶大會”。此會議集聚中國產(chǎn)業(yè)鏈高階主管、Cadence的技術(shù)使用者、開發(fā)者與業(yè)界專家，分享重要設(shè)計與驗證問題的解決經(jīng)驗，并為實現(xiàn)高階芯片、SoC和系統(tǒng)、IP及工具的新技術(shù)發(fā)現(xiàn)新技術(shù)。
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          • 關(guān)鍵字：
                        Cadence  SoC                          
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          華力微電子基于Cadence數(shù)字工具開發(fā)55納米參考設(shè)計流程
          
                                                            
            
                    	
          • 　　Cadence設(shè)計系統(tǒng)公司與上海華力微電子有限公司，今天共同宣布華力微電子基于Cadence Encounter數(shù)字技術(shù)交付出55納米平臺的參考設(shè)計流程。從現(xiàn)在起，華力微電子首次在其已建立的55 納米工藝平臺上實現(xiàn)了從 RTL到GDSII的完整流程，它也是Cadence與上海華力緊密合作的結(jié)果。
　　在該流程中所使用的Cadence數(shù)字工具包括RTL Compiler、Encounter Digital Implementation 系統(tǒng)、Conformal LEC、QRC Extraction、E
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          • 關(guān)鍵字：
                        Cadence  55納米                          
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