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基于CPLD的雙屏結(jié)構(gòu)液晶控制器的研究與設(shè)計(jì)
- 介紹了Verilog HDL設(shè)計(jì)CPLD作為液晶控制器的幾個(gè)基本部分，經(jīng)過驗(yàn)證，所設(shè)計(jì)控制器在單片機(jī)作用下正確完成液晶的顯示。本設(shè)計(jì)創(chuàng)新點(diǎn)在于控制器設(shè)計(jì)使用硬件描述語言Verilog而非傳統(tǒng)設(shè)計(jì)方法設(shè)計(jì)，易于理解，易于維護(hù)，調(diào)試電路速度快，有許多易于掌握的仿真綜合布局布線工具。若使用其他液晶屏，只需修改程序中相關(guān)參數(shù)，更多功能的擴(kuò)充，也只需增添CPLD中的模塊即可實(shí)現(xiàn)。
- 關(guān)鍵字： 控制器 研究 設(shè)計(jì) 液晶 結(jié)構(gòu) CPLD 雙屏 基于
FPGA平臺(tái)實(shí)現(xiàn)最小開關(guān)損耗的SVPWM算法
- 摘要：詳細(xì)分析了SVPWM的原理，介紹一種根據(jù)負(fù)載的功率因子來決定電壓空間零矢量的分配與作用時(shí)間的SVPWM算法，使得橋臂開關(guān)在通過其電流最大時(shí)的一段連續(xù)時(shí)間內(nèi)沒有開關(guān)動(dòng)作。這樣在提高開關(guān)頻率的同時(shí)減小了開關(guān)電
- 關(guān)鍵字： SVPWM FPGA 開關(guān)損耗 算法
CPLD在TMS320F2812系統(tǒng)中的應(yīng)用
- CPLD在TMS320F2812系統(tǒng)中的應(yīng)用,1 引言 TMS320F2812是美國(guó)德州儀器公司推出的C2000 家族中最新一代產(chǎn)品。先進(jìn)的內(nèi)部和外設(shè)結(jié)構(gòu)使得該處理器主要用于大存儲(chǔ)設(shè)備管理、高性能的控制場(chǎng)合。在F2812構(gòu)成的應(yīng)用系統(tǒng)中，需要設(shè)計(jì)一些邏輯控制電路來保證
- 關(guān)鍵字： 應(yīng)用 系統(tǒng) TMS320F2812 CPLD
基于FPGA無線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計(jì)
- 摘要 給出了一種由FPGA實(shí)現(xiàn)的無線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計(jì)方法，采用自頂向下的方法設(shè)計(jì)各個(gè)模塊，并在QuartusII8.0完成了仿真，該控制器主要支持IEEE802．15．4協(xié)議。測(cè)試結(jié)果表明，該MAC控制器支持20～250 kbmi
- 關(guān)鍵字： FPGA MAC 無線傳感器網(wǎng)絡(luò) 控制器
基于FPGA的CAN總線控制器設(shè)計(jì)
- 摘要：使用Verilog HDL硬件描述語言完成了對(duì)CAN總線控制器的設(shè)計(jì)，能夠?qū)崿F(xiàn)符合CAN2．0A協(xié)議的所有功能。本總線控制器的外部接口采用Altera公司開發(fā)的Avalon總線接口，增強(qiáng)了控制器的應(yīng)用靈活性。本設(shè)計(jì)使用Modelsim
- 關(guān)鍵字： FPGA CAN 線控 制器設(shè)計(jì)
VGA圖形控制器的FPGA實(shí)現(xiàn)
- VGA圖形控制器的FPGA實(shí)現(xiàn),VGA(視頻圖形陣列)作為一種標(biāo)準(zhǔn)的顯示接口得到廣泛的應(yīng)用。利用FPGA 芯片和EDA 設(shè)計(jì)方法，可以因地制宜，根據(jù)用戶的特定需要，設(shè)計(jì)出針對(duì)性強(qiáng)的VGA 顯示控制器，不僅能夠大大降低成本，還可以滿足生產(chǎn)實(shí)踐中不斷變化
- 關(guān)鍵字： 實(shí)現(xiàn) FPGA 控制器 圖形 VGA
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