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基于DDS的電路板檢測(cè)儀信號(hào)源設(shè)計(jì)
- 基于DDS的電路板檢測(cè)儀信號(hào)源設(shè)計(jì),針對(duì)某型導(dǎo)彈測(cè)試設(shè)備電路板檢測(cè)儀激勵(lì)信號(hào)源具體要求，采用了基于直接數(shù)字頻率合成技術(shù)(DDS)的信號(hào)發(fā)生器設(shè)計(jì)方法，介紹了DDS的工作原理，詳細(xì)闡述了基于FPGA設(shè)計(jì)DDS信號(hào)發(fā)生器的主要環(huán)節(jié)和實(shí)現(xiàn)的方法。采用了硬件描述語(yǔ)言Verilog HDL，完成了信號(hào)發(fā)生器的電路設(shè)計(jì)和功能仿真，并通過(guò)DE2-70開(kāi)發(fā)板結(jié)合嵌入式邏輯分析儀SignalTapⅡ進(jìn)行了分析驗(yàn)證。實(shí)驗(yàn)結(jié)果表明，該信號(hào)發(fā)生器能較好地產(chǎn)生所需激勵(lì)信號(hào)，具有較高的實(shí)用價(jià)值。
- 關(guān)鍵字： 信號(hào)源 設(shè)計(jì) 檢測(cè)儀 電路板 DDS 基于
基于FPGA的DDS設(shè)計(jì)及實(shí)現(xiàn)
- 針對(duì)DDS頻率轉(zhuǎn)換時(shí)間短，分辨率高等優(yōu)點(diǎn)，提出了基于FPGA芯片設(shè)計(jì)DDS系統(tǒng)的方案。該方案利用A1tera公司的QuartusⅡ開(kāi)發(fā)軟件，完成DDS核心部分即相位累加器和ROM查找表的設(shè)計(jì)，可得到相位連續(xù)、頻率可變的信號(hào)，并通過(guò)單片機(jī)配置FPGA的E2PROM完成對(duì)DDS硬件的下載，最后完成每個(gè)模塊與系統(tǒng)的時(shí)序仿真。經(jīng)過(guò)電路設(shè)計(jì)和模塊仿真，驗(yàn)證了設(shè)計(jì)的正確性。由于FPGA的可編程性，使得修改和優(yōu)化DDS的功能非常快捷。
- 關(guān)鍵字： FPGA DDS
基于DDS+PLL實(shí)現(xiàn)跳頻信號(hào)源的設(shè)計(jì)方法
- 航空通信設(shè)備包括短波通信、超短波通信設(shè)備，短波、超短波通信設(shè)備又分為常規(guī)通信方式和跳頻通信方式，跳頻通信因具有抗干擾性強(qiáng)、抗偵測(cè)能力好、頻譜利用率高和易于實(shí)現(xiàn)碼分多址等優(yōu)點(diǎn)被稱(chēng)為無(wú)線(xiàn)電通信的ldquo
- 關(guān)鍵字： 設(shè)計(jì) 方法 信號(hào)源 實(shí)現(xiàn) DDS PLL 基于
基于DDS的高精度任意波形發(fā)生器設(shè)計(jì)
- 摘要：系統(tǒng)利用直接數(shù)字頻率合成技術(shù)(DDS)完成任意波形發(fā)生器設(shè)計(jì)，以FPGA作為核心控制器件，用Flash和RAM作為波形數(shù)據(jù)存儲(chǔ)模塊，在上位機(jī)軟件的控制下，利用高精度D／A轉(zhuǎn)換器，實(shí)現(xiàn)正弦波、方波、三角波、鋸齒波、高
- 關(guān)鍵字： DDS 高精度 任意波形發(fā)生器
基于AVR與DDS技術(shù)的超聲波電源研制
- 設(shè)計(jì)了一種在500kHz內(nèi)頻率任意可調(diào)、3.2瓦內(nèi)功率任意可調(diào)、且具備工作過(guò)程頻率自動(dòng)跟蹤的超聲電源。綜合應(yīng)用 AVR單片機(jī)與 DDS頻率合成技術(shù)，能夠調(diào)節(jié)輸出頻率并驅(qū)動(dòng)換能器的多階工作頻率；采用觸發(fā)器跟蹤與電流最大值等跟蹤方法，實(shí)現(xiàn)對(duì)換能器工作頻率的實(shí)時(shí)精確跟蹤，滿(mǎn)足壓電換能器的穩(wěn)定諧振工作的要求。此外，本超聲電源具備多種波型輸出、 LCD顯示、鍵盤(pán)輸入、自動(dòng)掃頻等多種功能，可應(yīng)用于半導(dǎo)體芯片引線(xiàn)鍵合、醫(yī)療超聲、超聲金屬加工等領(lǐng)域。
- 關(guān)鍵字： 電源 研制 超聲波 技術(shù) AVR DDS 基于 功率模塊
基于FPGA和DDS技術(shù)的正弦信號(hào)發(fā)生器設(shè)計(jì)
- 該系統(tǒng)由FPGA、單片機(jī)控制模塊、鍵盤(pán)、LED顯示組成，采用直接數(shù)字頻率合成(DDS)，D／A以及實(shí)時(shí)計(jì)算波形值等技術(shù)，設(shè)計(jì)出具有頻率設(shè)置功能，頻率步進(jìn)為100 Hz，頻率范圍為1 kHz～10 MHz之間正弦信號(hào)發(fā)生器。該系統(tǒng)的頻率范圍寬，步進(jìn)小，頻率精度較高。
- 關(guān)鍵字： FPGA DDS 正弦信號(hào)發(fā)生器
基于FPGA的并行多通道激勵(lì)信號(hào)產(chǎn)生模塊
- 引言并行測(cè)試的實(shí)現(xiàn)途徑分為軟件方式和硬件方式。用軟件方式實(shí)現(xiàn)并行測(cè)試，關(guān)鍵是對(duì)測(cè)試任務(wù)的分...
- 關(guān)鍵字： FPGA NiosII FIFO DDS 多通道激勵(lì)信號(hào)
基于MXT8051的太陽(yáng)能可調(diào)逆變電源
- 隨國(guó)家節(jié)能環(huán)保推行政策的出臺(tái)以及太陽(yáng)能開(kāi)發(fā)技術(shù)的不斷完善，太陽(yáng)能作為一種綠色的能源逐漸為工業(yè)和家庭所用;但如今外設(shè)工作復(fù)雜多變，對(duì)電源(特別是交流電源)的要求越來(lái)越嚴(yán)峻,本設(shè)計(jì)針對(duì)這一瓶頸提供了一套控制系統(tǒng)，可以有效解決多種環(huán)境下的用電?；贛XT8051的太陽(yáng)能可調(diào)逆變電源采用MXT8051做微控制器控制，12864液晶顯示，鍵盤(pán)輸入，正弦波頻率、相位及幅值的調(diào)制;再由放過(guò)充模塊控制太陽(yáng)能板的充電儲(chǔ)能輸出;正弦波輸出調(diào)節(jié)模塊由DDS芯片AD98508集成模塊產(chǎn)生可調(diào)節(jié)波形，再由高頻放大模塊放大輸出。整個(gè)
- 關(guān)鍵字： 時(shí)代民芯 MXT8051 DDS AD9850
基于單片機(jī)的頻率特性測(cè)試儀設(shè)計(jì)
- 本文介紹了基于DDS技術(shù)的頻率特性測(cè)試儀的設(shè)計(jì)方法。在設(shè)計(jì)中掃頻信號(hào)源采用DDS芯片AD9851實(shí)現(xiàn)，以單片機(jī)AT89C52為控制核心，控制整個(gè)系統(tǒng)協(xié)調(diào)工作并實(shí)時(shí)對(duì)所測(cè)數(shù)據(jù)進(jìn)行處理， LCD顯示幅頻特性和相頻特性曲線(xiàn)，實(shí)現(xiàn)了系統(tǒng)的小型化和全數(shù)字化。
- 關(guān)鍵字： 單片機(jī) 測(cè)試儀 DDS 幅頻特性 相頻特性 201006
一種基于DDS技術(shù)的信號(hào)發(fā)生器研究與實(shí)現(xiàn)
- 首先闡述了DDS技術(shù)的基本原理，在此基礎(chǔ)上，實(shí)現(xiàn)了一種采用單片機(jī)AT89S52控制AD9850芯片的任意信號(hào)發(fā)生器系統(tǒng)。理論研究和實(shí)驗(yàn)結(jié)果表明，該系統(tǒng)可產(chǎn)生頻率和幅值均可調(diào)的正弦波、三角波和方波，且頻帶寬、精度高、穩(wěn)定性好。
- 關(guān)鍵字： DDS 信號(hào)發(fā)生器
基于DDS+PLL高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn)
- 基于DDS+PLL高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn),摘要：結(jié)合DDS+PLL技術(shù)，采用DDS芯片AD9851和集成鎖相芯片ADF4113完成了GSM 1 800 MHz系統(tǒng)中高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn)。詳細(xì)介紹系統(tǒng)中核心芯片的性能、結(jié)構(gòu)及使用方法，并運(yùn)用ADS和ADISimPLL軟件對(duì)設(shè)計(jì)方案進(jìn)行
- 關(guān)鍵字： 合成器 設(shè)計(jì) 實(shí)現(xiàn) 頻率 高性能 DDS PLL 基于
DDS+PLL高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn)
- DDS+PLL高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn),摘要：結(jié)合DDS+PLL技術(shù)，采用DDS芯片AD9851和集成鎖相芯片ADF4113完成了GSM 1 800 MHz系統(tǒng)中高性能頻率合成器的設(shè)計(jì)與實(shí)現(xiàn)。詳細(xì)介紹系統(tǒng)中核心芯片的性能、結(jié)構(gòu)及使用方法，并運(yùn)用ADS和ADISimPLL軟件對(duì)設(shè)計(jì)方案進(jìn)行
- 關(guān)鍵字： 設(shè)計(jì) 實(shí)現(xiàn) 合成器 頻率 PLL 高性能 DDS
dds介紹
DDS的簡(jiǎn)單介紹
DDS同 DSP（數(shù)字信號(hào)處理）一樣，是一項(xiàng)關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫(xiě)。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時(shí)間等優(yōu)點(diǎn)，廣泛使用在電信與電子儀器領(lǐng)域，是實(shí)現(xiàn)設(shè)備全數(shù)字化的一個(gè)關(guān)鍵技術(shù)。
一塊DDS芯片中主要包括頻率控制寄存器、高速相位累加器和正弦計(jì)算 [ 查看詳細(xì) ]
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