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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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dsp+fpga 文章進(jìn)入dsp+fpga技術(shù)社區(qū)

多重問題夾擊下的電子供應(yīng)鏈

在上期的文章中，筆者簡單分析了2012年電子供應(yīng)鏈上的分銷商面臨的內(nèi)憂外患不利局面，面對這樣迷茫的局面，有些廠商很早就做出了自己的選擇。雖然無法確定這樣的選擇是否正確，但確實(shí)給眾多迷茫中的電子元器件分銷商指出一條新的出路。
關(guān)鍵字：艾睿合眾達(dá) DSP 201202

基于FPGA NiosII的MPEG-4視頻播放器

引言多媒體技術(shù)實(shí)用化的關(guān)鍵技術(shù)之一，就是解決視頻、音頻數(shù)字化以后數(shù)據(jù)量大，與數(shù)字存儲媒體、通信網(wǎng)容量小的矛盾，其解決途徑就是壓縮。為了支持低比特率視頻傳輸業(yè)務(wù)，MPEG(Moving Picture Expert5 Group)推出了
關(guān)鍵字： NiosII FPGA MPEG 視頻播放器

基于單片機(jī)的CPLD/FPGA被動串行下載配置的實(shí)現(xiàn)

1引言隨著電子技術(shù)的發(fā)展，當(dāng)前數(shù)字系統(tǒng)的設(shè)計(jì)正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。推動該潮流迅猛發(fā)展的引擎就是日趨進(jìn)步和完善的高密度現(xiàn)場可編程邏輯器件設(shè)計(jì)技術(shù)。高密度現(xiàn)場可編程邏輯器件（CPLD/
關(guān)鍵字： CPLD FPGA 單片機(jī) 被動

基于Actel FPGA的TFT控制器技術(shù)方案設(shè)計(jì)

基于Actel FPGA的TFT控制器技術(shù)方案設(shè)計(jì),在1970年，F(xiàn)ergason制造了第一臺具有實(shí)用性的LCD，從此之后，用戶產(chǎn)品的界面發(fā)生了巨大改變，變得更加的美觀、實(shí)用，在一定場合下逐漸取代傳統(tǒng)的數(shù)碼管、LED的顯示。TFT誕生于80年代末，在1995年之后被廣泛的應(yīng)用，現(xiàn)
關(guān)鍵字：技術(shù) 方案設(shè)計(jì) 控制器 TFT Actel FPGA 基于

基于Linux操作系統(tǒng)的ARM/DSP多機(jī)I2C通信設(shè)計(jì)方案

引言　　在很多嵌入式控制系統(tǒng)中，系統(tǒng)既要完成大量的信息采集和復(fù)雜的算法，又要實(shí)現(xiàn)精確的控制功能。采用運(yùn)行有嵌入式Linux操作系統(tǒng)的ARM9微控制器完成信號采集及實(shí)現(xiàn)上層控制算法，并向DSP芯片發(fā)送上層算法得到控
關(guān)鍵字：通信設(shè)計(jì) 方案 I2C 多機(jī) Linux 操作系統(tǒng) ARM/DSP 基于

基于DSP與CPLD空間瞬態(tài)光輻射信號實(shí)時(shí)探測系統(tǒng)電路設(shè)計(jì)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 空間瞬態(tài) CPLD 光輻射信號

DSP與單片機(jī)的高速通信實(shí)現(xiàn)方案

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP 單片機(jī) 高速通信

DSP和OZ890的電池管理系統(tǒng)設(shè)計(jì)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP OZ890 電池管理

基于VC++的FPGA重配置方案設(shè)計(jì)

基于VC++的FPGA重配置方案設(shè)計(jì),采用VC++程序的FPGA重配置設(shè)計(jì)方案利用現(xiàn)場可編程邏輯器件FPGA的多次可編程配置特點(diǎn)，通過重新下載存儲于存儲器的不同系統(tǒng)數(shù)據(jù)，從而實(shí)現(xiàn)不同的芯片邏輯功能，可以在很大程度上提高資源利用率。原始配置FPGA的方法是
關(guān)鍵字：方案設(shè)計(jì) 配置 FPGA VC 基于

G.723.1標(biāo)準(zhǔn)算法在DSP上的優(yōu)化

G.723.1標(biāo)準(zhǔn)算法在DSP上的優(yōu)化,1 引言　　G.723.1是刪組織于1996年推出的一種低碼率的語音編碼算法標(biāo)準(zhǔn)，也是目前該組織頒布的語音壓縮標(biāo)準(zhǔn)中碼率最低的一種標(biāo)準(zhǔn)。G.723.1主要用于對語音及其它多媒體聲音信號的壓縮，目前在一些數(shù)字音視頻傳輸、高
關(guān)鍵字：優(yōu)化 DSP 算法標(biāo)準(zhǔn) G.723.1

基于FPGA的高速異步FIFO的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的高速異步FIFO的設(shè)計(jì)與實(shí)現(xiàn),引言　　現(xiàn)代集成電路芯片中，隨著設(shè)計(jì)規(guī)模的不斷擴(kuò)大．一個(gè)系統(tǒng)中往往含有數(shù)個(gè)時(shí)鐘。多時(shí)鐘帶來的一個(gè)問題就是，如何設(shè)計(jì)異步時(shí)鐘之間的接口電路。異步FIFO(First In First Out)是解決這個(gè)問題的一種簡便、快捷的解
關(guān)鍵字：設(shè)計(jì) 實(shí)現(xiàn) FIFO 異步 FPGA 高速基于

FPGA上同步開關(guān)噪聲的分析與解決方法介紹

FPGA上同步開關(guān)噪聲的分析與解決方法介紹,概述　　隨著半導(dǎo)體技術(shù)的快速發(fā)展，近年來FPGA 的器件容量和輸入輸出的管腳數(shù)量都極大的增加了，例如StratixIV 器件，最大的一款EP4SE680 擁有68.11 萬個(gè)邏輯單元和1104個(gè)輸入輸出管腳。大量的輸出管腳在同一時(shí)刻翻
關(guān)鍵字：解決方法介紹分析噪聲同步開關(guān) FPGA

數(shù)字信號處理器（DSP）在電源產(chǎn)品設(shè)計(jì)上的應(yīng)用

1前言利用高性能的數(shù)字信號處理器（DSP）設(shè)計(jì)電源，不但能夠減少電路的元器件，而且可以大大增加系統(tǒng)的可靠性...
關(guān)鍵字：數(shù)字信號處理器（DSP）直流驅(qū)動電源仿真芯片ADMC331

基于FPGA機(jī)載實(shí)時(shí)視頻圖形處理系統(tǒng)的設(shè)計(jì)

摘要給出了某機(jī)載實(shí)時(shí)視頻圖形處理系統(tǒng)的硬件電路設(shè)計(jì)方案，以XC5VFX70T FPGA作為核心處理器，實(shí)現(xiàn)了對DVI及PAL等多種格式視頻信號的解碼、實(shí)時(shí)處理以及輸出。系統(tǒng)電路設(shè)計(jì)簡潔，具有較強(qiáng)的靈活性和擴(kuò)展性。文中介紹
關(guān)鍵字： FPGA 機(jī)載實(shí)時(shí)視頻圖形處理系統(tǒng)

基于FPGA的雙口RAM實(shí)現(xiàn)及應(yīng)用

基于FPGA的雙口RAM實(shí)現(xiàn)及應(yīng)用,摘要：為了在高速采集時(shí)不丟失數(shù)據(jù)，在數(shù)據(jù)采集系統(tǒng)和CPU之間設(shè)置一個(gè)數(shù)據(jù)暫存區(qū)。介紹雙口RAM的存儲原理及其在數(shù)字系統(tǒng)中的應(yīng)用。采用FPGA技術(shù)構(gòu)造雙口RAM，實(shí)現(xiàn)高速信號采集系統(tǒng)中的海量數(shù)據(jù)存儲和時(shí)鐘匹配。功能仿
關(guān)鍵字：實(shí)現(xiàn) 應(yīng)用 RAM 雙口 FPGA 基于

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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如何使用FPGA實(shí)現(xiàn)多通道高速CMOS圖像采集系統(tǒng)的設(shè)計(jì)
如何使用FPGA實(shí)現(xiàn)新型高速CCD圖像數(shù)據(jù)采集系統(tǒng)
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