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基于TMS320C6713和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計
- 基于TMS320C6713和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計,1 引言
數(shù)據(jù)采集系統(tǒng)是通信與信息技術(shù)領(lǐng)域中重要的功能模塊，應(yīng)用廣泛。而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)大多以單片機(jī)或中規(guī)模數(shù)字電路為核心，其模數(shù)轉(zhuǎn)換器(A／D轉(zhuǎn)換器)采樣速率較低。顯然傳統(tǒng)數(shù)據(jù)采集系統(tǒng)不能完全滿足高 - 關(guān)鍵字： 系統(tǒng) 設(shè)計 數(shù)據(jù)采集 高速 TMS320C6713 MAX1420 基于 數(shù)據(jù)采集 TMS320C6713 MAX1420 USB通信接口 DSP
X-Fest 2010研討會將于1月在亞洲全面啟動
- 安富利電子元件 (Avnet Electronics Marketing) 與賽靈思公司(Xilinx, Inc.)再次攜手舉辦X-Fest 2010系列研討會，并將展開亞洲之旅。此次環(huán)球研討會的亞洲行將于2010年1月12日在北京拉開帷幕，隨后將在中國大陸、臺灣、韓國、新加坡、澳大利亞及印度的其他十個城市相繼舉辦。 這次X-Fest技術(shù)研討會在全球37個城市舉辦，其中包括亞洲地區(qū)的11個城市。這為期一天的研討會為FPGA、DSP和嵌入式系統(tǒng)設(shè)計人員提供實用的技能培訓(xùn)，它將提供多種時長75分鐘的
- 關(guān)鍵字： Avnet FPGA DSP
基于DM642的智能視頻監(jiān)控系統(tǒng)的DSP實現(xiàn)
- 實現(xiàn)了基于多媒體數(shù)字信號處理器TMS320DM642的智能視頻監(jiān)控系統(tǒng)，包括基于DSP系統(tǒng)構(gòu)架以及算法的DSP實現(xiàn)。
- 關(guān)鍵字： DSP 智能監(jiān)控 PCI總線 數(shù)字圖像處理 DM642 200912
處理器集成DSP可提高圖形和音頻處理能力
- 處理器集成DSP的目的主要是提高圖形和音頻處理能力，從而節(jié)約Core(內(nèi)核)的資源，發(fā)揮處理器在多媒體和游戲應(yīng)用上的潛力。 便攜產(chǎn)品的處理器向高端和多核發(fā)展將具有劃時代的意義，Intel依靠Atom想在便攜式設(shè)備分得一杯羹，ARM希望在高性能、多核處理器的發(fā)展上，向Intel發(fā)起挑戰(zhàn)。是 ARM挺進(jìn)Intel在計算機(jī)市場的領(lǐng)域，還是Intel下探到ARM在嵌入式強(qiáng)勢的便攜市場，未來無法預(yù)測。但是，ARM和Intel必將在交匯點展開一輪激烈的戰(zhàn)斗是肯定的。中電器材作為ARM產(chǎn)品的銷售方，將結(jié)合市場
- 關(guān)鍵字： DSP Core 處理器
便攜產(chǎn)品復(fù)雜應(yīng)用需要多處理器支持
- 便攜產(chǎn)品的應(yīng)用越復(fù)雜，需要的處理器資源就越多，單純的提高處理器速度不可能很好地解決這一問題。特別對于一些固定的應(yīng)用，比如音視頻解碼、GPS基帶處理等，需要使用多處理器或CPU+DSP的并行計算模式才能有理想表現(xiàn)。 在我們的PND方案中，采用了CSR公司的A4Prima平臺，在HDMediaPlayer(高清播放器)中我們采用了Telechips公司的TCC8900，這些都是主流的ARM11為基礎(chǔ)的應(yīng)用處理器，而我們現(xiàn)在預(yù)研的產(chǎn)品，基本上都將轉(zhuǎn)到更高端的ARMCortex-A系列為核心的應(yīng)用處理器
- 關(guān)鍵字： 處理器 DSP PND
基于FPGA的電動機(jī)微機(jī)保護(hù)實現(xiàn)方法
- 0 引 言
電動機(jī)內(nèi)部故障的診斷與檢測是電動機(jī)保護(hù) 的主要研究方向。近年來,其研究主要集中在兩方 面:一方面是追尋保護(hù)理論上的突破,逐步由定性 說明到定量分析;另一方面是在實現(xiàn)手段上的發(fā)展,逐步 - 關(guān)鍵字： FPGA 電動機(jī) 微機(jī)保護(hù) 實現(xiàn)方法
賽靈思同時推出六大領(lǐng)域優(yōu)化開發(fā)套件
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)日前宣布，作為公司目標(biāo)設(shè)計平臺最新一步的發(fā)展，賽靈思同時推出六大領(lǐng)域優(yōu)化開發(fā)套件。目標(biāo)設(shè)計平臺是賽靈思公司幫助開發(fā)人員在FPGA 設(shè)計時專注于產(chǎn)品創(chuàng)新與差異化的創(chuàng)新理念。這些面向Virtex-6 和 Spartan-6 系列的開發(fā)平臺可大幅縮短實現(xiàn)最佳系統(tǒng)性能所需的時間，同時還確保片上系統(tǒng) (SoC) 開發(fā)階段的低功耗水平。這些最新套件主要針對嵌入式處理、DSP，以及構(gòu)建要求高速串行連接功能的系統(tǒng)，為設(shè)計團(tuán)隊提供了專門針對設(shè)計流程而精
- 關(guān)鍵字： Xilinx 開發(fā)套件 Virtex FPGA
Altera 推出其面向 Stratix IV FPGA 的最新開發(fā)套件
- Altera 公司今天宣布推出其面向 Stratix?IV FPGA 的最新開發(fā)套件。Stratix IV E FPGA 開發(fā)套件具有業(yè)界最高密度、最高性能的 FPGA。該套件為用戶提供了全面的設(shè)計環(huán)境，其中包括迅速開始其高密度原型產(chǎn)品設(shè)計所需的硬件和軟件。 Stratix IV E FPGA 開發(fā)套件基于高性能、高密度的 Stratix IV EP4SE530 FPGA。該 FPGA 具有 530K 邏輯元件 (LE)，比當(dāng)前市場上同類競爭產(chǎn)品的 FPGA 性能平均高 25%。S
- 關(guān)鍵字： Altera Stratix FPGA
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