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致力推動FPGA深入高校教育，Altera舉辦全國大學(xué)教師會議
- 近日，Altera公司在清華大學(xué)拉開了全國大學(xué)教師會議的序幕， 來自全國118所高校的近300名教師、Altera公司高層參加了這一為期兩天的學(xué)術(shù)盛會。這已是Altera公司第五次舉辦的全國范圍內(nèi)的大學(xué)教師會議。自2003年以來，Altera公司一年一度的大學(xué)教師會議，將全國各大高校的教師匯聚一堂，通過若干專題研討會以及經(jīng)驗交流，讓廣大高校老師對可編程邏輯技術(shù)的發(fā)展及其在大學(xué)課程中的應(yīng)用有更深入的了解，對課程設(shè)置的改革有更清晰的概念，為高校教師的應(yīng)用教學(xué)搭建起交流學(xué)習的平臺。 在今年
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DSP入門導(dǎo)讀（5）
- 并行FLASH引導(dǎo)的一點經(jīng)驗-阿哲 最近BBS上關(guān)于FLASH和BOOT的討論很活躍，我也多次來此請教。前幾天自制的DSP板引導(dǎo)成功，早就打算寫寫這方面的東西。我用的 DSP是5416，以其為核心，做了一個相對獨立的子系統(tǒng)（硬件、軟件、算法），目前都已基本做好。下面把在FLASH引導(dǎo)方面做的工作向大家匯報一下，希望能對大家有所幫助。本人經(jīng)驗和文筆都有限，寫的不好請大家諒解。 硬件環(huán)境： DSP：TMS320VC5416PGE160 FLASH：SST39VF40
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基于FPGA+PCI的并行計算平臺實現(xiàn)
- 當前對于各種加密算法.除了有針對性的破解算法，最基本的思想就是窮舉密鑰進行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數(shù)較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結(jié)構(gòu)設(shè)計簡便而具有實際應(yīng)用的前景。 PCI總線(外設(shè)互聯(lián)總線)與傳統(tǒng)的總線標準——ISA總線(工業(yè)標準結(jié)構(gòu)總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標準，在普通PC機和工控機上有著廣泛的應(yīng)
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基于FPGA的分布式算法FIR濾波器設(shè)計
- 引 言 FIR(finite impulse response)濾波器是數(shù)字信號處理系統(tǒng)中最基本的元件，它可以在保證任意幅頻特性的同時具有嚴格的線性相頻特性，同時其單位沖激響應(yīng)是有限的，沒有輸入到輸出的反饋，是穩(wěn)定的系統(tǒng)。因此，F(xiàn)IR濾波器在通信、圖像處理、模式識別等領(lǐng)域都有著廣泛的應(yīng)用。 目前FIR濾波器的硬件實現(xiàn)有以下幾種方式： 一種是使用單片通用數(shù)字濾波器集成電路，這種電路使用簡單，但是由于字長和階數(shù)的規(guī)格較少，不易完全滿足實際需要。雖然可采用多片擴展來滿足要求，但會增加體積和
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FPGA奔向45納米
- Altera公司技術(shù)開發(fā)副總裁Mojy Chian博士來到北京，在媒體座談會上介紹了該公司45nm IC開發(fā)的情況。他說，45nm相對65nm的優(yōu)勢要比65nm相對90nm的優(yōu)勢更大，同時開發(fā)難度也更高。Altera通過選擇正確的合作伙伴、采用“第一片硅投產(chǎn)”的方法以及協(xié)作設(shè)計和工藝開發(fā)的方式來實現(xiàn)2008年45nm FPGA的生產(chǎn)。 那個叫Moore的人真幸運。他沒有發(fā)現(xiàn)真正的物理定律。他只不過總結(jié)并預(yù)測了半導(dǎo)體產(chǎn)業(yè)的發(fā)展規(guī)律，但他可能比大多數(shù)發(fā)現(xiàn)真正定律的物理學(xué)家都著名。說他幸運，是因為那個
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C語言平臺 縮短SoC前期設(shè)計時間
- 在設(shè)計上能減少結(jié)構(gòu)探索時間的C語言平臺，在結(jié)構(gòu)上如何以新思考突破? 以往半導(dǎo)體業(yè)者大多使用FPGA(Field Programmable Gate Array)製作樣品(Prototype)，接著鎖定幾項晶片重要規(guī)格，依此找出最適合該晶片的結(jié)構(gòu)，這種方式最大缺點是作業(yè)時間非常冗長。然而，C語言平臺的設(shè)計方式則是，利用軟體模擬分析檢討晶片結(jié)構(gòu)，以往FPGA平臺的樣品，大約需要半年左右的結(jié)構(gòu)探索時間，如果採用C語言平臺的設(shè)計方式，只需要花費約2周~1個月的時間。 目前開發(fā)最快的是日本沖電氣，以
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基于DSP的高速實時語音識別系統(tǒng)的設(shè)計與實現(xiàn)
- 實時語音識別系統(tǒng)中，由于語音的數(shù)據(jù)量大，運算復(fù)雜，對處理器性能提出了很高的要求，適于采用高速DSP實現(xiàn)。雖然DSP提供了高速和靈活的硬件設(shè)計，但是在實時處理系統(tǒng)中，還需結(jié)合DSP器件的結(jié)構(gòu)及工作方式，針對語音處理的特點，對軟件進行反復(fù)優(yōu)化，以縮短識別時間，滿足實時的需求。因此如何對DSP進行優(yōu)化編程，解決算法的復(fù)雜性和硬件存儲容量及速度之間的矛盾，成為實現(xiàn)系統(tǒng)性能的關(guān)鍵。本文基于TMS320C6713設(shè)計并實現(xiàn)了高速實時語音識別系統(tǒng)，在固定文本的說話人辨識的應(yīng)用中效果顯著。 1 語音識別的原理
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DSP與普通MCU的區(qū)別
- 考慮一個數(shù)字信號處理的實例，比如有限沖擊響應(yīng)濾波器（FIR）。用數(shù)學(xué)語言來說，F(xiàn)IR濾波器是做一系列的點積。取一個輸入量和一個序數(shù)向量，在系數(shù)和輸入樣本的滑動窗口間作乘法，然后將所有的乘積加起來，形成一個輸出樣本。 類似的運算在數(shù)字信號處理過程中大量地重復(fù)發(fā)生，使得為此設(shè)計的器件必須提供專門的支持，促成了了DSP器件與通用處理器（GPP）的分流： 1 對密集的乘法運算的支持 GPP不是設(shè)計來做密集乘法任務(wù)的，即使是一些現(xiàn)代的GPP，也要求多個指令周期來做一次乘法。而DSP處理器使用專門的硬件來實
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基于單片機和DSP的被動聲目標探測平臺設(shè)計
- 1 引言 被動聲目標的信息一般夾雜在復(fù)雜多變的環(huán)境噪聲中，信噪比低。采用傳統(tǒng)的目標探測，較難達到要求， 必須使用先進的檢測、定向定位算法，然而這些算法的運算量都較大，實時實現(xiàn)有一定難度。數(shù)字信號處理器DSP的出現(xiàn)，使得先進算法的工程實時實現(xiàn)成為可能。但系統(tǒng)的體積、功耗和可靠性又成為主要問題。本系統(tǒng)采用TI公司的低功耗5000系列DSP和微功耗430系列單片機，采用主從式通用化體系結(jié)構(gòu)設(shè)計，在滿足系統(tǒng)功能要求的前提下，對系統(tǒng)的體積、功耗和可靠性做了很大的改進，特別適于在電池供電、功耗要求嚴格的設(shè)備
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FPGA在語音存儲與回放系統(tǒng)中的應(yīng)用
- 1 引言 隨著數(shù)字信號處理器、超大規(guī)模集成電路的高速發(fā)展，語音記錄技術(shù)已從模擬錄音階段過渡到數(shù)字錄音階段。在數(shù)字化錄音技術(shù)中，壓縮后的語音數(shù)據(jù)有些存儲在硬盤中，有些存儲在帶有掉電保護功能的RAM或FLASH存儲器中。筆者介紹的語音存儲與回放系統(tǒng)，未使用專用的語音處理芯片，不需要擴展接口電路，只利用FPGA作為核心控制器，就能完成語音信號的數(shù)字化處理，即實現(xiàn)語音的存儲與回放。 2 系統(tǒng)總體結(jié)構(gòu) 數(shù)字化語音存儲與回放系統(tǒng)的基本工作原理是將模擬語音信號通過模數(shù)轉(zhuǎn)換器(A/D)轉(zhuǎn)換成數(shù)字信號
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