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dsp＋fpga 文章進(jìn)入dsp＋fpga技術(shù)社區(qū)

構(gòu)建基于PXI電子液壓制動系統(tǒng)EHB駕駛員在回路混合仿真實驗平臺

研發(fā)EHB控制器的關(guān)鍵點在于通過大量測試實驗掌握執(zhí)行元件的工作性能，在模擬環(huán)境下有效地進(jìn)行參數(shù)仿真、軟件仿真，減少實際路面測試帶來的困難，并開發(fā)基于虛擬現(xiàn)實技術(shù)的混合仿真平臺，在不同虛擬環(huán)境下由駕駛員產(chǎn)生的的實際操縱動作對EHB快速原型的控制器進(jìn)行功能驗證和逼真的產(chǎn)品性能演示。
關(guān)鍵字： LabVIEW EHB FPGA PWM

萊迪思宣布推出針對微型系統(tǒng)的世界上最小的FPGA

萊迪思半導(dǎo)體公司(NASDAQ: LSCC)今日宣布推出iCE40 LP384 FPGA，超低密度FPGA擴(kuò)展的iCE40系列的最小器件。能夠使設(shè)計人員快速地添加新的功能，使成本敏感、空間受限、低功耗的產(chǎn)品差異化，新的小尺寸FPGA對許多應(yīng)用是理想的選擇，諸如便攜式醫(yī)療監(jiān)護(hù)儀、智能手機(jī)、數(shù)碼相機(jī)、電子書閱讀器和緊湊的嵌入式系統(tǒng)。
關(guān)鍵字：萊迪思 FPGA iCE40

世健攜高新技術(shù)方案及產(chǎn)品亮相2013慕尼黑上海電子展

2013慕尼黑上海電子展于3月19日拉開帷幕，世健系統(tǒng)(香港)有限公司以“節(jié)能不降性能”為旗號，帶領(lǐng)一眾前沿的技術(shù)方案和產(chǎn)品華麗亮相，當(dāng)中包括全球首發(fā)的領(lǐng)先科技產(chǎn)品，吸引了眾多業(yè)內(nèi)人士的眼球。
關(guān)鍵字：世健 DSP 藍(lán)牙 CSR

基于TMS320F2808 DSP最小系統(tǒng)設(shè)計及應(yīng)用

通過介紹了新一代美國德州儀器(TI)公司C2000平臺上的定點DSP芯片TMS320F2808的性能特點和硬件結(jié)構(gòu)、外設(shè)模塊，給出了由TMS3 20F2808組成的DSP最小應(yīng)用系統(tǒng)，并介紹了各部分電路的設(shè)計方案
關(guān)鍵字： DSP TMS320F2808 最小應(yīng)用系統(tǒng)

基于TMS320C6000 DSP及DSP／BIOS系統(tǒng)的Flash引導(dǎo)自啟動設(shè)計

隨著信息技術(shù)的發(fā)展，DSP在現(xiàn)代電子系統(tǒng)設(shè)計中得到了廣泛的應(yīng)用，并且DSP的FLASH自啟動在DSP的系統(tǒng)設(shè)計中也占有重要的地位，DSP／BIOS是TI推出的嵌入式實時操作系統(tǒng)。
關(guān)鍵字： TMS320C6713 引導(dǎo)啟動 DSP／BIOS實時操作系統(tǒng)

基于FPGA的通信系統(tǒng)同步提取的實現(xiàn)

在可靠的通信系統(tǒng)中，要保證接收端能正確解調(diào)出信息，必須要有一個同步系統(tǒng)，以實現(xiàn)發(fā)送端和接收端的同步，因此同步提取在通信系統(tǒng)中是至關(guān)重要的。一個簡單的接收系統(tǒng)框圖如圖1所示。本文介紹一種基于現(xiàn)場可編程
關(guān)鍵字： FPGA 通信系統(tǒng)

基于FPGA的應(yīng)力應(yīng)變信號監(jiān)測系統(tǒng)的研究設(shè)計

文中介紹了一種基于FPGA的多通道應(yīng)力應(yīng)變信號監(jiān)測系統(tǒng)的設(shè)計方案，該系統(tǒng)的研究為一些大型建筑結(jié)構(gòu)由于年代久遠(yuǎn)而需要維護(hù)、維修提供客觀依據(jù)，主要闡述了前端信號采集電路硬件以及FPGA上各個控制模塊的設(shè)計，系統(tǒng)可以通過NiosⅡ軟核修改FPGA中的各項采樣參數(shù)，如采樣率、采樣通道數(shù)、起始通道等，來實現(xiàn)對不同對象的應(yīng)變情況進(jìn)行實時監(jiān)測，模擬實驗表明系統(tǒng)運行穩(wěn)定可靠，采集精度高，具有很高的實用價值。
關(guān)鍵字： FPGA 應(yīng)力信號監(jiān)測系統(tǒng)

基于時鐘頻率調(diào)整的時間同步的FPGA實現(xiàn)及應(yīng)用

網(wǎng)絡(luò)化運動控制是未來運動控制的發(fā)展趨勢，隨著高速加工技術(shù)的發(fā)展，對網(wǎng)絡(luò)節(jié)點間的時間同步精度提出了更高的要求。如造紙機(jī)械，運行速度為1 500～1 800m/min，同步運行的電機(jī)之間1mu;s的時間同步誤差將造成30 mu;
關(guān)鍵字： FPGA 時鐘頻率時間同步

基于FPGA的模擬視頻轉(zhuǎn)SDI的轉(zhuǎn)換器設(shè)計與實現(xiàn)

摘要：為了將現(xiàn)有模擬視頻系統(tǒng)接入到數(shù)字串行視頻系統(tǒng)，需要將模擬視頻轉(zhuǎn)換成SDI信號。采用SAA7113先將模擬視頻數(shù)字化，用Altera公司的CYCLONE III系列FPGA完成SDI信號的擾碼、編碼等功能，接口芯片采用國家半導(dǎo)體公司的LMH0001，使用Tektronix VFM 7120進(jìn)行測試，信號指標(biāo)符合SMPTE259M標(biāo)準(zhǔn)。
關(guān)鍵字： FPGA SDI LMH0001 201303

基于數(shù)字相關(guān)器與DSP的短波數(shù)據(jù)解調(diào)器設(shè)計

摘要：論文基于最佳接收機(jī)原理，在DSP硬件平臺設(shè)計并實現(xiàn)了短波數(shù)據(jù)的多路FSK解調(diào)。探討了接收機(jī)的核心部件數(shù)字相關(guān)器在DSP上實現(xiàn)的幾種算法及使用中的時間復(fù)雜度，并利用副本載波自身的周期性，有效壓縮了數(shù)據(jù)的存儲空間。
關(guān)鍵字： DSP FSK 相關(guān)器 201303

時分復(fù)分技術(shù)的FPGA實現(xiàn)

摘要：用FPGA芯片來實現(xiàn)時分復(fù)分接技術(shù)，設(shè)計復(fù)用電路和分接電路。發(fā)送端完成復(fù)用電路。在發(fā)送端將一路1024K數(shù)據(jù)、一路512K數(shù)據(jù)、7路64K數(shù)據(jù)通過時分復(fù)用，合成一路2048K數(shù)據(jù)，傳輸出去。接收端完成分接電路。
關(guān)鍵字： PCM FPGA 201303

使用Zynq-7000 All Programmable SoC實現(xiàn)圖像傳感器色彩校正

摘要：我們在本文介紹的算法闡述了如何使用運行在嵌入式處理器(諸如Zynq處理平臺采用的ARM9核)上的軟件，控制執(zhí)行像素級色彩校正的定制圖像和視頻處理算法。
關(guān)鍵字：賽靈思嵌入式 Zynq FPGA 201303

一種基于FPGA的三電平原理及實現(xiàn)方式

針對兩電平DSP2407控制板在三電平逆變器控制中資源不足的問題，在不改變原有成熟算法和硬件的基礎(chǔ)上，提出一種基于現(xiàn)場可編程門陣列(FPGA)的三電平實現(xiàn)方法。采用FPGA構(gòu)造了三電平脈寬調(diào)制(PWM)IP核，包含三電平調(diào)制策略、驅(qū)動脈沖分配和保護(hù)、死區(qū)補償、零序電壓注入、中點電壓平衡控制及阻尼振蕩抑制算法等功能，并解決了DSP與FPGA的同步問題?；贔PGA和DSP構(gòu)建一個三電平逆變器硬件平臺，在一臺30 kW三相異步電機(jī)上完成了相關(guān)實驗。實驗結(jié)果驗證了該方法的可行性和正確性，為兩電平調(diào)速算法拓展到三
關(guān)鍵字： FPGA 三電平方式原理

基于FPGA的電力諧波檢測設(shè)計

基于FFT算法的電力系統(tǒng)諧波檢測裝置，大多采用DSP芯片設(shè)計。DSP芯片是采用哈佛結(jié)構(gòu)設(shè)計的一種CPU，運算能力很強(qiáng)，速度很快;但是其順序執(zhí)行的模式限制了其進(jìn)行FFT運算的速度。而現(xiàn)場可編程邏輯門陣列(Field Programm
關(guān)鍵字： FPGA 電力諧波檢測

CEVA和Mindspeed合作關(guān)系滿足LTE-Advanced小型基站

全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán)(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司和小型基站(small cell)系統(tǒng)級芯片(SoC)解決方案領(lǐng)導(dǎo)廠商Mindspeed, (NASDAQ:MSPD)宣布擴(kuò)大戰(zhàn)略合作關(guān)系，CEVA公司為Mindspeed公司提供用于下一代LTE-Advanced多模小型基站Transcede? SoC的CEVA-XC4000 DSP授權(quán)許可。
關(guān)鍵字： CEVA DSP SoC

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基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)

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