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dsp＋fpga 文章進入dsp＋fpga技術(shù)社區(qū)

德州儀器推出 C6A816x Integra? DSP + ARM 系列處理器

　　日前，德州儀器 (TI) 宣布在現(xiàn)有數(shù)字信號處理器 (DSP) + ARM? 產(chǎn)品的成功基礎(chǔ)上推出 C6A816x Integra? DSP + ARM 系列處理器。C6A816x Integra DSP + ARM 處理器不但可提供高達 1.5 GHz 的業(yè)界最快單內(nèi)核浮點與定點 DSP 性能，而且還集成性能高達 1.5 GHz 的業(yè)界最快單內(nèi)核 ARM Cortex?-A8 內(nèi)核。
關(guān)鍵字：德州儀器 DSP 處理器

一種基于FPGA的電子穩(wěn)像系統(tǒng)的研究與設計

電子攝像系統(tǒng)已廣泛應用于軍用及民用測繪系統(tǒng)中，但是效果受到其載體不同時刻姿態(tài)變化或震動的影響。當工...
關(guān)鍵字：電子穩(wěn)像系統(tǒng) FPGA 圖像檢測

28納米FPGA產(chǎn)品激戰(zhàn)

　　賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品，不僅使FPGA市場戰(zhàn)火升溫，也讓晶圓代工市場激烈角逐，在Xilinx首度與臺積電攜手合作后，Altera在28納米產(chǎn)品的布局上亦相當積極，近期亦展示在28納米FPGA平臺上的25-Gbps收發(fā)器，F(xiàn)PGA雙雄的激烈競賽，預料臺積電將成為最大受惠者。　　
關(guān)鍵字：臺積電 FPGA

SiTime為賽靈思(Xilinx) FPGA評估套件提供可編程時脈方案

　　全硅MEMS時脈技術(shù)方案領(lǐng)導公司SiTime Corporation今天宣布賽靈思(Xilinx)在其Virtex?-6 FPGA ML605評估套件, Spartan?-6 FPGA SP601 和SP605 FPGA評估套件上導入了SiTime可編程全硅MEMS振蕩器。全球可編程平臺領(lǐng)導廠商賽靈思公司在這些評估套件中采用了SiTime的 SiT9102高性能差分振蕩器及各種規(guī)格組合的SiT8102可編程高性能振蕩器。　　
關(guān)鍵字： SiTime FPGA

SiTime為賽靈思FPGA評估套件提供可編程時鐘方案

　　2010年9月15，美國加洲森尼韋爾市-全硅MEMS時鐘技術(shù)方案領(lǐng)導公司SiTime Corporation今天宣布賽靈思(Xilinx)在其Virtex®-6 FPGA ML605評估套件, Spartan®-6 FPGA SP601 和SP605 FPGA評估套件上導入了SiTime可編程全硅MEMS振蕩器。全球可編程平臺領(lǐng)導廠商賽靈思公司在這些評估套件中采用了SiTime的 SiT9102高性能差分振蕩器及各種規(guī)格組合的SiT8102可編程高性能振蕩器。　　“賽靈
關(guān)鍵字： Xilinx Virtex FPGA

一種基于FPGA和單片機的掃頻儀設計與實現(xiàn)

一個網(wǎng)絡的頻率特性包括幅頻特性和相頻特性，在系統(tǒng)設計時，各個網(wǎng)絡的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶...
關(guān)鍵字：掃頻儀 FPGA 單片機

基于FPGA分布式算法的濾波器設計

設計了FPGA的分布式算法結(jié)構(gòu)和具體的硬件環(huán)境。基于FPGA的分布式算法充分利用FPGA的并行處理特性設計算法，簡化了濾波器系統(tǒng)設計。采用了分割查找表技術(shù)，節(jié)省了FPGA硬件資源。對查找表(LUT)中內(nèi)容經(jīng)過相應的修改即可方便地實現(xiàn)低通、高通、帶通濾波。對基于FPGA分布式算法的濾波器進行了仿真及工況環(huán)境下的測試實驗。實驗結(jié)果表明，該算法不僅提高了系統(tǒng)運行速度，而且節(jié)省了大量的FPGA資源，還具有極大的靈活性。
關(guān)鍵字： FPGA 分布式算法濾波器設計

大容量無線傳輸技術(shù)中DSP的啟動

大容量無線傳輸技術(shù)中DSP的啟動,1 引言

在極低譜密度，高頻譜利用率的大容量無線傳輸技術(shù)中，高速實時信號處理成為技術(shù)的關(guān)鍵。目前市場上，能滿足對高速實時信號處理的需要有具有良好的可編程性的器件主要有 DSP 和FPGA。

TMS320C6000 系
關(guān)鍵字： DSP 啟動技術(shù) 傳輸無線大容量

基于DSP的交流電機伺服控制器設計

關(guān)鍵字：雙閉環(huán)控制 DSP 交流電機伺服控制

在小尺寸DSP上實現(xiàn)2D條形碼解碼

條形碼一般被用于將關(guān)鍵的字母數(shù)字信息轉(zhuǎn)換為數(shù)字系統(tǒng)能夠掃描和讀取的符號信息，而無需每次都要將信息錄...
關(guān)鍵字： 2D條形碼 DSP CRC 解碼

ADSP21062信號處理板的一種簡易測試方法

關(guān)鍵字： DSP 測試方法雷達信號處理系統(tǒng)

基于DSP+MCU的列車滾動軸承故障診斷系統(tǒng)設計

關(guān)鍵字：滾動軸承故障診斷 DSP MCU Hilbert交換小波奇異性檢測

帶寬自適應全數(shù)字鎖相環(huán)的設計與實現(xiàn)

關(guān)鍵字： DSP-Builder 帶寬自適應 PI控制全數(shù)字鎖相環(huán)

合眾達聯(lián)手TI推出免費Code Composer Studio IDE v4

　　自即日起至2010年12月31日期間，合眾達聯(lián)合TI推出免費的、可永久持續(xù)升級的Code Composer Studio IDE v4. 　　凡購買任意一款合眾達公司(SEED)的基于TI處理器平臺的SEED-XDS560仿真器或SEED-XDS510仿真器，您將即刻免費獲得鉑金版支持永久持續(xù)升級的Code Composer Studio IDE v4. 　　同時，合眾達為回饋老客戶，凡購買過合眾達仿真器的朋友，　　可免費下載Code Composer Studio IDE v4 　　注冊可
關(guān)鍵字：合眾達 DSP

一種基于FPGA的雷達脈沖預分選器設計

0引言現(xiàn)代電子戰(zhàn)環(huán)境日趨復雜，信號日趨密集，新體制雷達不斷出現(xiàn)，雷達信號的各個參數(shù)以各種規(guī)律變化，...
關(guān)鍵字： FPGA 雷達信號雷達脈沖預分選器

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dsp＋fpga電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設計的方法
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