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          多種EDA工具的FPGA設(shè)計方案

          • 概述:介紹了利用多種EDA工具進(jìn)行FPGA設(shè)計的實現(xiàn)原理及方法,其中包括設(shè)計輸入、綜合、功能仿真、實現(xiàn)、時序仿真、配置下載等具體內(nèi)容。并以實際操作介紹了整個FPGA的設(shè)計流程。 關(guān)鍵詞: FPGA 仿真 綜合 EDA在數(shù)字
          • 關(guān)鍵字: FPGA  EDA  設(shè)計方案    

          對勾形復(fù)蘇 新需求引領(lǐng)半導(dǎo)體業(yè)革新

          •   今年4月的Globalpress電子峰會如期在美國舊金山舉行,30多家公司的密集講演折射出半導(dǎo)體業(yè)的回暖態(tài)勢,而從與會公司的發(fā)展策略和分享的熱點技術(shù)中,或可一窺半導(dǎo)體業(yè)下一波的發(fā)展方向。本報記者特就其中的熱點技術(shù)進(jìn)行探討,并就幾家公司的發(fā)展策略進(jìn)行介紹,以饗讀者。   ASIC與FPGA發(fā)力低功耗   年參加Globalpress電子峰會的企業(yè)代表中,與FPGA相關(guān)的公司數(shù)量眾多,包括Altera、Lattice(萊迪思)、QuickLogic等。而與其呈此消彼長之勢的ASIC陣營也不甘示弱,Op
          • 關(guān)鍵字: ASIC  FPGA  

          基于FPGA視頻采集中的I2C總線設(shè)計與實現(xiàn)

          • 隨著編碼理論和多媒體網(wǎng)絡(luò)應(yīng)用的發(fā)展,圖像和視頻壓縮編碼JPEG2000系統(tǒng)應(yīng)用得到逐步推廣。在此從視頻采集中I2C總線的特點、協(xié)議入手,著重對I2C總線設(shè)計及實現(xiàn)方法進(jìn)行介紹?;谝曨l采集芯片SAA7111,提出采用VHDL語言來模擬實現(xiàn)I2C總線接口的方法,并將其嵌入到FPGA中。實驗仿真結(jié)果證明數(shù)據(jù)是正確、穩(wěn)定、可靠的,具有一定的可借鑒性。
          • 關(guān)鍵字: 總線  設(shè)計  實現(xiàn)  I2C  集中  FPGA  視頻  基于  通信協(xié)議  

          FPGA+DSP導(dǎo)引頭信號處理中FPGA設(shè)計的關(guān)鍵技術(shù)

          • 1引言隨著同防工業(yè)對精確制導(dǎo)武器要求的不斷提高,武器系統(tǒng)總體設(shè)計方案的日趨復(fù)雜,以及電子元器件水...
          • 關(guān)鍵字: FPGA+DSP  導(dǎo)引頭  信號處理  設(shè)計  

          利用VHDL語言進(jìn)行可變速彩燈控制器的設(shè)計

          • 0引言硬件描述語言(HDL)是相對于一般的計算機(jī)軟件語言如C,Pascal而言的。HDL是用于設(shè)計硬件電子系...
          • 關(guān)鍵字: VHDL  FPGA  CPLD  可變速  彩燈控制器  

          使用RapidIO技術(shù)搭建可重構(gòu)信號處理平臺

          • 摘要:軍事領(lǐng)域常選擇ADI公司的TS201芯片用于信號處理平臺,但由于其采用基于電路交換的LINK口進(jìn)行連接,...
          • 關(guān)鍵字: FPGA  RapidIO  可重構(gòu)  信號處理  DSP  LINK口  

          2009~2010年度TI DSP大賽決賽在哈爾濱舉行

          •   2010年5月19日至22日,2009~2010年度TI DSP大獎賽決賽在哈爾濱隆重舉行,本次競賽由德州儀器主辦,哈爾濱工程大學(xué)承辦。共有來自全國25所高校的41支參賽隊,200余名師生參加了此次決賽,哈爾濱工程大學(xué)、復(fù)旦大學(xué)、清華大學(xué)、深圳大學(xué)等4支參賽隊分別獲得了OMAP3專題組、算法組、系統(tǒng)設(shè)計組的一等獎。德州儀器副總裁林坤山先生,首席科學(xué)家Gene Frants先生、亞洲區(qū)大學(xué)計劃部總監(jiān)沈潔女士以及哈爾濱工程大學(xué)領(lǐng)導(dǎo)出席并為獲獎學(xué)生頒獎。 會場   2009~2010年度TI DSP
          • 關(guān)鍵字: TI  DSP  

          Altium在Altium Designer軟件內(nèi)新增Aldec FPGA仿真技術(shù)

          •   Altium和Aldec日前簽署的OEM協(xié)議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。   該協(xié)議的簽署使進(jìn)行FPGA(現(xiàn)場可編程門陣列)設(shè)計的電子產(chǎn)品設(shè)計師們?nèi)缁⑻硪恚瑯I(yè)內(nèi)領(lǐng)先的Aldec VHDL及Verilog仿真功能實現(xiàn)了無縫集成,與Altium Designer軟件融為一體。電子產(chǎn)品設(shè)計師們可以在Altium電子產(chǎn)品設(shè)計統(tǒng)一架構(gòu)中使用久經(jīng)考驗的Aldec仿真技術(shù)。   Altium首席執(zhí)行官Nick Martin表示:“多年來,Alti
          • 關(guān)鍵字: Altium  FPGA  Designer  

          基于CycloneII和MSP430的網(wǎng)絡(luò)數(shù)據(jù)加密實現(xiàn)

          基于NiosII的視頻采集與DVI成像研究及實現(xiàn)

          • 摘要:采用FPGA作為視頻采集控制和圖像處理芯片,配置NiosII軟核,在FPGA片內(nèi)完成圖像處理和圖像顯示控制,...
          • 關(guān)鍵字: FPGA  NiosII  DVI  圖像采集  

          基于FPGA實現(xiàn)多路模擬信號自適應(yīng)采集系統(tǒng)

          • 主要介紹基于FPGA實現(xiàn)多路模擬信號自適應(yīng)采集系統(tǒng)的設(shè)計。該系統(tǒng)主要包括軟件和硬件兩部分:硬件主要采用FPGA芯片,AD7982-1,ADG406和運放AD824來搭建硬件平臺;軟件包括FPGA程序和事后數(shù)據(jù)處理程序。系統(tǒng)采用動態(tài)8位量化方式克服了固定8位量化對信號采集精度的影響,目前已成功用于產(chǎn)品中。
          • 關(guān)鍵字: FPGA  多路  采集系統(tǒng)  模擬信號    

          新的變步長LMS算法及DSP設(shè)計

          • 新的變步長LMS算法及DSP設(shè)計,Widrow和Hoff等人于1960年提出最小均方誤差(LMS)算法,由于其結(jié)構(gòu)簡單,計算量小,穩(wěn)定性好,易于實現(xiàn)等優(yōu)點而得到廣泛的應(yīng)用。LMS算法的缺點是收斂速度慢,它克服不了收斂速度和穩(wěn)態(tài)誤差這一對固有矛盾:在收斂的前
          • 關(guān)鍵字: 設(shè)計  DSP  算法  LMS  步長  

          基于DSP TMS320LF2407的自動避障小車

          基于TMS320C5410的256PPM調(diào)制設(shè)計

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