1裝置的配置及硬件特點葛洲壩大江電廠主接線如圖I所示。變壓器主保護的硬件平臺采用的是北京康拓...
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APCI控機 DSP 變壓器
Tensilica今日宣布，多媒體IC設計公司Skyviia已為其新一代多媒體SoC(片上系統(tǒng))設計選用了Tensilica的HiFi音頻DSP內核。
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Tensilica HiFi音頻 DSP
DSP的雙電源解決方案,DSP的供電電路設計是DSP應用系統(tǒng)設計的一個重要組成部分。TIDSP家族（C6000和C54xx）要求有獨立的內核電源和I／O電源，如TMS320VC5402，它的內核電壓是1．8V，I／O電壓是3．3V。由于DSP一般在系統(tǒng)中要承擔大量的實時
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解決方案 電源 DSP
全球領先的硅產品知識產權(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內核授權廠商CEVA公司宣布，東芝公司 (Toshiba Corporation) 獲CEVA-TeakLite-III DSP內核授權許可，助力其即將推出的移動音頻芯片和汽車音頻DSP產品系列。CEVA-TeakLite-III DSP內核具有用于此類復雜音頻應用的最佳性能，為東芝提供最先進和成熟的32位音頻DSP能力。這一內核在The Linley Group的DSP內核報告中獲評選為“最優(yōu)音頻處理器”
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東芝 DSP
全球領先的硅產品知識產權(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內核授權廠商CEVA公司宣布，東芝公司 (Toshiba Corporation) 獲CEVA-TeakLite-III DSP內核授權許可，助力其即將推出的移動音頻芯片和汽車音頻DSP產品系列。CEVA-TeakLite-III DSP內核具有用于此類復雜音頻應用的最佳性能，為東芝提供最先進和成熟的32位音頻DSP能力。這一內核在The Linley Group的DSP內核報告中獲評選為“最優(yōu)音頻處理器”。
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CEVA DSP
由全球領先的高性能信號處理解決方案供應商和數(shù)據(jù)轉換器市場份額領先者Analog Devices, Inc. 贊助的2011 ADI 中國大學創(chuàng)新設計競賽（UDC-University Design Competition）頒獎典禮于今日在上海復旦大學成功舉行。來自全國的決賽選手與行業(yè)技術專家、以及 ADI 國內外高管等齊聚一堂，多項涉及工業(yè)自動化控制、汽車電子、娛樂消費等基于 MEMS 應用領域的創(chuàng)新作品成為本次盛典的亮點。
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ADI DSP
11月1日至4日，第二屆德州儀器 (TI) 全球核心大學計劃國際研討會在古城西安召開，該研討會為全球頂級電子工程院校搭建了一個創(chuàng)新交流平臺，來自世界各地的知名教授就未來電子工程教育和研究方向、高等教育與產業(yè)如何結合、以及當前電子產業(yè)熱點，如IC如何影響云計算等話題展開了分享和探討。同時，今年是TI大學計劃在中國開展的第十五個年頭，2011 TI 中國大學計劃十五周年年會(2011 TI中國教育者年會)也同期在西安舉行。
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TI DSP
全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc.)近日宣布推出具有全新功能的 ISE 13.3 設計套件，可幫助 DSP 設計人員在面向無線、醫(yī)療、航空航天與軍用、高性能計算和視頻應用的設計中輕松實現(xiàn)具備比特精度的單精度、雙精度、完全定制精度浮點數(shù)學運算。
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賽靈思 DSP ISE 13.3
摘要：根據(jù)相關測速原理，利用相關差值法的信號處理方法，設計一種基于DSP的非接觸式智能實時測速系統(tǒng)。系統(tǒng)采...
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速度測量 相關理論 峰值搜索 DSP
摘 要：介紹了一種利用雙口RAM實現(xiàn)DSP與單片機高速數(shù)據(jù)通信的方法，給出了它們之間的接口電路以及軟件實現(xiàn)方案 ...
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DSP 51單片機 高速通信
基于DSP的JPEG圖像壓縮設計,一、引言 JPEG算法是一種數(shù)字圖像壓縮編碼算法，具有壓縮比例高、失真小的特點，并已被確定為國際標準[1]。該標準被廣泛應用于數(shù)碼相機、監(jiān)視系統(tǒng)、手機、可視電話等等諸多方面。它的應用與實現(xiàn)不僅限于PC機
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壓縮 設計 圖像 JPEG DSP 基于
數(shù)字視頻產品需求近些年出現(xiàn)猛增。主流應用包括視頻通信、視頻監(jiān)控與工業(yè)自動化，而最熱門的要算娛樂應用，如D...
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視頻算法 DSP
移相器簡介
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變頻器 模塊 設計 變壓 相器 DSP 控制 數(shù)字 基于
基于DSP的IP電話設計,引言 傳統(tǒng)的電話網(wǎng)是以電路交換的方式傳輸語音信號的，它需要的基本帶寬為64kbit/s。據(jù)統(tǒng)計，在正常通話情況下，大約只有40％的時間為有聲期，其余時間電路均為空占，網(wǎng)絡帶寬利用率不高。隨著計算機技術的不斷發(fā)
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設計 電話 IP DSP 基于
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