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基于DSP和FPGA的磁浮列車同步485通信方式研究

在高速磁浮交通系統(tǒng)中，車載測速定位單元對車輛的位置和速度進(jìn)行實(shí)時(shí)測量，并將位置和速度信號通過無線電系統(tǒng)傳送至地面上的牽引控制系統(tǒng)和運(yùn)行控制系統(tǒng)，以用于長定子直線同步電機(jī)牽引的反饋控制，以及車輛運(yùn)行的指揮和安全防護(hù)。測速定位單元是牽引和運(yùn)控系統(tǒng)閉環(huán)控制的核心與關(guān)鍵。測速定位單元緊鄰懸浮電磁鐵及長定子繞組和鐵心，處于懸浮磁場和牽引磁場中，電磁環(huán)境非常復(fù)雜，這對其通信設(shè)備的電磁兼容性能提出了很高的要求。另外，為滿足牽引控制系統(tǒng)的需求，測速定位信號的精度要求相當(dāng)高。因此，測速定位信號傳輸?shù)乃俣取?shí)時(shí)
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TMS320F2812外部接口分析與存儲器擴(kuò)展

TMS320F2812是德州儀器(TI)公司專門為工業(yè)應(yīng)用而設(shè)計(jì)的新一代DSP處理器，它的性能大大優(yōu)于當(dāng)前廣泛使用的TMS320LF240x系列。該芯片為32位定點(diǎn)DSP，最高主頻150 MHz，最小指令周期6.67 ns，外部采用低頻時(shí)鐘，通過片內(nèi)鎖相環(huán)倍頻；相對于TMS320LF2407只能尋址192 KB地址空間，該芯片的外部接口最多可尋址4 MB的空間；有3個(gè)獨(dú)立的片選信號，并且讀／寫時(shí)序可編程，兼容不同速率的外設(shè)擴(kuò)展；通過配置外部接口寄存器，在訪問外部設(shè)備
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DSP性能提升將成數(shù)字消費(fèi)產(chǎn)品核心引擎

DSP在發(fā)展過程中從始至終都經(jīng)受著各種嚴(yán)峻的挑戰(zhàn)，同時(shí)也總是能夠從中產(chǎn)生出許多新的機(jī)遇，并且也創(chuàng)造出不少奇跡。隨著其性能的不斷提升和成本的降低，它的應(yīng)用領(lǐng)域在不斷拓展。此外還伴隨著與FPGA、MCU競爭態(tài)勢的加劇，DSP如何解決新形勢下的“老問題”。本報(bào)特邀請業(yè)內(nèi)代表發(fā)表觀點(diǎn)。 DSP應(yīng)用不斷拓展 .DSP將全面覆蓋嵌入式數(shù)字信息市場，可以取代常規(guī)處理器CPU，甚至可以沖擊單片機(jī)MCU、ASIC的市場；圖像和聲音處理為DSP展開巨大的市場空間。鄭小龍隨著DSP性能的提高，其功耗與價(jià)格的
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基于DSP的雷達(dá)視頻信號數(shù)字采集與檢測

引言反應(yīng)速度更快、精度更高、目標(biāo)的自動錄取、使操作員能夠同時(shí)處理多批目標(biāo)，是現(xiàn)代雷達(dá)所追求的技術(shù)指標(biāo)。雷達(dá)視頻信號的數(shù)字采集和檢測是達(dá)成這樣目標(biāo)的前提條件。眾所周知，雷達(dá)對目標(biāo)位置的測量，主要是依據(jù)目標(biāo)回波相對于發(fā)射電波的延遲時(shí)間以及雷達(dá)天線的方向來決定的。電波的傳播速度極快，傳播l海里的時(shí)間大約只有12.35μs，雷達(dá)發(fā)射電波的間隔一般在ms數(shù)量級。在此間隔時(shí)間內(nèi)，理論上最多會有成百上千個(gè)目標(biāo)的回波。要在如此短的時(shí)間之內(nèi)，對這么多的目標(biāo)回波信號進(jìn)行數(shù)字采集和處理，快速的采集器件及高速計(jì)算機(jī)處理器
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基于DSP和CPLD的智能相機(jī)系統(tǒng)設(shè)計(jì)與研制

作者結(jié)合DSP技術(shù)、CPLD/FPGA技術(shù)，以及圖像處理技術(shù)、傳感器技術(shù)等，開發(fā)設(shè)計(jì)出一種實(shí)用的嵌入式實(shí)時(shí)圖像處理系統(tǒng)――工業(yè)用智能相機(jī)，實(shí)現(xiàn)了產(chǎn)品質(zhì)量的自動檢測和分類。
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TD-SCDMA系統(tǒng)基帶處理的DSP+FPGA實(shí)現(xiàn)方案

摘要：本文在分析TD-SCDMA系統(tǒng)基帶處理方案的基礎(chǔ)上，提出了一種在性能、靈活性和性價(jià)比方面都比較理想的DSP+FPGA基帶發(fā)送的實(shí)現(xiàn)方案。關(guān)鍵詞：TD-SCDMA；基帶處理；DSP；FPGA 引言和傳統(tǒng)的CDMA系統(tǒng)相比，第三代移動通信的最大特點(diǎn)在于能支持多種速率的業(yè)務(wù)，從話音到分組數(shù)據(jù)，再到多媒體業(yè)務(wù)，并能根據(jù)具體的業(yè)務(wù)需要，提供必要的帶寬，數(shù)據(jù)處理量非常大。然而，對不同速率業(yè)務(wù)的基帶處理，所需的存儲量、運(yùn)算量以及處理延時(shí)差異很大。因此，采用何種硬件結(jié)構(gòu)才能有效地處理各種業(yè)務(wù)是本文所要探討的問
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合成孔徑雷達(dá)成像系統(tǒng)逆存儲轉(zhuǎn)置器的DSP設(shè)計(jì)

本文設(shè)計(jì)的ICTM模塊以TI的一款高性能定點(diǎn)DSP芯片TMS320C6415為核心處理器，兩條大容量SDRAM作為外部存儲器，實(shí)現(xiàn)輸入數(shù)據(jù)的逆存儲轉(zhuǎn)置操作。
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基于DSP的NURBS曲線插補(bǔ)控制

本文介紹了一種基于TMS320LF2407a DSP芯片的運(yùn)動控制卡的設(shè)計(jì)方法及NURBS插補(bǔ)的概念，提出了實(shí)現(xiàn)NURBS曲線插補(bǔ)的一種實(shí)時(shí)方法
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Xilinx發(fā)布新版DSP開發(fā)工具可提升性能38%

賽靈思公司宣布其DSP開發(fā)工具可將多速率DSP設(shè)計(jì)的Fmax性能提升高達(dá)38%，同時(shí)還大大提高了易用性。AccelDSP?綜合工具和System Generator for DSP工具9.2版的發(fā)布，使Xilinx? XtremeDSP? 解決方案的開發(fā)工具組件提供了更高的性能水平，同時(shí)兩種工具間的集成也更為緊密，為同時(shí)使用MATLAB? 和 Simulink? 建模環(huán)境的開發(fā)人員進(jìn)一步簡化了FPGA設(shè)計(jì)流程。 “
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TI高管指點(diǎn)中國未來DSP應(yīng)用熱點(diǎn)

近日，德州儀器(TI)DSP系統(tǒng)產(chǎn)品部全球副總裁NielsAnderskouv在訪問北京期間表示，對中國來說這是一個(gè)充滿無限可能的時(shí)代。視頻、無線基礎(chǔ)設(shè)施、醫(yī)療、綠色科技將在中國成為具有極大潛力的DSP應(yīng)用市場。其中，視頻安全領(lǐng)域在中國已開始加快增速。創(chuàng)新將使中國在未來全球電子領(lǐng)域扮演更為重要的角色，而TIDSP技術(shù)無疑將快速推動上述應(yīng)用領(lǐng)域的創(chuàng)新。根據(jù)iSuppli今年7月發(fā)布的報(bào)告顯示，中國DSP市場將繼續(xù)以每年10%的速度增長，TI認(rèn)為視頻
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FPGA-DSP 瞄準(zhǔn)目標(biāo)：用得起的 DSP 性能

FPGA-DSP性能揭秘在無線基站等高性能 DSP 應(yīng)用中，考慮將 FPGA 用作處理引擎者日益增多。在這些應(yīng)用中，F(xiàn)PGA 既可與 DSP 處理器一爭高下，亦可與之比翼齊飛。有了更多選擇，就意味著系統(tǒng)設(shè)計(jì)者有必要了解高端FPGA的信號處理性能，其中既包括 FPGA 之間的性能對比，也包括與高端 DSP 處理器的性能對比。遺憾的是，最常用的性能數(shù)字非但有失可靠、含混不清，而且常常是矛盾百出。例如，因?yàn)?DSP 應(yīng)用常常在很大程度上依賴乘法累加 (MAC) 運(yùn)算，所以 DSP 處理器和 FPGA 供應(yīng)商有時(shí)
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基于電力電子應(yīng)用平臺DSP通用板的設(shè)計(jì)

隨著電力電子市場需求與日俱增, 為了縮短電力電子硬件設(shè)計(jì)的開發(fā)時(shí)間，本文設(shè)計(jì)開發(fā)了DSP56F803通用板作為各種電力電子應(yīng)用的硬件開發(fā)平臺。
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基于DSP三軸跟蹤轉(zhuǎn)臺伺服控制系統(tǒng)設(shè)計(jì)

本文介紹了基于TMS320F2812三軸跟蹤轉(zhuǎn)臺伺服控制系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)。
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基于TMS320LF2407 DSP控制器語音模塊的設(shè)計(jì)

本文著重介紹了DSP芯片的SPI同步串行接口及SPI與語音轉(zhuǎn)換芯片AD50的通信方式，給出了硬件電路設(shè)計(jì)。
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DSP軟件向桌面和嵌入式系統(tǒng)挑戰(zhàn)

如何合理地安排數(shù)據(jù)流程，使之在DSP的各執(zhí)行單元間無沖突地順利執(zhí)行，仍是DSP開發(fā)人員面臨的一個(gè)非常重要的問題。由于設(shè)計(jì)的復(fù)雜性，將算法映射到DSP具體目標(biāo)硬件上，尚不能采用高層次編程語言，必須使用匯編語言，并對器件的并行執(zhí)行機(jī)制有十分清楚的了解。而這種局限于匯編語言的編程設(shè)計(jì),正是提高軟件開發(fā)效率的瓶頸。　　90年代早期，嵌入式系統(tǒng)和桌面應(yīng)用的開發(fā)人員曾面臨相似的問題。當(dāng)時(shí)為提高設(shè)計(jì)效率而采用的方法現(xiàn)在仍可借鑒使用。一個(gè)短期的解決方案是由編程人員自己解決這一問題。但是，編程人員相對短缺，而且DSP
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