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DSP+FPGA在高速高精運動控制器中的應用
- 運動控制卡已經(jīng)在數(shù)控機床、工業(yè)機器人、醫(yī)用設備、繪圖儀、IC電路制造設備、IC封裝等領域得到了廣泛運用，取得了良好的效果。目前運動控制卡大部分采用8051系列的8位單片機，雖然節(jié)省了開發(fā)周期但缺乏靈活性，難以勝任高要求運作環(huán)境，而且運算能力有限。 DSP的數(shù)據(jù)運算處理功能強大，即使在很復雜的控制中，采樣周期也可以取得很小，控制效果更接近于連續(xù)系統(tǒng)。把DSP與PC的各自優(yōu)勢結合將是高性能數(shù)控系統(tǒng)的發(fā)展趨勢。本運動控制器采用TI公司的高性能浮點DSP作為主控芯片，通過ISA接口與PC
- 關鍵字： DSP FPGA 運動控制 插補 伺服
基于構件技術的嵌入式系統(tǒng)復用軟件設計
- 引言 對嵌入式軟件構件平臺而言，其支撐平臺首先是一個嵌入式實時多任務操作系統(tǒng)，其次為整個軟件構件的設計提供開發(fā)工具和集成環(huán)境。在支撐平臺的設計過程中，可以借鑒領域工程的思想，將整個嵌入式實時多任務操作系統(tǒng)設計成一個系統(tǒng)級的軟件構件庫。這樣不但實現(xiàn)了嵌入式操作系統(tǒng)的可裁剪性，而且由于從嵌入式操作系統(tǒng)到應用程序的設計都是基于離散化的軟件構件，因此方便了嵌入式控制應用軟件設計時的集成和調試。為了方便軟件構件的管理，可以將系統(tǒng)級和應用級的軟件構件庫綜合成一個功能完備的軟件構件庫。它包括從嵌入式控制系統(tǒng)的
- 關鍵字： 嵌入式 軟件構件平臺 操作系統(tǒng) DSP
Xilinx推出LogiCORE Turbo編解碼器解決方案
- 賽靈思公司（Xilinx, Inc.）推出針對LTE無線系統(tǒng)的性能優(yōu)化可編程Turbo編碼解決方案。利用Spartan® 和 Virtex®現(xiàn)場可編程門陣列（FPGA）嵌入的數(shù)字信號處理（DSP）能力, 新推出的Xilinx 3GPP LTE Turbo 編碼器和解碼器LogiCORE™ 產(chǎn)品提供了高達200 Mbps的吞吐能力，可滿足不斷演化的長期演進（LTE）標準對現(xiàn)代無線系統(tǒng)提出的語音和日益增長的數(shù)據(jù)通信要求。 Turbo碼最初專為3G無線系統(tǒng)的商用
- 關鍵字： Xilinx LTE Turbo FPGA DSP 編碼器 解碼器
基于TMS320C50的通用語音信號處理系統(tǒng)
- 語言是人類相互溝通信息的重要工個。隨著現(xiàn)代科學技術的發(fā)展,特別是語音通信和各種語音產(chǎn)品的廣泛普及,語音信號的數(shù)字化處理在越來越多的領域中發(fā)揮著巨大的作用。目前,各種以語言信號數(shù)字處理為特點的商品已經(jīng)進入市場,商品化的語音信號處理機也已問世,如KAY公司的CSL TM（Computerized Speech Lab）。 一個完備的語音信號處理系統(tǒng)不但要具備語音信號的采集和回放功能,而且更重要的是要能完成復雜的語音信號分析和處理算法。通常這些算法運算量大,且又要滿足實時或準實時的快速高效處理要求,因
- 關鍵字： DSP 語音 信號處理
多核設計需掌握關鍵技術
- 過去一段時間以來，收益遞減法則(Law of Diminishing Return)在傳統(tǒng)處理器架構的進展方面已經(jīng)明顯體現(xiàn)出來。每一代新工藝幾何尺寸和新興微架構的進步，在相應性能上所能帶來的增益正在逐漸減少──顯然，借助更快速度以實現(xiàn)摩爾定律的方法不再靈驗！功耗和微架構改良的限制，使單一處理器的發(fā)展前景受挫，業(yè)界的關注焦點已轉向多處理器或多核芯片架構的開發(fā)潛力。 由于多核主要是用于克服單處理器系統(tǒng)局限性的，所以很多人認為，采用多核純粹是出于性能方面的考慮。但以picoChip的經(jīng)驗來看，多核技術
- 關鍵字： 多核 收益遞減法則 DSP 處理器
一種實時信號處理系統(tǒng)的研究和實現(xiàn)
- 引言 近年來，實時信號處理的要求越來越高，所用系統(tǒng)要求具有處理大量數(shù)據(jù)的能力，這就要求系統(tǒng)硬件要達到很高的運算速度，并且軟件處理程序也要盡可能優(yōu)化，以保證系統(tǒng)的實時性。本文基于FPGA和ADSP-TS101S所實現(xiàn)的一種高速數(shù)據(jù)并行處理系統(tǒng)，可以進行實時連續(xù)波和脈沖波的處理，并將連續(xù)波的頻譜和脈沖波脈沖幅度信息、脈前時刻、脈寬及載頻打包輸出。整個系統(tǒng)的輸出延時被控制在1ms之內。 系統(tǒng)任務及系統(tǒng)結構 系統(tǒng)任務 系統(tǒng)頻譜分析電路組成結構如圖1所示。前端輸入為高頻寬帶模擬信號經(jīng)過數(shù)
- 關鍵字： FPGA DSP 信號處理 DMAR DMA
基于ARM和DSP的嵌入式智能儀器系統(tǒng)設計
- 1 引言 隨著智能儀器及控制系統(tǒng)對實時性信號處理的要求不斷提高和大規(guī)模集成電路技術的迅速發(fā)展。越來越迫切的要求有一種高性能的設計方案與之相適應，將DSP技術和ARM技術結合起來應用于嵌入式系統(tǒng)中，將會充分發(fā)揮兩者優(yōu)勢以達到智能控制系統(tǒng)中對數(shù)據(jù)的實時性、高效性的通信要求。該嵌入式系統(tǒng)要求實時響應，具有嚴格的時序性。其工作環(huán)境可能非常惡劣，如高溫、低溫、潮濕等，所以系統(tǒng)還要求非常高的穩(wěn)定性。 2 嵌入式系統(tǒng)的總體設計 2.1 核心器件的主要功能 ARM和DSP分別選用Cirrus
- 關鍵字： 嵌入式 智能儀器 DSP ARM
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